[发明专利]一种多通道多相滤波器中的缓存处理装置无效
申请号: | 201210016685.X | 申请日: | 2012-01-18 |
公开(公告)号: | CN102545831A | 公开(公告)日: | 2012-07-04 |
发明(设计)人: | 杨明;王新生;高桂香 | 申请(专利权)人: | 大唐移动通信设备有限公司 |
主分类号: | H03H17/00 | 分类号: | H03H17/00 |
代理公司: | 北京同达信恒知识产权代理有限公司 11291 | 代理人: | 刘松 |
地址: | 100083*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 通道 多相 滤波器 中的 缓存 处理 装置 | ||
1.一种多通道多相滤波器中的缓存处理装置,其特征在于,该装置包括一个控制模块、一个块随机存取存储器BRAM、一个触发模块、若干个寄存器、若干个系数存储器以及若干个级联的数字信号处理DSP模块,且寄存器、系数存储器及DSP模块的个数相同,且每级DSP模块对应不同的寄存器和系数存储器,其中,
所述控制模块,用于控制所述BRAM的两个输出端口顺序输出数据;
所述BRAM,用于在所述控制模块的控制下,通过两个输出端口顺序向所有寄存器输出数据;
所述触发模块,用于触发每个寄存器以及第一级DSP模块工作;
每个寄存器,用于在被所述触发模块触发时存储所述BRAM输出的数据;
每个系数存储器,用于存储设定系数;
每级DSP模块,用于在被触发时,将从自身对应的寄存器获取的数据与从自身对应的系数存储器获取的设定系数相乘,然后进行数字化处理,且在自身不是最后一级DSP模块时,触发下一级DSP模块工作。
2.如权利要求1所述的装置,其特征在于,所述BRAM的两个输出端口包括第一端口和第二端口,则
所述控制模块,用于控制所述第一端口和所述第二端口各自开始输出数据的时间间隔为设定数目个时钟周期,其中,所述设定数目为DSP模块个数的一半。
3.如权利要求1所述的装置,其特征在于,所述系数存储器包括只读存储器ROM。
4.如权利要求2所述的装置,其特征在于,所述设定数目包括3或4。
5.一种多通道多相滤波器,其特征在于,包括权利要求1~4中任意一项所述的装置。
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