[发明专利]加密数据流的方法有效

专利信息
申请号: 201110222304.9 申请日: 2011-08-04
公开(公告)号: CN102377563A 公开(公告)日: 2012-03-14
发明(设计)人: G.伯托尼;F.佐扎尼 申请(专利权)人: 意法半导体(格勒诺布尔2)有限公司;意法半导体股份有限公司
主分类号: H04L9/08 分类号: H04L9/08;H04L9/18;H04L9/32
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 刘春元;王洪斌
地址: 法国格*** 国省代码: 法国;FR
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摘要:
搜索关键词: 加密 数据流 方法
【权利要求书】:

1.一种加密或解密二进制数据流的方法,包括如下步骤:生成二进制加密流(BS),由可逆逻辑运算将该二进制数据流的每个比特与二进制加密流的比特进行组合,

其特征在于二进制加密流的生成包括如下步骤:

通过对数据块(RN,CB1,CB2)应用使用了私密密钥(SK)的密码函数(ENC1,ENC2,ENC3)来生成输入块(CB1,CB2,CB3),以及

通过由逻辑运算将输入块的比特彼此组合来从输入块生成二进制加密流(BS),以这样的方式来防止仅根据二进制加密流确定输入块。

2.按照权利要求1的方法,包括步骤:通过对先前获得的输入块(CB1,CB2)应用密码函数来连续地生成输入块(CB2,CB3)。

3.按照权利要求2的方法,其中二进制加密流的生成通过循环(C1,C2,C3)来完成,在每次循环期间生成二进制加密流(BS)的几个比特,输入块(CB1,CB2,CB3)的生成具有等于二进制加密流的几十个生成循环的持续时间。

4.按照权利要求1至3中的一项的方法,其中初始数据块(RN)随机地生成,用于通过应用密码函数生成第一数据块,并由数据流发射器(DEV1)发送给数据流接收器(DEV2)。

5.按照权利要求1至4中的一项的方法,其中二进制加密流(BS)的生成以循环方式(C1,C2,Cn)完成,每个循环包括如下步骤:将输入块(CB1)的几个比特彼此组合以生成加密流的几个比特,通过将输入块的几个比特彼此组合来更新输入块的一部分,以这种方式使得在一定次数的循环之后,输入块的每个比特依赖于初始输入块的所有比特。

6.按照权利要求1至5中的一项的方法,其中密码函数是如下类型:AES, DES, 三重DES, Twofish,或Serpent, 或者散列函数,其应用于要加密的数据(RN,CB1,CB2,CB3)以及应用于私密密钥(SK)。

7.一种流加密设备,包括:二进制加密流(BS)的生成电路(SCG),以及利用二进制加密流的比特来加密或解密的数据流的每个比特的可逆组合逻辑电路(LGS1,LGS2),

其特征在于,所述生成电路(SCG)包括:生成输入块(CB)的块加密电路(BCIP),以及根据输入块来供给二进制加密流的、输入块的比特的组合逻辑电路(SCIP),该电路(SCG)实施按照权利要求1-6中的一项的方法。

8.按照权利要求7的设备,其中组合逻辑电路(SCIP)包括:供给逻辑电路(LGF2),其生成作为输入块(CB)的比特的函数的二进制加密流(BS)的比特;以及更新逻辑电路(LGF1),其组合输入块的比特并用从所述组合得到的比特来替换输入块(CB)的比特。

9.按照权利要求8的设备,其中更新逻辑电路(LGF1)被配置使得在更新逻辑电路的一定次数的处理循环之后,更新的输入块的每个比特依赖于块加密电路(BCIP)供给的输入块的所有比特。

10.按照权利要求7或9的设备,其中组合逻辑电路(SCIP)包括:块移位寄存器(RSR),其接收加密的块(CB),该块在组合逻辑电路的每个处理循环被移位一定数目的比特,所述数目等于在组合逻辑电路的每个处理循环供给的二进制加密流(BS)的比特数目;以及逻辑门(LG1-LG4),其通过组合该移位寄存器的几个比特来供给二进制加密流的比特。

11.按照权利要求7至10中的一项的设备,其中组合逻辑电路(SCIP)包括:块移位寄存器(RSR),其接收加密的块(CB),该块在组合逻辑电路的每个处理循环被移位一定数目的比特,所述数目等于在组合逻辑电路的每个处理循环供给的二进制加密流(BS)的比特数目;以及非线性逻辑电路(NLF1-NLF4),其组合移位寄存器的比特并将通过非线性逻辑电路获取的比特引入到移位寄存器中。

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