[发明专利]控制上电顺序的方法和装置在审
申请号: | 201110221251.9 | 申请日: | 2011-08-03 |
公开(公告)号: | CN102915097A | 公开(公告)日: | 2013-02-06 |
发明(设计)人: | 叶位彬 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | G06F1/26 | 分类号: | G06F1/26 |
代理公司: | 深圳市世纪恒程知识产权代理事务所 44287 | 代理人: | 胡海国 |
地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 控制 顺序 方法 装置 | ||
技术领域
本发明涉及到通信领域,特别涉及到一种控制上电顺序的方法和装置。
背景技术
通讯设备中各单板都有上电顺序要求,传统的上电顺序控制方法主要有两种:第一,如图1所示,利用不同的电容充电延时来控制各个单板电源的使能信号,以获得不同的上电时间;第二,如图2所示,利用前一个单板电源的输出作为下一个单板电源的使能信号。第一种方法虽然电路简单,但是不容易获得准确的电容充电延时,必须仔细地调整阻容值,且很难实现大尺度的上电延时,在实际应用中很大局限性。第二种方法电路比较复杂,而且前后两个单板电源的上电延时很大,如果存在多个单板电源需要控制上电顺序,最后一个单板电源的上电比第一个单板电源的上电有大延时。这两种方法都只能应用于简单的上电顺序控制场合,对于日趋复杂的上电顺序要求越来越难以应付。
发明内容
本发明的主要目的为提供一种控制上电顺序的方法和装置,以简单、低成本的方法实现准确的上电时间控制,满足日趋复杂的上电顺序要求。
本发明提出一种控制上电顺序的方法,包括:
通过预设的计时器对多个被上电模块的上电时间进行计时;
当所述被上电模块的上电时间到达时,控制电源分别对所述被上电模块上电。
优选地,所述控制电源分别对各模块上电包括:
当存在多个电源,分别对应所述被上电模块时,则在被上电模块的上电时间到达时,启动上电时间到达的被上电模块对应的电源,进行上电。
优选地,所述控制电源分别对各模块上电还包括:
只有一个电源时,则在被上电模块的上电时间到达时,启动上电时间到达的被上电模块对应的开关,进行上电。
优选地,所述定时器为一个或多个。
优选地,当所述定时器为多个时,分别通过所述多个定时器对各被上电模块进行计时。
本发明还提出一种控制上电顺序的装置,包括:
计时模块,用于通过预设的计时器对多个被上电模块的上电时间进行计时;
上电模块,用于当所述被上电模块的上电时间到达时,控制电源分别对所述被上电模块上电。
优选地,所述上电模块具体用于:
当存在多个电源,分别对应所述被上电模块时,则在被上电模块的上电时间到达时,启动上电时间到达的被上电模块对应的电源,进行上电。
优选地,所述上电模块还具体用于:
只有一个电源时,则在被上电模块的上电时间到达时,启动上电时间到达的被上电模块对应的开关,进行上电。
优选地,所述定时器为一个或多个。
优选地,当所述定时器为多个时,所述计时模块分别通过所述定时器对各被上电模块进行计时。
本发明提供的一种控制上电顺序的方法和装置,可以复用通讯设备内已有的CPLD或FPGA作逻辑控制,以简单、低成本的方法实现准确的上电时间控制及复杂的上电顺序控制,满足日趋复杂的单板或芯片上电顺序要求,提高单板可靠性。通过本发明,调整上电时间和上电顺序,只需要修改相应代码,无需修改硬件电路,简化设计流程。
附图说明
图1为现有技术的上电顺序控制方法示意图;
图2为现有技术的另一上电顺序控制方法示意图;
图3为本发明控制上电顺序的方法和装置的应用场景;
图4为本发明控制上电顺序的方法和装置的另一应用场景;
图5为本发明控制上电顺序的方法一实施例的系统架构图;
图6为本发明控制上电顺序的方法一实施例的流程示意图;
图7为本发明控制上电顺序的装置一实施例的结构示意图。
本发明目的的实现、功能特点及优点将结合实施例,参照附图做进一步说明。
具体实施方式
应当理解,此处所描述的具体实施例仅仅用以解释本发明,并不用于限定本发明。
本发明提供一种控制上电顺序的方法一实施例,本实施例包括控制模块、给控制模块供电的小功率电源及其它外围电路。控制模块的主要功能是计时,并在各个设定的时间点分别启动各个被上电模块的电源。控制模块主要包含一个计时器和若干控制输出管脚,可由CPLD(Complex Programmable Logic Device,复杂可编程逻辑器件)、FPLD(Field programmable logic device,现场可编程逻辑控制器)或其它控制器加晶振实现,晶振产生固定周期的脉冲送给CPLD或FPLD,CPLD或FPLD内部的计数器对脉冲进行计数,脉冲的周期乘以计数值即为计时器的值。
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