[发明专利]一种符号级处理装置有效
| 申请号: | 201010284164.3 | 申请日: | 2010-09-15 |
| 公开(公告)号: | CN102404758A | 公开(公告)日: | 2012-04-04 |
| 发明(设计)人: | 冯立国 | 申请(专利权)人: | 中兴通讯股份有限公司 |
| 主分类号: | H04W24/00 | 分类号: | H04W24/00 |
| 代理公司: | 北京银龙知识产权代理有限公司 11243 | 代理人: | 许静 |
| 地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 一种 符号 处理 装置 | ||
技术领域
本发明属于移动通信领域,特别涉及一种用于宽带码分多址系统的符号级处理装置。
背景技术
在宽带码分多址通信系统中,为了克服衰落及频率偏移等问题,需要测量物理信道的信道估计、频率偏移、功率控制中的信干比,从而完成RAKE接收机功能以及系统的功率控制等功能。
在宽带码分多址通信系统的接收系统中,这些测量一般是用专用控制信道的多径数据通过特定的算法来完成。现有技术中,针对信道估计、频偏估计和信干比测量等分别给出了具体的实现装置,每个实现装置完成一个测量项目。通常,接收系统要处理多个用户的上述测量,同时还要完成多径数据的最大比合并。这样,在接收系统中就会包括多种实现装置,导致接收系统的实现比较复杂。
发明内容
本发明所要解决的技术问题是提供一种符号级处理装置,用于宽带码分多址系统中,以降低其接收系统的实现复杂度。
为解决上述技术问题,本发明提供技术方案如下:
一种符号级处理装置,包括:
复数加减法模块,具有两个输入端口、一个输出端口和一个控制端口,所述复数加减法模块具有至少两种复数加减法运算模式,用于根据控制端口接收到的控制信息从所述至少两种复数加减法运算模式选择其中一种运算模式,对两个输入端口输入的数据执行复数加减运算,将运算结果通过输出端口输出;
选择模块,具有至少两个输入端口、两个输出端口和一个控制端口,其中一个输入端口与所述复数加减法模块的输出端口连接,用于根据控制端口接收到的控制信息从所述至少两个输入端口输入的数据中选择两个,分别从两个输出端口输出;
复数乘累加模块,具有两个输入端口、一个输出端口和一个控制端口,两个输入端口分别与所述选择模块的两个输出端口连接,所述复数乘累加模块具有至少两种复数乘累加运算模式,用于根据控制端口接收到的控制信息从所述至少两种复数乘累加运算模式选择其中一种运算模式,对两个输入端口输入的数据执行复数乘累加运算,将运算结果通过输出端口输出。
上述的符号级处理装置,其中,所述选择模块包括:
第一选择器,具有3个输入端口、两个输出端口和一个控制端口,其中一个输入端口与复数加减法模块的输出端口连接,用于根据控制端口接收到的控制信息从3个输入端口输入的数据中选择两个,分别从两个输出端口输出;
第二选择器,具有两个输入端口、一个输出端口和一个控制端口,其中一个输入端口与第一选择器的一个输出端口连接,另外一个输入端口与输出端口连接,用于根据控制端口接收到的控制信息从两个输入端口输入的数据中选择一个,从输出端口输出;
第三选择器,具有两个输入端口、一个输出端口和一个控制端口,其中一个输入端口与第一选择器的另外一个输出端口连接,另外一个输入端口与输出端口连接,用于根据控制端口接收到的控制信息从两个输入端口输入的数据中选择一个,从输出端口输出。
上述的符号级处理装置,其中:
所述第一选择器包括两个三选一单元,每个所述三选一单元用于从3路输入数据中选择一路数据输出。
上述的符号级处理装置,其中,还包括:
复数加减法器,具有两个输入端口、一个输出端口和一个控制端口,其中一个输入端口与复数乘累加模块的输出端口连接,所述复数加减法器具有至少两种复数加减法运算模式,用于根据控制端口接收到的控制信息从所述至少两种复数加减法运算模式选择其中一种运算模式,对两个输入端口输入的数据执行复数加减运算,将运算结果通过输出端口输出。
上述的符号级处理装置,其中:
所述复数加减法模块为一复数加减法器组,包括n个并行的复数加减法器,n为大于或等于1的整数。
上述的符号级处理装置,其中,所述复数加减法器包括:
复数加减法单元,用于执行复数加减运算;
四舍五入饱和单元,用于对复数加减法单元的运算结果进行截位。
上述的符号级处理装置,其中:
在所述复数加减法单元与所述四舍五入饱和单元之间和/或所述四舍五入饱和单元的输出端还设置有延迟寄存器组,用于对相应的数据进行延时处理。
上述的符号级处理装置,其中,所述复数乘累加模块包括:
n个并行的复数乘法器,n为大于或等于1的整数,用于执行复数乘法运算;
n平方根阶复数加法树,用于对所述n个并行的复数乘法器的运算结果进行累加运算;
四舍五入饱和单元,用于对所述n平方根阶复数加法树的运算结果进行截位。
上述的符号级处理装置,其中:
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