[发明专利]一种适用于CMMB和DVB-H的时域同步电路结构有效
申请号: | 201010241937.X | 申请日: | 2010-08-02 |
公开(公告)号: | CN101895506A | 公开(公告)日: | 2010-11-24 |
发明(设计)人: | 樊文华;李斯梦;周昌盛;陈赟;曾晓洋;葛云龙;陈绪斌;曹家麟 | 申请(专利权)人: | 复旦大学 |
主分类号: | H04L27/26 | 分类号: | H04L27/26;H04L25/03 |
代理公司: | 上海正旦专利代理有限公司 31200 | 代理人: | 陆飞;盛志范 |
地址: | 200433 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 适用于 cmmb dvb 时域 同步 电路 结构 | ||
技术领域
本发明属于无线数字通信技术领域,具体涉及一种同时支持CMMB和DVB-H两种移动多媒体标准的时域同步电路结构。
背景技术
移动多媒体技术如今已经得以越来越广泛的应用。随着中国移动多媒体标准CMMB的颁布实施,移动多媒体得到了进一步的普及。多模多标准是当今移动多媒体技术发展的趋势,以同一套终端在不同地域实现对不同标准下节目的接收也是多模多标准发展的要求。同步技术作为接收终端中一个重要的部分,其在多模接收终端中的研究应用也具有非常重要的意义。
研究目前主要的移动多媒体标准如欧洲标准DVB-H,中国标准CMMB,发现它们在OFDM符号结构上具有一定的共性。即都采用了多载波OFDM(正交频分复用)调制方式,都采用了循环前缀+数据体的时域符号结构等等。而同步算法的选取则是根据OFDM符号结构的特征,因此这些共性决定了可以寻求到一种融合的同步方案来支持各个标准。
基于多模多标准的需求以及各个移动多媒体标准在OFDM符号结构上的共性,本发明提出了一种融合的硬件结构,能够同时支持目前两种主流的移动多媒体标准CMMB和DVB-H,实现最大程度的硬件复用。
发明内容
本发明目的在于提供一种同时支持CMMB和DVB-H两种标准的时域同步电路结构,实现最大程度的硬件复用。
本发明根据CMMB和DVB-H两种标准在OFDM符号结构上的共性,提出了一种融合的硬件结构,实现同时对两种标准频域同步的支持,包括:数据缓存控制模块,数据处理模块,模式识别判断模块以及符号粗同步和小数倍载波频偏估计模块。通过考虑两种标准在同步方案上的共性从而实现硬件融合,并且通过缓存不同长度的数据,通过控制模块控制时域同步过程中相同模块的分时复用,提高了硬件利用率。具体结构如图1所示,输入输出说明如表1所示。模式选择信号MODE_SEL控制当前工作模式 (是CMMB还是DVB-H),若是CMMB模式则START信号有效就直接进入CMMB的符号粗同步和小数倍频偏估计,如是DVB-H模式则由START信号有效先进入模式识别,模式识别完成后进入DVB-H的符号粗同步和小数倍频偏估计,因为FFT窗口和循环前缀长度都有已经估计出,便可类似与CMMB的配置来完成,这里就不累述。
数据缓存控制模块,用于时域同步过程中不同情况下数据的缓存和控制。即针对时域同步过程中不同情况下需要缓存的数据不一样,完成数据的缓存和输出以及模块的启动控制。具体结构如图2所示,输入输出说明如表2所示。无论对于是对两个标准的符号粗同步和小数倍载波频偏估计还是DVB-H的模式识别,它都是基于时域特定信号的相关,只是数据处理过程中,需要缓存的时间和累加求和的相关值长度不同。数据缓存控制模块由数据缓存模块(8K的 RAM),相关值存储单元(2K的 RAM),计数模块,控制模块组成。对于CMMB模式,CMMB的符号粗同步和小数倍载波频偏估计用的是同步信号来做相关就峰值, 数据缓存控制模块配置数据缓存模块为2k,相关值存储单元为2k。经过数据处理模块求峰值后送给符号粗同步和小数倍载波频偏估计模块求幅角后输出。对于DVB-H模式,模式识别时的数据分别与缓存2k、4k和8k的相关求峰值,因为2k模式循环前缀最小为64,则选择64点累加求和。得到3个峰值后通过模式识别判断模块,比较最大者对应的即为当前模式。此时FFT_MODE指示出当前的FFT窗口长度N,则缓存模块配置为N,再经过4(N+Ng)个符号之后得到一个新的相关峰位置,与对应模式第一个相关峰相减求平均减去N便可估计出Ng的值,CP_MODE输出,MD_DONE有效。模式识别完成后进入DVB-H符号粗同步和小数倍载波频偏估计,此时只需配置相关存储单元长度为Ng即可,经过数据处理模块求峰值后送给符号粗同步和小数倍载波频偏估计模块求幅角后输出。
数据处理模块,在同步过程中进行数据的相关、累加和求绝对值运算。因为无论是两种标准的符号粗同步和小数倍载波频偏估计还是DVB-H的模式识别都是对时域特定信号的相关,因此分时复用这个相关累加求绝对值的模模块可节省2/3的硬件代价。数据处理模块只需根据数据缓存控制模块的输出数据做相关数据处理即可。具体结构如图4所示,输入输出说明如表4所示。
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