[发明专利]自适应多路串行冗余高速总线无效

专利信息
申请号: 201010129151.9 申请日: 2010-03-18
公开(公告)号: CN101834695A 公开(公告)日: 2010-09-15
发明(设计)人: 刘文怡;沈三民;张彦军;张会新;王立;燕洪成;黄卡尔;郅银周 申请(专利权)人: 中北大学
主分类号: H04L1/00 分类号: H04L1/00;H04L12/40
代理公司: 北京德琦知识产权代理有限公司 11018 代理人: 牛峥;王丽琴
地址: 030051*** 国省代码: 山西;14
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摘要:
搜索关键词: 自适应 串行 冗余 高速 总线
【权利要求书】:

1.一种总线设备,包括用于在两个传输方向上进行数据传输的两个组成结构和连接关系均完全相同的子设备:正向子系统和反向子系统;其特征在于:

所述正向子系统包括:正向输入保存模块、正向发送模块、正向接收保存模块、正向输出模块、正向反馈控制模块和正向指令控制模块;所述反向子系统包括:反向输入保存模块、反向发送模块、反向接收保存模块、反向输出模块、反向反馈控制模块和反向指令控制模块;

所述正向输入保存模块,首先执行正向指令控制模块通知的相关操作,之后,接收反向反馈控制模块发来的反向反馈控制指令,将其按照设定的反馈指令包格式打包后缓存;还接收正向输入数据,将其按照设定的包格式打包后缓存;

所述正向发送模块,首先执行正向指令控制模块通知的相关操作,之后,读取正向输入保存模块中缓存的打包后的反向反馈控制指令或打包后的正向输入数据,将其发送到正向接收保存模块;

所述正向接收保存模块,接收正向发送模块发来的打包后的反向反馈控制指令或打包后的正向输入数据,将所述反向反馈控制指令发送给反向指令控制模块,缓存所述正向输入数据并将自身的当前处理状态发送给正向反馈控制模块;

所述正向输出模块,读取正向接收保存模块缓存的打包后的正向输入数据,将其解包得到输入数据的打包前格式后输出;

所述正向反馈控制模块,根据正向接收保存模块发来的其当前处理状态的信息生成正向反馈控制指令并缓存到反向输入保存模块;

所述正向指令控制模块,根据反向接收保存模块发来的正向反馈控制指令通知正向输入保存模块和正向发送模块进行相关操作;

所述反向输入保存模块,首先执行反向指令控制模块通知的相关操作,之后,接收正向反馈控制模块发来的正向反馈控制指令,将其按照设定的反馈指令包格式打包后缓存;还接收反向输入数据,将其按照设定的包格式打包后缓存;

所述反向发送模块,首先执行反向指令控制模块通知的相关操作,之后,读取反向输入保存模块中缓存的打包后的正向反馈控制指令或打包后的反向输入数据,将其发送到反向接收保存模块;

所述反向接收保存模块,接收反向发送模块发来的打包后的正向反馈控制指令或打包后的反向输入数据,将所述正向反馈控制指令发送给正向指令控制模块,缓存所述反向输入数据并将自身的当前处理状态发送给反向反馈控制模块;

所述反向输出模块,读取反向接收保存模块缓存的打包后的反向输入数据,将其解包得到输入数据的打包前格式后输出;

所述反向反馈控制模块,根据反向接收保存模块发来的其当前处理状态的信息生成反向反馈控制指令并缓存到正向输入保存模块;

所述反向指令控制模块,根据正向接收保存模块发来的反向反馈控制指令对反向输入保存模块和反向发送模块进行相应的指令控制。

2.根据权利要求1所述的总线设备,其特征在于,所述正向输入保存模块包括:

正向数据输入缓冲控制模块,当有正向输入数据需要通过总线设备进行传输时,判断是否存在空的正向发送端数据存储RAM,如果存在,则允许所述正向输入数据输入并将其发送给正向数据输入缓冲FIFO,如果不存在,则不允许所述正向输入数据输入;

正向数据输入缓冲FIFO,接收所述正向数据输入缓冲控制模块发来的正向输入数据,将其进一步发送给正向双路选通开关;

正向双路选通开关,接收所述正向数据输入缓冲FIFO发来的正向输入数据,将所述正向输入数据发送给正向数据校验模块;当接收到正向数据校验模块返回的校验通过的信息后,再将所述正向输入数据发送给正向数据读取与写RAM模块;

正向数据校验模块,对所述正向双路选通开关发来的正向输入数据进行校验,如果校验未通过则继续等待下一个正向输入数据并对其继续进行校验,直到校验通过,向所述正向双路选通开关返回校验通过的信息;

正向数据读取与写RAM模块,接收反向反馈控制模块发来的反向反馈控制指令,将其按照设定的反馈指令包格式打包后缓存到正向发送端数据存储RAM当中,同时为保存该反馈指令包的RAM设置指令包标识;还接收正向双路选通开关发来的正向输入数据,将其按照设定的包格式打包后缓存到正向发送端数据存储RAM当中,同时根据为保存该打包后的正向输入数据的RAM设置数据包标识;

正向发送端数据存储RAM,首先执行正向指令控制模块控制下的操作,之后,接收数据读取与写RAM模块发来的打包后的反馈指令包和/或打包后的正向输入数据进行缓存。

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