[发明专利]存储系统和该存储系统的操作方法无效
| 申请号: | 200710151425.2 | 申请日: | 2007-09-28 |
| 公开(公告)号: | CN101154433A | 公开(公告)日: | 2008-04-02 |
| 发明(设计)人: | 安德烈亚斯·托伊伯;D·里希特;L·德安布罗吉;赖纳·施皮尔贝格 | 申请(专利权)人: | 奇梦达闪存有限责任公司 |
| 主分类号: | G11C7/10 | 分类号: | G11C7/10 |
| 代理公司: | 北京康信知识产权代理有限责任公司 | 代理人: | 余刚;尚志峰 |
| 地址: | 德国德*** | 国省代码: | 德国;DE |
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| 摘要: | |||
| 搜索关键词: | 存储系统 操作方法 | ||
1.一种存储系统包括:
I/O端口,具有I/O端口数据总线宽度;
多个存储器,所述多个存储器中的每一个均具有存储器数据总线宽度;
数据总线宽度转换电路,用于将数据大小从被读取的多个存储器中的至少一个的所述存储器数据总线宽度转换成所述I/O端口的所述I/O端口数据总线宽度;以及
控制器,用于控制所述多个存储器和所述I/O端口之间的数据传送。
2.根据权利要求1所述的存储系统,其中,所述多个存储器中的每一个的所述存储器数据总线宽带取决于所述多个存储器中所述每一个的速度。
3.根据权利要求1所述的存储系统,其中,所述I/O端口具有I/O端口数据带宽,以及所述多个存储器中的每一个在被读取时均具有至少等于所述I/O端口的所述I/O端口数据带宽的存储器数据带宽。
4.根据权利要求1所述的存储系统,其中,所述数据总线宽度转换电路包括多个并串转换器或多个并并转换器。
5.根据权利要求4所述的存储系统,其中,所述数据总线带宽转换电路包括至少一个多路复用器,用于选择性地将所述多个存储器中的至少一些连接至所述I/O端口,以将从所述多个存储器中所选择的一个读取的数据提供给所述I/O端口。
6.根据权利要求1所述的存储系统,还包括多路复用器,用于选择性地将所述控制器连接至所述I/O端口,以将来自所述控制器的信息提供给所述I/O端口,其中,所述控制器连接至所述I/O端口,以接收来自所述I/O端口的信息。
7.根据权利要求1所述的存储系统,还包括多路复用器,用于选择性地将所述多个存储器中的至少一些连接至所述I/O端口,以将从所述多个存储器的至少一些中读取的数据提供给所述I/O端口,其中,所述控制器连接至所述I/O端口,以从所述I/O端口接收信息。
8.根据权利要求1所述的存储系统,还包括连接至所述I/O端口的数据总线宽度转换电路,用于将来自所述I/O端口的输入数据单元分成多个部分,其中,将所述数据单元的所述多个部分中的每一个依大小设置成与所述多个存储器中的相应一个的所述存储器数据总线带宽相对应。
9.根据权利要求8所述的存储系统,其中,所述数据总线宽度转换电路包括多个串并转换器或多个并并转换器。
10.根据权利要求8所述的存储系统,还包括作为写缓冲器的附加的存储器,用于在所述数据单元的所述多个部分中的每一个被写入所述多个存储器中的相应一个之前,对其进行缓冲。
11.根据权利要求1所述的存储系统,其中,所述多个存储器中的至少一些存储器具有不同于所述多个存储器中的其它存储器的读取速度。
12.根据权利要求1所述的存储系统,其中,所述控制器同时启动多于所述多个存储器之一的读访问。
13.一种存储系统,包括:
I/O端口,形成有I/O端口数据总线宽度;
多个存储器,所述多个存储器中的每一个均形成有存储器数据总线宽度;
数据总线宽度转换电路,用于将被编程的所述多个存储器中至少一个的所述存储器数据总线宽度转换为所述I/O端口的所述I/O端口数据总线宽度;以及
控制器,控制所述多个存储器和所述I/O端口之间的数据传送。
14.根据权利要求13所述的存储系统,其中,所述多个存储器中的每一个的所述存储器数据总线宽度取决于所述多个存储器的所述每一个的速度。
15.一种存储系统,包括:
多个非易失性存储器,包括用于接收将被存储在所述多个存储器中的所有数据的第一存储器;
I/O端口,用于提供将被存储在所述多个存储器中的所述数据;以及
控制器,用于控制所述多个存储器,以使在所述第一存储器中存储的数据量达到预定阈值时,将在所述第一存储器中存储的至少一些所述数据复制到所述多个存储器中的第二存储器。
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