[发明专利]驱动电路有效
申请号: | 200710096629.0 | 申请日: | 2007-04-19 |
公开(公告)号: | CN101290738A | 公开(公告)日: | 2008-10-22 |
发明(设计)人: | 邱郁文 | 申请(专利权)人: | 奇景光电股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/36;H03K19/0175;G02F1/133 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 吕晓章;李晓舒 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 驱动 电路 | ||
技术领域
本发明涉及一种显示器,且特别涉及一种显示器的驱动电路。
背景技术
请参照图1,图1为根据传统技术的用于显示器的驱动电路图。驱动电路100包括栓锁单元105、低压缓冲器110、电平移位器120以及缓冲器130。电平移位器(level shifter)120可将输入电压VIN转换为具有较大电压摆幅的输出电压VOUT。
当输入电压VIN的电压电平改变时,电平移位器120与缓冲器130会同时进行转态动作(由高电位转换为低电位或是由低电位转换为高电位)。在电平移位器120的转态过程中,电平移位器120与缓冲器130可能会因为处于第三态(tri-state)而导通大电流,进而对接地端造成压降。因为芯片中的电流路径具有寄生电阻,电平移位器120与缓冲器130所导通的大电流会拉高接地端的电压电平。若电平移位器120的转态能力不佳,即可能因为接地端的压降,而无法顺利完成转态。
在电路设计中,例如液晶显示器的驱动电路,通常是由多个电平移位器与缓冲器所组成,在进行转态时,所导通的电流更大,使得接地端的电压升高。此时,电平移位器也就更容易受到影响而无法顺利完成转态动作。
发明内容
本发明提供一种驱动电路,让电平移位器与缓冲器不同时进行转态,避免产生大电流而影响电平移位器的转态动作。
本发明另提供一种驱动电路,在电平移位器与缓冲器之间设置一开关,让缓冲器不与电平移位器同时进行转态动作,以避免影响电平移位器的转态动作。
本发明又提供一种驱动电路,在电平移位器完成转态后再使能缓冲器,避免同时转态时所产生的大电流,以增进驱动电路的转态能力。
为达成上述及其它目的,本发明提出一种驱动电路,包括电平移位器、缓冲器以及第一开关。其中,电平移位器用以转换输入电压的电压电平,而第一开关耦接于电平移位器与缓冲器之间,在电平移位器进行转态时不导通,并在电平移位器完成转态后导通。
上述的驱动电路,在一实施例中更包括第二开关,耦接于工作电压与缓冲器的输入端之间。其中,当第一开关导通时,第二开关不导通,当第一开关不导通时,第二开关导通。
本发明提出一种驱动电路,包括电平移位器、第一缓冲器、第二缓冲器、第一开关以及第二开关。电平移位器用以转换输入电压的电压电平。第一开关耦接于电平移位器与第一缓冲器之间,第二开关耦接第一缓冲器与第二缓冲器之间。第一开关与第二开关在电平移位器进行转态时不导通,并在电平移位器完成转态后导通。
上述的驱动电路,在一实施例中更包括第三开关,耦接于工作电压与第一缓冲器的输入端之间。其中,当第一开关导通时,第三开关不导通,当第一开关不导通时,第三开关导通。
本发明提出一种驱动电路,包括电平移位器、缓冲器以及开关。电平移位器用以转换输入电压的电压电平。缓冲器耦接于电平移位器的输出端。开关耦接于工作电压与缓冲器的电源端之间,用以控制缓冲器的电源供应时间。开关在电平移位器进行转态时不导通,并在电平移位器完成转态后导通,以延迟缓冲器进行转态的时间。
本发明另提出一种驱动电路包括电平移位器、缓冲器以及开关。电平移位器用以转换输入电压的电压电平,而缓冲器耦接于电平移位器的输出端。开关耦接在接地端与缓冲器之间。开关在电平移位器进行转态时不导通,并在电平移位器完成转态后导通,以避免电平移位器与缓冲器同时转态而造成接地端的压降。
本发明另再提出一种驱动电路包括电平移位器、缓冲器、第一电阻、第二电阻、第一开关以及第二开关。电平移位器用以转换输入电压的电压电平。缓冲器耦接于电平移位器的输出端,并操作于工作电压与接地端之间。第一电阻耦接工作电压与缓冲器之间。第二电阻耦接在接地端与缓冲器之间。第一开关并联于第一电阻。第二开关并联于第二电阻。第一开关与第二开关在电平移位器进行转态时不导通,并在电平移位器完成转态后导通,以减少缓冲器进行转态时所导通的电流。
综合上述,本发明将电平移位器与缓冲器的转态时间分开,避免同时转态所造成的大电流而影响接地端的电压电平。因此,电平移位器可以在正常偏压下进行转态动作,让驱动电路具有更好的转态能力。
为让本发明的上述和其它目的、特征和优点能更明显易懂,下文特举本发明的较佳实施例,并配合附图,作详细说明如下。
附图说明
图1为根据传统技术的驱动电路图。
图2为根据本发明一实施例的驱动电路图。
图3(a)为根据本发明另一实施例的驱动电路图。
图3(b)为根据本发明另一实施例的驱动电路信号时序图。
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