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[发明专利]芯片、芯片互联系统和校验芯片互联的方法-CN200710123009.1无效
发明人：汪达生 -专利权人：华为技术有限公司
申请日： 2007-06-26 - 公布日： 2008-12-31 - 主分类号： G01R31/28 文献下载
摘要：本发明公开了一种校验芯片互联的系统，包括互联的前级芯片和后级芯片，该前级芯片包括校验序列发送单元，该后级芯片包括校验序列接收单元，校验序列发送单元，使用多个单比特数据生成移位校验序列，并将该移位校验序列的数据依次向后级芯片发送；校验序列接收单元，使用移位校验序列中的数据生成移位对比序列，并将该移位对比序列和接收的移位校验序列进行比较得到校验结果。本发明还公开一种校验芯片互联的方法和一种芯片，通过对校验序列和对比序列进行比较，可以实现芯片互联的校验，且技术简单易行，方便测试。
芯片联系校验方法

[发明专利]序列变异校验方法和装置、生产变异序列的方法和装置及电子设备-CN201910202271.8有效
发明人：周淼;荆瑞琳;杜洋;李大为;玄兆伶;王海良;肖飞 -专利权人：北京安诺优达医学检验实验室有限公司;安诺优达基因科技（北京）有限公司
申请日： 2019-03-18 - 公布日： 2021-09-07 - 主分类号： G16B20/20 文献下载
摘要：公开了一种序列变异校验方法、生成变异序列的方法、序列变异校正装置、生成变异序列的装置和电子设备。该序列变异校验方法包括：获取原始序列；获取变异信息；获取已变异的待校验序列；以及，基于所述原始序列和所述变异信息校验所述待校验序列以确定所述待校验序列的变异是否正确。这样，增加了变异模拟过程的可靠性。
序列变异校验方法装置生产电子设备

[发明专利]一种循环冗余校验方法、设备及存储介质-CN201711472801.8在审
发明人：高剑;冯建科;郭士瑞;袁科学;蒋常斌;李杰;阎伟 -专利权人：北京自动测试技术研究所
申请日： 2017-12-29 - 公布日： 2018-06-29 - 主分类号： H03M13/09 文献下载
摘要：本发明公开了一种循环冗余校验方法、设备及存储介质。其中，该循环冗余校验方法包括如下步骤：将第一校验码CSAi‑1和第二校验码CSBi‑1作为数据序列Pi的初值与数据序列构成输入数据序列；分别进行CRC第一校验模式和CRC第二校验模式的校验，得到第一校验码CSAi和第二校验码CSBi，将第一校验码CSAi与上一个数据序列Pi‑1的第二校验码CSBi‑1连接到一起构成新数据序列；对构成的新数据序列再进行CRC第一校验模式的校验，得出数据序列Pi的校验码；计数器的数值逐一增加，重复上述步骤，直至所有传输的数据序列全部校验完成，得到所有数据序列的校验码。该方法避免了传统CRC32异或运算的信息丢失，在不增加资源消耗的基础上，提高了校验的准确性。
校验码校验数据序列循环冗余校验存储介质新数据输入数据序列计数器信息丢失异或运算资源消耗传输重复

[发明专利]分布式CRC极化码-CN201780092334.8在审
发明人： K·S·贾亚思格赫;陈宇;杜冬阳;陈捷 -专利权人：上海诺基亚贝尔股份有限公司;诺基亚技术有限公司
申请日： 2017-05-04 - 公布日： 2020-02-07 - 主分类号： H03M13/09 文献下载
摘要：一种方法，包括：确定循环冗余校验(CRC)生成器序列，该CRC生成器序列定义在控制信息值序列与循环冗余校验(CRC)序列值之间的一对一映射；以及确定组合序列，该组合序列通过在控制信息值序列内分布循环冗余校验(CRC)值序列而被形成，其中在控制信息值序列内分布循环冗余校验(CRC)值序列基于的是循环冗余校验(CRC)生成器序列的所选择部分。
循环冗余校验控制信息分布循环冗余校验组合序列生成器一对一映射序列定义

[发明专利]一种译码方法及装置-CN200710124346.2有效
发明人：吴向春;江长国;刘华斌;陈俊仕;高振兴;李景玉 -专利权人：华为技术有限公司
申请日： 2007-11-02 - 公布日： 2009-05-06 - 主分类号： H04L1/00 文献下载
摘要：本发明实施例公开了一种译码方法及装置，该译码方法包括：根据接收的译码数据获得最大似然路径；沿着最大似然路径回溯，输出最大似然序列，对最大似然序列进行校验，判断最大似然序列是否通过校验，如果是，将该最大似然序列作为译码输出序列输出，否则，沿着最大似然路径选择回溯节点；沿着回溯节点回溯，输出试探序列，对试探序列进行校验，将通过校验的试探序列作为译码输出序列输出，或在所有试探序列没有通过校验时，将最大似然序列作为译码输出序列输出。本发明实施例通过输出多组译码序列，分别对每一组译码序列进行校验，选择一组通过校验码校验的序列作为该组译码数据的译码输出序列输出，降低了译码的误块率，提高了通信系统的性能。
一种译码方法装置

[发明专利]信号校验及信号发送方法、系统、存储器-CN202210828453.8在审
发明人：苏鹏洲 -专利权人：长鑫存储技术有限公司
申请日： 2022-07-13 - 公布日： 2022-10-21 - 主分类号： G06F13/16 文献下载
摘要：本公开实施例提供一种信号校验方法、信号发送方法、信号校验系统、信号发送系统及存储器。其中，信号校验方法包括：获取存储控制器发送的第一信号序列和用于对第一信号序列进行校验的第二信号序列；按照预设规则，对第一信号序列中的每一第一信号进行运算处理，得到第三信号序列；其中，第二信号序列和第三信号序列均包括设定的校验字段集中的每一校验字段分别对应的校验信号；预设规则包括每一第一信号与每一校验字段之间的对应关系，每一第一信号分别对应不同的校验字段组；对第二信号序列中的每一校验信号和第三信号序列中的每一校验信号进行比较，得到第一信号序列的校验结果。
信号校验发送方法系统存储器

[发明专利]一种Polar码的编码方法及装置-CN201710502949.5有效
发明人：黄凌晨;李榕;张华滋;徐晨;戴胜辰;张公正;乔云飞 -专利权人：华为技术有限公司
申请日： 2017-06-27 - 公布日： 2021-08-27 - 主分类号： H04L1/00 文献下载
摘要：本申请涉及通信技术领域，公开了一种Polar码的编码方法及装置，用以提供一种新的校验编码方式。该方法为：对所述至少两个待校验的第一比特序列分别进行校验编码以获得至少两个校验比特序列，所述至少两个待校验的第一比特序列的并集为所述K个信息比特，K为正整数；对所述K个信息比特和所述至少两个校验比特序列进行交织操作，或者，将所述第一部分信息比特序列和所述第一校验比特序列进行交织操作以获得交织后的第三比特序列，所述全部信息比特序列中除所述第一部分信息比特序列之外的第二部分信息比特序列、所述第二校验比特序列、和所述第三校验比特序列组成第二比特序列；对所述第二比特序列进行极化Polar编码。
一种 polar 编码方法装置

[发明专利]LDPC码编码方法、装置、网络设备和存储介质-CN202011027693.5在审
发明人：钟海静;许金海 -专利权人：中兴通讯股份有限公司
申请日： 2020-09-25 - 公布日： 2022-03-29 - 主分类号： H03M13/11 文献下载
摘要：本发明实施例提供的LDPC码编码方法、装置、网络设备和存储介质，根据提供的LDPC码，对LDPC码的基础矩阵中，对应的非零元素进行存储；根据第一校验子矩阵、非零元素以及待编码序列，计算得到第一校验序列；其中，LDPC码的校验矩阵被划分为第一校验子矩阵、第二校验子矩阵、全零矩阵以及单位对角阵；根据第二校验子矩阵、单位对角阵、非零元素以及待编码序列，以及所述第一校验序列，计算得到第二校验序列；根据第一校验序列、第二校验序列和待编码序列，计算得到编码输出。从而，通过将LDPC码的校验矩阵，划分为第一校验子矩阵、第二校验子矩阵、全零矩阵和单位对角阵，来进行编码处理，从而提升了编码处理的效率，降低了编码延迟，满足了5G场景下的低时延要求。
ldpc 编码方法装置网络设备存储介质

[发明专利]发送、接收装置及方法、校验比特及解码信号的生成装置-CN201410220555.7有效
发明人：村上丰;古贺久雄;儿玉宣贵 -专利权人：松下电器产业株式会社
申请日： 2010-02-19 - 公布日： 2017-11-14 - 主分类号： H03M13/03 文献下载
摘要：本发明提供了一种发送、接收装置及其方法、奇偶校验比特生成装置及解码信号生成装置。所述发送装置包括计算单元，通过对于由多个比特构成的信息序列和附加于所述信息序列的已知信息，用低密度奇偶校验卷积码进行编码，计算奇偶校验比特；输出单元，输出所述信息序列和所述奇偶校验比特；决定单元，根据所述信息序列的序列长以及编码率来决定所述奇偶校验比特中的、使用所述已知信息生成的奇偶校验序列的序列长；发送单元，发送对所述信息序列以及所述奇偶校验比特追加了所述编码率的值以及所述信息序列的序列长的值的发送信号。
发送接收装置方法校验比特解码信号生成

[发明专利]奇偶校验比特的生成、发送、接收装置及发送、接收方法-CN201410220157.5有效
发明人：村上丰;古贺久雄;儿玉宣贵 -专利权人：松下电器产业株式会社
申请日： 2010-02-19 - 公布日： 2017-10-27 - 主分类号： H03M13/03 文献下载
摘要：本发明提供了一种发送装置、发送方法、奇偶校验比特生成装置、接收装置、接收方法以及解码信号生成装置。所述发送装置包括决定单元，对每个所述信息序列的序列长的规定范围，决定用所述已知信息生成的第1奇偶校验序列的序列长，决定的所述第1奇偶校验序列的序列长对于每个所述信息序列的序列长的规定范围具有不同的序列长；计算单元，基于决定的所述第1奇偶校验序列的序列长，将所述已知信息附加到所述信息序列，通过使用所述低密度奇偶校验卷积码编码运算生成对于所述信息序列以及所述附加信息的所述奇偶校验比特；发送单元，发送对所述信息序列以及所述奇偶校验比特追加了所述信息序列的序列长的值的发送信号
奇偶校验比特生成发送接收装置方法

[发明专利]纠错装置和纠错方法-CN200810130279.X无效
发明人：吉田贤治 -专利权人：株式会社东芝
申请日： 2008-06-23 - 公布日： 2008-12-31 - 主分类号： G11B20/18 文献下载
摘要：对于通过将预定模式(A)的虚设符号增加至数字信息序列所获得的数据序列生成纠错校验位序列，所述数字信息序列被调制以转变成满足再现系统请求的形式。如果校验位序列满足所述再现系统请求，则以所述信息序列和奇偶比特序列彼此对应的方式输出不包括所述虚设符号和所述校验位序列的所调制数字信息序列。如果校验位序列不满足所述再现系统请求，则将另一预定模式(B)的虚设符号增加至所调制数字信息序列，从而生成纠错校验位序列。
纠错装置方法

[发明专利]分段级联Hash序列的极化码编码方法-CN201710417744.7有效
发明人：费泽松;孙策;于含笑;贾岱 -专利权人：北京理工大学
申请日： 2017-06-06 - 公布日： 2020-12-04 - 主分类号： H03M13/13 文献下载
摘要：本发明公开了一种极化码编码方法，特别涉及一种分段级联Hash序列的极化码编码方法，属于信道编码领域。本发明通过对信息比特序列分段进行Hash校验后，再将信息比特序列依次与校验比特序列级联，构造出新的比特序列后再进行极化码编码。其核心是利用Hash序列的独立随机特性提高校验准确性，降低了不同信息生成相同校验比特的概率；同时采用分段校验的方法不仅可以对信息比特进行校验，而且可以对之前的检验比特进行校验。
分段级联 hash 序列极化编码方法

[发明专利]在通信系统中生成代码的设备和方法-CN02800733.6有效
发明人：金闵龟;张在成 -专利权人：三星电子株式会社
申请日： 2002-02-08 - 公布日： 2003-11-26 - 主分类号： H03M13/00 文献下载
摘要：QCTC(准互补快速码)生成设备含有：快速编码器，用于通过编码信息码元序列，生成信息码元序列和数种奇偶校验码元序列；信道交织器，用于分别交织信息码元序列和奇偶校验码元序列，通过多路复用具有相同优先级的奇偶校验码元序列的码元生成新奇偶校验码元序列，和逐次链接信息码元序列和新的奇偶校验码元序列；和QCTC发生器，用于在给定开始位置，从链接的码元序列中循环选择预定个数的码元，生成具有给定代码率的子代码。
通信系统生成代码设备方法

[发明专利]基于CRC的纠错解码的方法、装置、终端-CN202210609789.5在审
发明人：孙谦 -专利权人：江苏屹信航天科技有限公司
申请日： 2022-05-31 - 公布日： 2022-09-09 - 主分类号： H04L1/00 文献下载
摘要：本发明公开了一种基于CRC的纠错解码的方法、装置、终端，该方法包括：生成校验图样；对接收到的原始比特序列进行分组奇偶校验解码，获得第一校验结果和第一解码序列；对第一解码序列进行CRC校验，获得第二校验结果；若第二校验结果为零，提取第一解码序列中的第一原始信息序列，若第二校验结果不为零，根据校验图样对第一解码序列进行纠错，获得纠错后的第二原始信息序列；本发明在利用CRC解码的基础上，增加了奇偶校验和纠错解码
基于 crc 纠错解码方法装置终端

[发明专利]一种通信时效性错误检测系统及检测方法-CN202011551860.6在审
发明人：王文俊;李彦平;蒲永材;黄菊;谭晟吉;邵德立;邹佳鑫;吴昌昊;尹得智;张雄林 -专利权人：中国兵器装备集团自动化研究所
申请日： 2020-12-24 - 公布日： 2021-03-26 - 主分类号： H04L1/00 文献下载
摘要：本发明公开了一种通信时效性错误检测系统及检测方法，系统包括发送端和接收端，接收端接收来自发送端的第一数据；并对从第一数据中提取的第一序列号和第一CRC校验码进行校验；若序列号校验通过，将第二序列号更新为第一序列号；其中，第二序列号为接收端存储的上一次校验通过的第一序列号；若序列号检验失败且第一CRC校验码校验通过，接收端将第二序列号更新为第一序列号；若序列号校验失败且第一CRC校验码也校验失败，接收端不更新第三序列号
一种通信时效性错误检测系统方法

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