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[发明专利]时间寄存器-CN201580075347.5有效
发明人：吴影;罗伯特·斯达世斯基;毛懿鸿 -专利权人：华为技术有限公司
申请日： 2015-02-03 - 公布日： 2019-12-06 - 主分类号： G04F10/00 文献下载
摘要：一种时间寄存器(300)包含：耦合到一对输入时钟(IN₁、IN₂)的一对输入(345、346)；用于产生一对电平信号(V_C1、V
时间寄存器

[发明专利]一种提高读写速度的方法、装置及NAND闪存-CN201910990385.3在审
发明人：李琪;刘从振;侯志彬 -专利权人：合肥格易集成电路有限公司;西安格易安创集成电路有限公司;北京兆易创新科技股份有限公司
申请日： 2019-10-17 - 公布日： 2021-04-20 - 主分类号： G11C16/10 文献下载
摘要：本发明实施例提供一种提高读写速度的方法、装置及NAND闪存，NAND闪存包括SRAM、与SRAM连接的N个寄存器区以及与N个寄存器区一一对应的N个充电选择信号，N个充电选择信号的周期包括延迟时间，N个充电选择信号相互之间存在时间延迟，N个充电选择信号周期中的延迟时间叠加后等于N个寄存器区的寄存器选择信号走线延迟，方法包括：接收寄存器地址；根据寄存器地址确定待进行读写操作的寄存器区；设置待进行读写操作的寄存器区对应的充电选择信号有效本发明有效减小了SRAM读写寄存器的时间，极大提高了SRAM读写寄存器的速度。
一种提高读写速度方法装置 nand 闪存

[发明专利]从具有不同读取和写入定时的模式寄存器进行读取-CN201810993597.2在审
发明人： C·E·考克斯;B·纳莱 -专利权人：英特尔公司
申请日： 2018-08-29 - 公布日： 2019-04-05 - 主分类号： G06F12/06 文献下载
摘要：一种系统提供邮箱通信寄存器以用于主机与模式寄存器之间的通信。模式寄存器用于存储配置信息，并且主机将配置信息写入模式寄存器花费的时间少于主机从模式寄存器读取配置信息花费的时间。通信寄存器与模式寄存器分离，并且提供存储配置信息的位置以供主机读取。响应于主机请求读取，模式寄存器可以将配置信息复制到通信寄存器，并且允许主机基于与应用于模式寄存器的定时规则不同的定时规则来读取寄存器。主机可以从通信寄存器进行读取，而不是直接从在读取与写入之间具有定时差的寄存器进行读取。
读取模式寄存器主机通信寄存器配置信息寄存器存储配置信息定时规则写入读取寄存器寄存器读取系统提供写入模式邮箱通信主机请求从模式定时差复制响应通信应用

[发明专利]信息处理装置-CN87104991.0无效
发明人：渡边担;仓员桂一;柏木有吾;十山圭介;野尻徹 -专利权人：株式日立制作所
申请日： 1987-07-20 - 公布日： 1989-11-01 - 主分类号： G06F12/08 文献下载
摘要：在备有多个寄存器，且寄存器的存取时间远小于主存贮器的存取时间的计算机系统中，每条指令有表示地址部分的寄存器，在地址部分中，具有寄存器区的寄存器地址的区域寄存器赋值与表示寄存器区某一相对寄存器地址的寄存器位移赋值结合在一起，因此，既使实际寄存器的数目增加，伴随任务交换等所需的寄存器保存与恢复可被减少，由此程序运行、处理的速度提高。还有用于指示主存贮器的地址部分。
信息处理装置

[其他]信息处理装置-CN87104991无效
发明人：渡边担;仓员桂一;柏木有吾;十山圭介;野尻徹 -专利权人：株式日立制作所
申请日： 1987-07-20 - 公布日： 1989-11-01 - 主分类号：文献下载
摘要：在备有多个寄存器，且寄存器的存取时间远小于主存贮器的存取时间的计算机系统中，每条指令有表示地址部分的寄存器，在地址部分中，具有寄存器区的寄存器地址的区域寄存器赋值与表示寄存器区某一相对寄存器地址的寄存器位移赋值结合在一起，因此，既使实际寄存器的数目增加，伴随任务交换等所需的寄存器保存与恢复可被减少，由此程序运行、处理的速度提高。还有用于指示主存贮器的地址部分。
信息处理装置

[发明专利]一种基于寄存器灵活时序库的电路时序优化方法-CN202110906714.9有效
发明人：曹鹏;王家豪;姜海洋 -专利权人：东南大学;东南大学—无锡集成电路技术研究所
申请日： 2021-08-09 - 公布日： 2022-11-22 - 主分类号： G06F30/337 文献下载
摘要：本发明公开了一种基于寄存器灵活时序库的电路时序优化方法，首先通过在多组输入信号转换时间、时钟信号转换时间和寄存器负载电容情况下分别对寄存器仿真，通过改变寄存器的建立松弛和保持松弛，获得此时对应的实际传播延时，并通过线性插值获得特定的输入信号转换时间、时钟信号转换时间、寄存器负载电容、建立松弛和保持松弛下寄存器实际传播延时，从而建立寄存器灵活时序库；然后利用该库对电路中的所有寄存器路径进行静态时序分析，通过改变寄存器的建立松弛和保持松弛，找到满足建立时间余量和保持时间余量均大于零条件的最小时钟周期，从而在不改变电路设计、不增加电路面积开销的情况下提高电路性能。
一种基于寄存器灵活时序电路优化方法

[发明专利]一种便携式主站的实时控制系统及方法-CN201410152352.9有效
发明人：高峰;朱旻捷;陈云峰;唐丹红 -专利权人：国网上海市电力公司
申请日： 2014-04-16 - 公布日： 2017-10-10 - 主分类号： G06F9/50 文献下载
摘要：本发明公开了一种便携式主站的实时控制系统及方法，通讯接口CPU通过任务数据寄存器将任务指令发送至任务执行CPU；任务状态通过任务执行CPU、任务状态双口寄存器、任务状态读取寄存器传输至任务触发启动寄存器，任务时间通过任务执行CPU、任务时间双口寄存器、任务时间分配寄存器也传输至任务触发启动寄存器；由任务触发启动寄存器触发任务执行CPU执行任务，任务执行CPU将任务执行结果输出给任务数据寄存器，进而由任务数据寄存器送至通讯接口本发明中任务执行的状态、时间和触发事件按照双口缓存中的参数并行操作，实现了便携式主站系统任务分配的相对稳定，具有效率高，性能好、成本低的优点。
一种便携式实时控制系统方法

[发明专利]同步至少两套时间驱动引擎的系统和方法-CN201310071401.1有效
发明人：杨俊波;张晓波;杨哲 -专利权人：马维尔国际有限公司
申请日： 2013-03-05 - 公布日： 2017-07-28 - 主分类号： H04J3/06 文献下载
摘要：本公开提出了用于同步至少两套时间驱动引擎的系统和方法。至少两套时间驱动引擎共享一个时钟输入，一套作为基准时间驱动引擎，而其他套作为可调时间驱动引擎，分别具有一个第一寄存器，随着每个时钟输入周期的消逝，其值增加1，其中同步的目的是使得第一寄存器的值相等。系统包括至少一个第二寄存器，存储一个触发调整的值；至少一个第三寄存器，存储触发调整的值和第一寄存器的值之间的差值这两者之和；确定单元，用于确定第一寄存器的值之间的差值；以及控制单元，用于控制第二寄存器和第三寄存器中值的存储，以及当第一寄存器的值增加到第二寄存器中存储的值时，将第一寄存器的值由第三寄存器中的值替代。
同步至少时间驱动引擎系统方法

[发明专利]存储介质之间的时间约束型数据复制-CN201580032258.2在审
发明人： L·阿马里利奥;A·卡津 -专利权人：高通股份有限公司
申请日： 2015-05-28 - 公布日： 2017-05-10 - 主分类号： G06F13/38 文献下载
摘要：公开了存储介质之间的时间约束型数据复制。当电子设备参与实时操作时，在某个时间约束内可能需要将多个数据块从一个存储介质复制到另一存储介质。在这方面，数据端口由第一寄存器组的多个寄存器可操作地控制。在时间限制内将多个寄存器从第一寄存器组复制到第二寄存器组，而数据端口仍处于正被复制的多个寄存器的控制之下。通过在该时间限制内复制多个寄存器，有可能防止数据端口中的操作中断，并减少与寄存器复制操作相关联的带宽开销。
存储介质之间时间约束数据复制

[发明专利]基于时间戳标记电路的双核系统时钟同步方法及装置-CN202010556809.8有效
发明人：丁亮;王飞;夏科睿;张亚楠;于振中;张韬庚;彭超;侯旗;李小龙 -专利权人：合肥哈工轩辕智能科技有限公司
申请日： 2020-06-15 - 公布日： 2022-11-11 - 主分类号： H04J3/06 文献下载
摘要：本发明公开了基于时间戳标记电路的双核系统时钟同步方法及装置，所述方法包括：所述基于时间戳标记电路包括本地时钟单元、频率补偿寄存器、同步报文/和延迟请求检测电路、同步报文/延时请求时间锁存器、第一基地址数据寄存器、第二基地址数据寄存器以及时间事件状态寄存器，首先CPU通过总线接口向频率补偿寄存器中写入频率补偿值，启动本地时钟单元，作为本地时钟基准；向第一基地址数据寄存器中写入第二基地址数据寄存器的地址，向第二基地址数据寄存器中写入第一基地址数据寄存器的地址；本发明的优点在于：在底层由硬件电路获取时间戳，从时钟可快速根据收发时戳计算并调整与主时钟的偏差，完成主从时钟同步。
基于时间标记电路系统时钟同步方法装置

[发明专利]一种SSD主控内解决NANDRefresh的方法及SSD单元-CN202310494558.9在审
发明人：曹成;李瑞东;郭鹏 -专利权人：山东华芯半导体有限公司
申请日： 2023-04-27 - 公布日： 2023-08-04 - 主分类号： G11C16/20 文献下载
摘要：本发明公开了一种SSD主控内解决NAND Refresh的方法，包括步骤：配置NAND信息寄存器和Refresh时间间隔寄存器；设置状态寄存器启动位，定时单元读取配置的NAND信息寄存器和Refresh时间间隔寄存器，计算出每个Block之间发送Refresh操作的时间间隔并开始计时；状态寄存器启动时，通信单元定时不断生成Refresh操作命令；主控执行Refresh操作命令。基于该方法，软件设计人员配置硬件单元寄存器即可由硬件完成周期性下发NAND读操作命令，以完成Refresh操作。
一种 ssd 主控解决 nandrefresh 方法单元

[发明专利]保持时间违例修复方法、装置、设备及存储介质-CN202210781019.9有效
发明人：边少鲜;邓宇;栾晓琨;金文江 -专利权人：飞腾信息技术有限公司
申请日： 2022-07-05 - 公布日： 2022-10-11 - 主分类号： G06F30/3312 文献下载
摘要：本申请提供一种保持时间违例修复方法、装置、设备及存储介质，涉及集成电路技术领域。该方法包括：获取集成电路的静态时序分析结果，静态时序分析结果包括各个寄存器的保持时间的参数和建立时间裕量的参数，根据各个寄存器的保持时间的参数，从集成电路中确定与目标寄存器关联的多个逻辑单元，根据目标寄存器的建立时间裕量的参数，确定目标寄存器是否满足建立时间裕量的预设条件，若目标寄存器的建立时间裕量不满足预设条件，对多个逻辑单元中的目标逻辑单元进行替换，修改目标寄存器的建立时间裕量，对目标寄存器进行保持时间违例修复。本申请可以保证在进行保持时间违例修复时不会引入额外的建立时间违例，提高修复保持时间违例的效率。
保持时间违例修复方法装置设备存储介质

[发明专利]一种BMC时间保留方法、装置及电子设备和存储介质-CN201910290898.3有效
发明人：张兆义 -专利权人：苏州浪潮智能科技有限公司
申请日： 2019-04-11 - 公布日： 2022-08-05 - 主分类号： G06F11/34 文献下载
摘要：本申请公开了一种BMC时间保留方法、装置及一种电子设备和计算机可读存储介质，该方法包括：BMC启动时，获取主机时间寄存器的时间值，并检测所述时间值是否读取成功；如果否，则在检测到BIOS上电自检完成之后，重新读取所述主机时间寄存器的时间值；利用读取到的所述时间值设置所述BMC的时间，并将所述时间值写入所述BMC的内部时间寄存器；定期读取所述主机时间寄存器的实时时间，并将所述实时时间同步至所述内部时间寄存器本申请利用主机时间寄存器的时间值更新BMC的内部时间寄存器，在BMC复位或者关闭电源时将BMC时间值进行保留，保证了时间的准确性，从而在故障发生时便于追溯分析并解决问题。
一种 bmc 时间保留方法装置电子设备存储介质

[发明专利]寄存器写检测和状态监测机制实现方法、装置和系统-CN202310619223.5在审
发明人：詹贵阳;刘功哲;冯华;熊民权;马华;李焱明 -专利权人：上海芯钛信息科技有限公司
申请日： 2023-05-29 - 公布日： 2023-08-29 - 主分类号： G06F11/10 文献下载
摘要：本申请涉及一种寄存器写检测和状态监测机制实现方法、装置和系统。所述方法通过在寄存器模块中添加全局CRC寄存器保护机制，保护模块内安全相关的寄存器，全局CRC寄存器保护机制包括寄存器写检测和状态监测机制；寄存器写检测和状态监测机制是相互独立运行的，两者在不同的时间段调用写检测及CRC结果寄存器。可寄存器写检测过程可以无延时的检测数值是否正确的写入寄存器，状态监测机制过程中仅用一个CRC计算模块、一个写检测及CRC结果寄存器即可对多个功能寄存器形成监测保护，相比对每个寄存器做CRC的方式，电路实现简单，同时也可以的节省大量的面积开销，且检测时间也能控制在合理的范围内。
寄存器检测状态监测机制实现方法装置系统

[发明专利]数据处理方法、装置及计算机可读存储介质-CN202011271639.5有效
发明人：王骞;庄戌堃 -专利权人：山东云海国创云计算装备产业创新中心有限公司
申请日： 2020-11-13 - 公布日： 2022-12-23 - 主分类号： G06F9/30 文献下载
摘要：其中，方法包括预先为总线上设备的可访问内部寄存器设置相应的镜像寄存器。当接收到有效的总线写请求，将待写入数据锁存至写请求的寄存器对应的镜像寄存器中，并发送在延迟时间段内该镜像寄存器值不变的指令，同时生成FIFO处理请求；延迟时间段从当前时刻开始、时长为数据延迟时间，数据延迟时间大于数据从写入FIFO到写出FIFO、写入内部寄存器及数据同步所需时间之和。根据单深度的FIFO的状态将数据写入目标寄存器，并在延迟时间段之外调用数据同步程序将目标寄存器的变化数据写入至相应的镜像寄存器，可有效解决总线写后立即读这种应用场景下出现的读写不一致的问题，且不会降低整体系统性能
数据处理方法装置计算机可读存储介质

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