[发明专利]减缓GPU访存请求及指令访问cache时停顿的方法有效

专利信息
申请号: 201910601175.0 申请日: 2019-07-04
公开(公告)号: CN110457238B 公开(公告)日: 2023-01-03
发明(设计)人: 李炳超 申请(专利权)人: 中国民航大学
主分类号: G06F12/128 分类号: G06F12/128;G06F12/0811;G06F12/0842
代理公司: 天津市北洋有限责任专利代理事务所 12201 代理人: 李林娟
地址: 300300 天*** 国省代码: 天津;12
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摘要: 发明公开了一种减缓GPU访存请求及指令访问cache时停顿的方法,所述方法包括:位于FIFO队首的访存请求访问L1 cache,将访存请求的tag与L1 cache中的tag进行比较,若存在发生保留停顿的访存请求,将该访存请求从FIFO队首弹出,放入FIFO队尾;通过数据通路连通队首和队尾、以及第一控制逻辑控制访存请求从FIFO队首弹出之后的走向;构建第二控制逻辑及第一、三控制信号,用于对线程束调度器和读取单元之间的访存指令进行流水处理,使得当读取单元中的地址合并单元将所有的访存请求都合并完毕时便可处理下一条访存指令,并且当FIFO队列中有空闲条目时即可生成访存请求并存入。与现有的技术相比,本发明能够减少访存请求的停顿时间,提高访存请求的处理速度,同时也能够减少访存指令的等待时间,提高访存指令的处理速度。
搜索关键词: 减缓 gpu 请求 指令 访问 cache 停顿 方法
【主权项】:
1.一种减缓GPU访存请求及指令访问cache时停顿的方法,其特征在于,所述方法包括:/n位于FIFO队首的访存请求访问L1 cache,将访存请求的tag与L1 cache中的tag进行比较,若存在发生保留停顿的访存请求,将该访存请求从FIFO队首弹出,放入FIFO队尾;/n通过数据通路连通队首和队尾、以及第一控制逻辑控制访存请求从FIFO队首弹出之后的走向;/n构建第二控制逻辑及第一、三控制信号,用于对线程束调度器和读取单元之间的访存指令进行流水处理,使得当读取单元中的地址合并单元将所有的访存请求都合并完毕时便可处理下一条访存指令,并且当FIFO队列中有空闲条目时即可生成访存请求并存入。/n
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