[发明专利]一种支持多种Hash算法的电路有效

专利信息
申请号: 201811575251.7 申请日: 2018-12-21
公开(公告)号: CN109687972B 公开(公告)日: 2021-08-10
发明(设计)人: 申云飞;肖佐楠;郑茳 申请(专利权)人: 天津国芯科技有限公司
主分类号: H04L9/32 分类号: H04L9/32;H04L9/06
代理公司: 天津滨海科纬知识产权代理有限公司 12211 代理人: 杨慧玲
地址: 300457 天津市滨海新区开发*** 国省代码: 天津;12
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摘要: 发明提供了一种支持多种Hash算法的电路,包含初始化逻辑、常量选择逻辑、消息处理逻辑、迭代逻辑、一个MUX以及Hash值寄存器阵列。本设计支持的Hash算法包括:MD5、SHA0、SHA1、SHA224、SHA256、SHA384、SHA512、SM3。支持对一个消息的连续处理,只需要在消息的第一个block开始迭代之前将相应Hash算法定义的迭代初始值加载到Hash值寄存器阵列中,然后连续地处理此消息即可。另外,本设计还支持对一个消息的分段处理,在一个消息的两段之间可以插入另外一个消息的处理,在此种模式下只需要在迭代开始之前将本消息的前一个分段的迭代结果通过初始化逻辑加载到Hash值寄存器阵列即可。
搜索关键词: 一种 支持 多种 hash 算法 电路
【主权项】:
1.一种支持多种Hash算法的电路,其特征在于包括:初始化逻辑、常量选择逻辑、消息处理逻辑、迭代逻辑、MUX和Hash值寄存器阵列,初始化逻辑,用于在迭代开始之前向Hash值寄存器阵列赋初值;常量选择逻辑,根据具体的Hash算法种类以及迭代的轮数来选择需要送到迭代逻辑进行运算的常量值;消息处理逻辑,用于根据输入的原始消息计算每轮迭代需要的消息值;迭代逻辑,用于根据常量选择逻辑、消息处理逻辑及Hash值寄存器阵列提供的输入值对输入的消息进行迭代计算,每轮迭代计算的结果存放在Hash值寄存器阵列中;MUX,用于切换Hash值寄存器阵列与初始化逻辑或者迭代逻辑的通断;Hash值寄存器阵列,用于存储每轮迭代的结果。
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