[发明专利]LDPC译码器有效
| 申请号： | 201710312234.3 | 申请日： | 2017-05-05 |
| 公开（公告）号： | CN108809325B | 公开（公告）日： | 2022-01-28 |
| 发明（设计）人： | 张文军;文凛;寇亚军;戴永清 | 申请（专利权）人： | 上海数字电视国家工程研究中心有限公司 |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 200125 上海市浦东*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供了一种LDPC译码器，其特征在于，包括：主控模块；校验矩阵存储单元；子矩阵控制字模块；以及多对角线信息存储单元，其中，主控模块利用校验矩阵进行校验更新，对变量信息更新得到中间变量结果，多对角线信息存储单元用于存储中间变量结果，基于校验矩阵的并列度、多对角线的线数以及多对角线最大个数来设计该多对角线信息存储单元的大小，子矩阵控制字模块对以一定并行度对校验矩阵进行层处理时当前的子矩阵为准循环矩阵或多对角线矩阵进行判定，当判定为多对角线矩阵结构时，主控模块利用多对角线信息存储单元进行存储，其中，多对角线最大个数表示以一定并行度对校验矩阵进行层处理时子矩阵为多对角线结构的最大个数。 | ||
| 搜索关键词： | ldpc 译码器 | ||
【主权项】：
1.一种LDPC译码器，其特征在于，包括：主控模块；校验矩阵存储单元；子矩阵控制字模块；以及多对角线信息存储单元，其中，所述主控模块利用校验矩阵进行校验更新，对变量信息更新得到中间变量结果，多对角线信息存储单元用于存储所述中间变量结果，基于所述校验矩阵的并列度、多对角线的线数以及多对角线最大个数来设计该多对角线信息存储单元的大小，子矩阵控制字模块对以一定并行度对所述校验矩阵进行层处理时当前的子矩阵为准循环矩阵或多对角线矩阵进行判定，当判定为多对角线矩阵结构时，主控模块利用所述多对角线信息存储单元进行存储，其中，所述多对角线最大个数表示以一定并行度对所述校验矩阵进行层处理时子矩阵为多对角线结构的最大个数。
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