[发明专利]存储器访问指令顺序编码的生成和使用有效
| 申请号： | 201680054500.0 | 申请日： | 2016-09-13 |
| 公开（公告）号： | CN108027773B | 公开（公告）日： | 2022-09-20 |
| 发明（设计）人： | D·C·伯格;A·L·史密斯 | 申请（专利权）人： | 微软技术许可有限责任公司 |
| 主分类号： | G06F12/0806 | 分类号： | G06F12/0806;G06F9/38 |
| 代理公司： | 北京世辉律师事务所 16093 | 代理人： | 王俊 |
| 地址： | 美国华*** | 国省代码： | 暂无信息 |
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| 摘要： | 公开了用于使用硬件结构来控制存储器访问指令在基于块的处理器架构中的执行的装置和方法，该硬件结构指示指令块中的存储器访问指令的相对排序。在所公开的技术的一个示例中，一种执行具有多个存储器加载和/或存储器存储指令的指令块的方法包括选择下一存储器加载或者存储器存储指令，以基于被编码在块内的依赖性和对存储数据的存储向量执行，该数据指示指令块中的哪些存储器加载和存储器存储指令已经执行。可以使用存储掩码来对存储向量进行掩码。可以在对指令块译码时生成或者从指令块头部复制存储掩码。基于编码的依赖性和经掩码的存储向量，下一指令可以在它的依赖性可用时发出。 | ||
| 搜索关键词： | 存储器 访问 指令 顺序 编码 生成 使用 | ||
【主权项】：
1.一种包括存储器和一个或者多个基于块的处理器核的装置，所述核中的至少一个核包括：执行单元，被配置为执行被包含在指令块中的、包括多个存储器加载和/或存储器存储指令的存储器访问指令；硬件结构，其存储指示所述存储器访问指令中的至少一些存储器访问指令的执行排序的数据；以及控制单元，被配置为至少部分基于硬件结构数据来控制所述存储器访问指令向所述执行单元的发出。
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