[发明专利]用于DDS数字内核与数模转换器的电路接口系统有效
| 申请号： | 201611181645.5 | 申请日： | 2016-12-20 |
| 公开（公告）号： | CN106788390B | 公开（公告）日： | 2019-10-29 |
| 发明（设计）人： | 苏小波;于宗光;张涛;季惠才;杨霄垒;张甘英;邹家轩 | 申请（专利权）人： | 中国电子科技集团公司第五十八研究所 |
| 主分类号： | H03K19/0175 | 分类号： | H03K19/0175 |
| 代理公司： | 总装工程兵科研一所专利服务中心 32002 | 代理人： | 杨立秋 |
| 地址： | 214000*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明涉及一种用于DDS数字内核与数模转换器的电路接口系统，其包括DDS内核以及DAC内核；还包括内核接口电路，内核接口电路包括第一数据控制级、第二数据控制级以及第三数据控制级；第一数据控制级接收DDS内核产生的四路并行数据以及DDS内核产生的第一内核时钟；第二数据控制级，将四路并行数据分为两组相位相差180°的数据，并传输至第三数据控制级内，第三数据控制级接收第二数据控制级传输的两组相位相差180°的数据后，在四路相差90°相位的分频电路时钟作用下，将四路并行数据按90°相位差依次传输至DAC内核内。本发明结构紧凑，保证由DDS内核产生的四路高速并行数据能够按序传输至数模转换器，安全可靠。 | ||
| 搜索关键词： | 用于 dds 数字 内核 数模转换器 电路 接口 系统 | ||
【主权项】：
1.一种用于DDS数字内核与数模转换器的电路接口系统，包括DDS内核（1）以及DAC内核（2）；其特征是：还包括用于连接DDS内核（1）与DAC内核（2）连接的内核接口电路，所述内核接口电路包括第一数据控制级（3）、第二数据控制级（4）以及第三数据控制级（5），第一数据控制级（3）与DDS内核（1）连接，第一数据控制级（3）通过第二数据控制级（4）与第三数据控制级（5）连接，第三数据控制级（5）与DAC内核（2）连接；第一数据控制级（3）接收DDS内核（1）产生的四路并行数据以及DDS内核（1）产生的第一内核时钟，以在第一内核时钟作用下，消除四路并行数据间的延迟后，将所述四路并行数据传输至第二数据控制级（4）；第二数据控制级（4）接收第一数据控制级（3）传输的四路并行数据后，在DDS内核（1）产生的第一内核时钟以及第二内核时钟作用下，将四路并行数据分为两组相位相差180°的数据，并传输至第三数据控制级（5）内，其中，第一内核时钟、第二内核时钟为相位相差180°的两相时钟；第三数据控制级（5）接收第二数据控制级（4）传输的两组相位相差180°的数据后，在四路相差90°相位的分频电路时钟作用下，将四路并行数据按90°相位差依次传输至DAC内核（2）内。
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