[发明专利]具有减小环路延时功能的判决反馈均衡器在审

专利信息
申请号: 201611142397.3 申请日: 2016-12-12
公开(公告)号: CN108616468A 公开(公告)日: 2018-10-02
发明(设计)人: 吕俊盛;邵刚;王晋;唐龙飞;田泽;刘颖 申请(专利权)人: 中国航空工业集团公司西安航空计算技术研究所
主分类号: H04L25/03 分类号: H04L25/03
代理公司: 中国航空专利中心 11008 代理人: 杜永保
地址: 710000 *** 国省代码: 陕西;61
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摘要: 发明提供一种用于减小判决反馈均衡器环路延时的加法器配置方法,该方法基于判决反馈均衡器器的基本结构,主要包括:两级串联加法器,采样器和延时锁存器,反馈信号系数控制电路。其特征在于针对传统的判决反馈均衡器电路中的加法器结构,将其用以加和全部反馈信号的单一加法器,分裂为两级串联加法器;同时,将对环路时间约束最严格的反馈环路信号配置到后级加法器中,将其他反馈信号配置到前级加法器中。该配置方法在传统判决反馈均衡器结构基础上,仅需做简单的修改,即可有效减小判决反馈均衡器环路的延时,保证其在超高速应用下功能的正确性。
搜索关键词: 判决反馈均衡器 加法器 反馈信号 减小 环路延时 两级串联 系数控制电路 加法器结构 加法器配置 延时锁存器 反馈环路 结构基础 时间约束 信号配置 采样器 超高速 传统的 前级 延时 配置 电路 分裂 应用 保证
【主权项】:
1.一种具有减小环路延时功能的判决反馈均衡器,包括第一级加法器A、采样器、锁存器和n个系数加权电路,其特征在于,还包括第二级加法器B,第一级加法器A、第二级加法器B和采样器依次串联连接,将第一bit延时输出信号反馈到第二级加法器B中,将其他bit延时输出信号配置到第一级加法器A中。
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