[发明专利]一种链路质量自适应调优方法有效
申请号: | 201610259324.6 | 申请日: | 2016-04-25 |
公开(公告)号: | CN105930225B | 公开(公告)日: | 2017-12-05 |
发明(设计)人: | 周恒钊;童元满;李仁刚;刘金广 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10;G06F13/42 |
代理公司: | 济南信达专利事务所有限公司37100 | 代理人: | 张靖 |
地址: | 250101 山东*** | 国省代码: | 山东;37 |
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摘要: | 本发明公开了一种链路质量自适应调优方法,对于高速串行接口Serdes的链路,所述方法通过将PRBS‑31伪随机码发生/校验加入高速串行接口的去加重均衡过程,并以误码率和温度变化作为DFE结束判断标志,形成高速Serdes链路质量调优的固定流程。本发明方法能够有效改进Serdes链路传输质量,使传输误码率显著降低,进而提高芯片总线的传输性能,且自动化程度高,具有链路调优速度快,效果好等特点。 | ||
搜索关键词: | 一种 质量 自适应 方法 | ||
【主权项】:
一种链路质量自适应调优方法,对于高速串行接口Serdes的链路,其特征在于:所述方法通过将PRBS‑31伪随机码发生/校验过程加入高速串行接口的去加重均衡过程,并以误码率和温度变化量作为DFE判断反馈均衡过程结束判断标志,形成高速Serdes链路质量调优的固定流程;所述方法包括7个环节:1)发送端TX去加重参数配置,根据PCB板级高速信号仿真完整性仿真后得到的发送端均衡器参数值,通过SMBUS总线将其写入Serdes配置模块对应的去加重配置寄存器中;2)发送/接收端极性配置,完成所述的发送端发送端均衡器参数配置后,根据PCB板级设计中高速串行接口的PN翻转情况,对Serdes的Tx/Rx极性寄存器进行配置;3)BIST模式以及校验模式配置,完成所述的发送/接收端极性配置后,将Serdes发送端Tx配置成BIST模式,开始发送PRBS‑31伪随机序列码;接收端Rx打开数据比对,并配置期望的码型为PRBS‑31;4)接收端RX DFE判断反馈均衡过程微代码上传,完成所述的BIST模式配置后,将基于判决反馈均衡算法实现的自适应DFE程序微代码通过SMBUS总线上传写入芯片的RAM存储器中,上传完成后进行CRC校验并且通过;5)接收端RX DFE模式配置以及开始自适应DFE判断反馈均衡过程,完成所述的DFE程序代码 CRC校验后,先将接收端的DFE模式寄存器配置成粗调或参数定义迭代次数精调模式,然后打开DFE判断反馈均衡过程使能开关开始Serdes 接收端Rx自适应DFE判断反馈均衡过程,观测DFE状态寄存器直到粗调状态和精调状态都显示完成,切换DFE模式为自适应循环模式;6)监测序列码校验状态信息,完成所述的切换DFE模式为自适应循环模式后,将错误计数寄存器清0,开始监测该寄存器所显示的错误以及其累加速度,每10秒统计一次错误计数寄存器上的数据,若错误累加速度过快,误码率大于10E‑10,或者芯片温度上升过快, 10秒前后芯片温差大于10摄氏度,则继续保持执行自适应循环DFE 10秒;7)DFE判断反馈均衡过程完成以及发送端数据源切换,误码率小于10E‑10且温差小于10摄氏度,则DFE判断反馈均衡过程完成,关闭DFE判断反馈均衡过程使能后将高速串行接口的数据源从BIST测试数据序列切换到核心数据。
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