[实用新型]一种存储器接口无效
| 申请号： | 201020515413.0 | 申请日： | 2010-09-01 |
| 公开（公告）号： | CN201812284U | 公开（公告）日： | 2011-04-27 |
| 发明（设计）人： | 梁坚;沈斌;江正标;黄宇钊 | 申请（专利权）人： | 杭州国芯科技股份有限公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 310012 浙江省杭州市文*** | 国省代码： | 浙江;33 |
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| 摘要： | 本实用新型公开了一种存储器接口，所述存储器接口包括串行非易失存储器读模块、串行总线选择器和串行非易失存储器控制器。通过上述存储器接口，CPU可以快速对串行非易失存储器内的程序进行读操作，无需再搬运到随机存储器(RAM)中执行，可以节省大量随机存储器(RAM)的空间；同时也不失对串行非易失存储器的写功能。本实用新型还采用高速缓冲存储器，可以加快串行存储器读取数据的速度，使整个嵌入式系统在运行过程中更加流畅。 | ||
| 搜索关键词： | 一种 存储器 接口 | ||
【主权项】：
一种存储器接口，其特征在于：包括串行非易失存储器读模块(200)、串行总线选择器(300)和串行非易失存储器控制器(500)，串行非易失存储器读模块(200)通过第一片上系统总线(110)与片上系统总线控制器(100)相连，并通过第一串行总线(210)与串行总线选择器(300)相连；串行非易失存储器控制器(500)通过第二片上系统总线(120)与片上系统总线控制器(100)相连，并通过第二串行总线(510)与串行总线选择器(300)相连；串行总线选择器(300)通过第三串行总线(310)与串行非易失存储器(400)相连。
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