[发明专利]快闪记忆装置及其控制方法无效
| 申请号： | 200710086856.5 | 申请日： | 2007-03-19 |
| 公开（公告）号： | CN101271432A | 公开（公告）日： | 2008-09-24 |
| 发明（设计）人： | 许耀文 | 申请（专利权）人： | 亮发科技股份有限公司 |
| 主分类号： | G06F13/10 | 分类号： | G06F13/10 |
| 代理公司： | 北京科龙寰宇知识产权代理有限责任公司 | 代理人： | 孙皓晨 |
| 地址： | 中国*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明为一种快闪记忆装置及其控制方法，可利用一简单特殊的设计，以启动快闪记忆装置的特定功能。所述的快闪记忆装置是耦接至主机，且包含闪存与相耦接的控制器。闪存包含使用者区域与系统区域，使用者区域储存有一预设档案，系统区域储存一预设逻辑地址。主机在以写入模式开启所述的预设档案后，发出一写入命令，所述的写入命令是对应一写入逻辑地址且包含第一信息，而若控制器判断所述的写入逻辑地址为所述的预设逻辑地址且第一信息对应在快闪记忆装置的一预设功能，控制器即启动所述的预设功能。 | ||
| 搜索关键词： | 记忆 装置 及其 控制 方法 | ||
【主权项】：
1. 一种控制快闪记忆装置的方法，所述的快闪记忆装置储存有一预设档案与一预设逻辑地址，并耦接至一主机，其特征在于：所述的方法包含：所述的主机以一写入模式开启所述的预设档案；所述的主机发出一写入命令，所述的写入命令是对应一写入逻辑地址且包含一第一信息；所述的快闪记忆装置判断所述的写入逻辑地址是否为所述的预设逻辑地址；以及若所述的写入逻辑地址为所述的预设逻辑地址且所述的第一信息对应所述的快闪记忆装置的一预设功能，所述的快闪记忆装置启动所述的预设功能。
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