[发明专利]PLL时钟发生器及其控制方法和光盘装置无效
| 申请号： | 200410036888.0 | 申请日： | 2004-04-21 |
| 公开（公告）号： | CN1540636A | 公开（公告）日： | 2004-10-27 |
| 发明（设计）人： | 南野顺一;中田浩平 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G11B7/004 | 分类号： | G11B7/004;H03L7/08 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 汪惠民 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种PLL时钟发生器，接收输入信号，生成具有输入信号频率的N倍(N为大于或等于1的自然数)频率的输出信号，具备：对时钟信号进行N分频并输出的分频器(206)；检测输入信号与分频器(206)的输出信号的相位差，并输出包含表示所述相位差信息的相位差信号的相位比较器(202)；除去相位差信号的高频成分的低通滤波器(203)；发生对应低通滤波器(203)的输出频率的时钟信号，并将其输出到分频器的电压控制振荡器(204)；根据相位差信号，控制分频器输出信号相位的相位控制部(205)。由这样简单的构成，可以实现抖动小，高速引入的PLL时钟发生器。 | ||
| 搜索关键词： | pll 时钟发生器 及其 控制 方法 光盘 装置 | ||
【主权项】：
1.一种PLL时钟发生器，接收输入信号，并生成具有所述输入信号频率的N倍频率的输出信号的PLL时钟发生器，其中N为大于或等于1的自然数，其特征在于，具备：分频器，对时钟信号进行N分频后输出；相位比较器，检测所述输入信号与所述分频器的输出信号之间的相位差，并输出包含表示所述相位差的信息的相位差信号；低通滤波器，对所述相位差信号平滑化；电压控制振荡器，产生与低通滤波器输出对应的频率的所述时钟信号，并输出到所述分频器；和相位控制部，根据所述相位差信号控制所述分频器的输出信号的相位。
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