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[发明专利]用于共享虚拟存储器的系统-CN201611013967.9有效
发明人： R·M·桑卡兰;A·考克;P·兰兹;A·K·马里克;J·B·克罗斯兰;A·纳瓦勒;G·尼格;A·V·安德森 -专利权人：英特尔公司
申请日： 2012-07-24 - 公布日： 2021-09-07 - 主分类号： G06F12/1027 文献下载
摘要：本申请公开了用于在支持共享虚拟存储器的异构计算系统中的TLB关闭的方法和装置。公开了用于在多核系统中的共享虚拟存储器的异构设备的有效的TLB(转换后备缓冲器)关闭的方法和装置。用于有效的TLB关闭的装置的实施例可以包括：TLB，用于存储虚拟地址转换条目；以及与所述TLB耦合的存储器管理单元，用于保持与所述虚拟地址转换条目相对应的PASID(进程地址空间标识符)状态条目。PASID状态条目可以包括活跃参考状态和懒惰无效状态。该存储器管理单元可以响应于接收来自多核系统中的设备的PASID状态更新请求而执行PASID状态条目的原子修改，并读取PASID状态条目的懒惰无效状态。该存储器管理单元可以在响应各自的懒惰无效状态的激活之前将PASID状态更新响应发送到该设备以同步TLB条目。
用于共享虚拟存储器系统

[发明专利]用于生成被抑制的地址踪迹的设备和方法-CN201510313397.4有效
发明人： T·奥普费曼;J·B·克罗斯兰;J·W·布兰德特;B·C·斯特朗 -专利权人：英特尔公司
申请日： 2015-06-09 - 公布日： 2019-03-12 - 主分类号： G06F9/30 文献下载
摘要：描述了用于生成被抑制的地址踪迹的方法和设备。在某些实施例中，处理器包括具有踪迹抑制器的踪迹生成器，该踪迹抑制器输出由处理器执行的指令的被抑制的地址踪迹。在某些实施例中，为处理器生成被抑制的地址踪迹的方法包括从处理器的踪迹生成器的踪迹抑制器生成执行的指令的被抑制的地址踪迹。
用于生成抑制地址踪迹设备方法

[发明专利]用于在每线程的基础上跟踪TLB清除的装置、方法、系统和计算机可读存储介质-CN201380062629.2有效
发明人： S·M·康拉德;R·J·芬格;G·康纳;R·塞斯;J·B·克罗斯兰;A·阿加瓦尔 -专利权人：英特尔公司
申请日： 2013-06-20 - 公布日： 2018-08-07 - 主分类号： G06F12/10 文献下载
摘要：描述了一种包括识别有待被无效的一个或多个硬件线程的TLB信息的方法。该方法还包括确定该一个或多个硬件线程中的哪些线程处于其中TLB信息被清除的状态下。该方法还包括将TLB击落指引到该一个或多个硬件线程中的处于其中TLB信息未被清除的状态下的那些线程。
用于线程基础上跟踪 tlb 清除装置方法

[发明专利]用于防止未经授权的堆栈转移的系统和方法-CN201480025410.X有效
发明人： B·V·帕特尔;李晓宁;H·P·安维恩;A·K·马利克;G·奈格;J·B·克罗斯兰;T·奥普费尔曼;A·A·哈雷;J·W·布兰特;J·S·科克;B·L·瓦伊达 -专利权人：英特尔公司
申请日： 2014-05-30 - 公布日： 2018-07-24 - 主分类号： G06F12/14 文献下载
摘要：示例处理系统可以包括：堆栈下界寄存器，其被配置为存储第一存储器地址，该第一存储器地址标识能够经由堆栈段寻址的存储器的下界；堆栈上界寄存器，其被配置为存储第二存储器地址，该第二存储器地址标识能够经由堆栈段寻址的存储器的上界；以及堆栈边界校验逻辑，其被配置为通过将经由堆栈段访问的存储器地址与第一存储器地址和第二存储器地址中的至少一个进行比较来检测未经授权的堆栈转移。
用于防止未经授权堆栈转移系统方法

[发明专利]用于在计算机系统中传递中断的技术-CN201410225104.2有效
发明人： K·蒂鲁瓦鲁;R·帕塔萨拉蒂;J·B·克罗斯兰;S·考什克;L·胡德 -专利权人：英特尔公司
申请日： 2009-10-28 - 公布日： 2017-11-07 - 主分类号： G06F15/163 文献下载
摘要：一种实现计算机系统中的高效中断通信的技术。在一个实施方式中，在不使用存储器映射输入/输出(MMIO)的情况下，高级可编程中断控制器(APIC)使用多种接口指令或操作经由APIC接口寄存器中的一组位连接。
用于计算机系统传递中断技术

[发明专利]用于系统调用的稳健且高性能的指令-CN201410095695.6有效
发明人： B·V·帕特尔;J·B·克罗斯兰;A·A·哈尔;T·奥普费曼 -专利权人：英特尔公司
申请日： 2014-03-14 - 公布日： 2017-10-13 - 主分类号： G06F21/56 文献下载
摘要：本发明涉及用于系统调用的稳健且高性能的指令。稳健的系统调用和系统返回指令被处理器执行以在请求者和操作系统内核之间转移控制。该处理器包括执行电路和存储指向存储器中的数据结构的指针的寄存器。该执行电路从请求者接收将控制从所述请求者的第一特权等级转移到操作系统内核的第二特权等级的系统调用指令。作为响应，该执行电路在一个最小单元过渡中在所述请求者和所述操作系统内核之间交换所述寄存器所指向的数据结构。
用于系统调用稳健性能指令

[发明专利]用于在计算机系统中传递中断的技术-CN201310264335.X有效
发明人： K·蒂鲁瓦鲁;R·帕塔萨拉蒂;J·B·克罗斯兰;S·考什克;L·胡德 -专利权人：英特尔公司
申请日： 2009-10-28 - 公布日： 2017-07-04 - 主分类号： G06F13/24 文献下载
摘要：一种实现计算机系统中的高效中断通信的技术。在一个实施方式中，在不使用存储器映射输入/输出（MMIO）的情况下，高级可编程中断控制器（APIC）使用多种接口指令或操作经由APIC接口寄存器中的一组位连接。
用于计算机系统传递中断技术

[发明专利]用于在支持共享虚拟存储器的异构计算系统中的TLB关闭的方法和装置-CN201280031876.1有效
发明人： R·M·桑卡兰;A·考克;P·兰兹;A·K·马里克;J·B·克罗斯兰;A·纳瓦勒;G·尼格;A·V·安德森 -专利权人：英特尔公司
申请日： 2012-07-24 - 公布日： 2014-05-28 - 主分类号： G06F12/10 文献下载
摘要：公开了用于在多核系统中的共享虚拟存储器的异构设备的有效的TLB(转换后备缓冲器)关闭的方法和装置。用于有效的TLB关闭的装置的实施例可以包括：TLB，用于存储虚拟地址转换条目；以及与所述TLB耦合的存储器管理单元，用于保持与所述虚拟地址转换条目相对应的PASID(进程地址空间标识符)状态条目。PASID状态条目可以包括活跃参考状态和懒惰无效状态。该存储器管理单元可以响应于接收来自多核系统中的设备的PASID状态更新请求而执行PASID状态条目的原子修改，并读取PASID状态条目的懒惰无效状态。该存储器管理单元可以在响应各自的懒惰无效状态的激活之前将PASID状态更新响应发送到该设备以同步TLB条目。
用于支持共享虚拟存储器计算系统中的 tlb 关闭方法装置

[发明专利]用于进行段寄存器读和写而不管特权等级的系统、装置和方法-CN201180062099.2有效
发明人： B·V·帕特尔;G·尼格;M·G·迪克森;J·S·科克;J·B·克罗斯兰 -专利权人：英特尔公司
申请日： 2011-11-09 - 公布日： 2013-08-28 - 主分类号： G06F9/30 文献下载
摘要：描述了用于执行特权不可知的段基寄存器读或写指令的系统、装置和方法的实施例。示例性方法可包括获取特权不可知的段基寄存器写指令，其中该特权不可知的写指令包括64位数据源操作数，对所获取的特权不可知的段基寄存器写指令进行解码，以及执行经解码的特权不可知的段基寄存器写指令以便将源操作数的64位数据写入由该特权不可知的段基寄存器写指令的操作码标识的段基寄存器中。
用于进行寄存器不管特权等级系统装置方法

[发明专利]使用寄存器扩展在中央处理单元中管理和实现元数据-CN201010500641.5有效
发明人： B·V·帕特尔;R·古帕拉克里西南;A·F·格鲁;R·J·科什里斯;D·A·范德克;J·F·西胡拉;A·K·玛里克;J·B·克罗斯兰;G·尼格;S·D·罗杰斯;M·G·迪克森;M·J·查尼;J·格特里伯 -专利权人：英特尔公司
申请日： 2010-09-25 - 公布日： 2011-04-27 - 主分类号： G06F9/30 文献下载
摘要：处理器的一组默认寄存器被扩展成计算机系统的处理器上的元数据寄存器。默认寄存器上存储有数据，而与该数据关联的元数据单独存储在元数据寄存器上。
使用寄存器扩展中央处理单元管理实现数据

[发明专利]具有群集ID和群集内ID的逻辑APIC ID的创建-CN200880107214.1无效
发明人： S·D·考什基;K·K·蒂鲁瓦卢尔;J·B·克罗斯兰;S·穆思拉萨纳卢尔;R·S·帕塔萨拉蒂;L·P·霍德 -专利权人：英特尔公司
申请日： 2008-08-28 - 公布日： 2010-08-04 - 主分类号： G06F13/24 文献下载
摘要：在一些实施例中，设备包含逻辑中断标识号创建逻辑以接收物理处理器标识号，并通过使用物理处理器标识号创建逻辑处理器标识号。每一个逻辑处理器标识号对应于其中一个物理处理器标识号，并且逻辑处理器标识号各包含处理器群集标识号和群集内标识号。处理器群集标识号各形成为包含来自在适当位置移位的对应物理处理器标识号的一组位，并且群集内标识号各响应于对应物理处理器标识号位中其它位的值形成。描述了其它实施例。
具有群集 id 逻辑 apic 创建

[发明专利]用于在计算机系统中传递中断的技术-CN200910207971.2有效
发明人： K·蒂鲁瓦鲁;R·帕塔萨拉蒂;J·B·克罗斯兰;S·考什克;L·胡德 -专利权人：英特尔公司
申请日： 2009-10-28 - 公布日： 2010-06-09 - 主分类号： G06F13/24 文献下载
摘要：一种实现计算机系统中的高效中断通信的技术。在一个实施方式中，在不使用存储器映射输入/输出(MMIO)的情况下，高级可编程中断控制器(APIC)使用多种接口指令或操作经由APIC接口寄存器中的一组位连接。
用于计算机系统传递中断技术

[发明专利]识别处理器集群的中断的处理器选择-CN200810212765.6有效
发明人： S·D·考希克;K·K·蒂鲁瓦卢尔;J·B·克罗斯兰;S·穆特拉沙纳鲁;R·S·帕塔萨拉蒂;L·P·胡德 -专利权人：英特尔公司
申请日： 2008-09-04 - 公布日： 2009-03-11 - 主分类号： G06F9/48 文献下载
摘要：在一些实施例中，一种装置包括处理器选择逻辑，用于接收与中断相关联的逻辑目的地标识号码，所述中断每个都具有处理器集群标识号码，用于识别所述中断所引导至的处理器集群。所述逻辑目的地标识号码每个都用于识别在所识别的处理器集群中哪些处理器可用来接收中断中相对应的一个。所述处理器选择逻辑用于选择所述可用的处理器的一个来接收所述中断，以及所述可用的处理器中所选择的一个通过所述逻辑目的地标识号码中相应位的相对位置来被识别。还描述了其它实施例。
识别处理器集群中断选择

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