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[发明专利]采用用于校准的脉冲到数字转换器(PDC)的延迟锁定环(DLL)-CN201880044778.9有效
发明人： E·黑路;B·班迪达 -专利权人：高通股份有限公司
申请日： 2018-06-18 - 公布日： 2023-08-25 - 主分类号： H03L7/081 文献下载
摘要：本公开的方面涉及从同相时钟信号生成正交时钟信号。根据一个方面，延迟锁定环(DLL)包括：第一脉冲到数字转换器(PDC)，生成第一脉冲宽度测量，其中第一脉冲宽度测量包括第一符号和第一幅度；第二脉冲到数字转换器(PDC)，生成第二脉冲宽度测量，其中第二脉冲宽度测量包括第二符号和第二幅度；数字环路滤波器，其被耦合到第一PDC和第二PDC，数字环路滤波器基于第一脉冲宽度测量和第二脉冲宽度测量生成经过滤波的比较输出；以及第一延迟生成块，基于经过滤波的比较输出和同相时钟信号生成正交时钟信号。
采用用于校准脉冲数字转换器 pdc 延迟锁定 dll

[发明专利]栅极升压的低压降调节器-CN202010207274.3有效
发明人：高卓;B·班迪达 -专利权人：高通股份有限公司
申请日： 2017-03-13 - 公布日： 2021-12-03 - 主分类号： G05F1/575 文献下载
摘要：本公开的实施例涉及栅极升压的低压降调节器。在某些方面，电压调节器包括传输晶体管，传输晶体管具有耦合到电压调节器的输入的漏极、耦合到电压调节器的输出的源极以及栅极。电压调节器还包括放大器，放大器具有耦合到基准电压的第一输入、耦合到反馈电压的第二输入以及输出，其中反馈电压大约等于电压调节器的输出处的电压或与电压调节器的输出处的电压成比例。电压调节器还包括电压升压器，电压升压器具有耦合到放大器的输出的输入和耦合到传输晶体管的栅极的输出，其中电压升压器被配置成将在电压升压器的输入处的电压升压以生成经升压的电压，并在电压升压器的输出处输出经升压的电压。
栅极升压低压降调

[发明专利]电子设备和用于监视模拟信号的方法-CN201780052615.0有效
发明人：宋德强;孔晓华;B·班迪达;高卓 -专利权人：高通股份有限公司
申请日： 2017-08-09 - 公布日： 2021-08-31 - 主分类号： G01R31/316 文献下载
摘要：集成电路(IC)芯片包括用于监视由IC芯片内一个或多个混合信号核芯所生成的模拟信号集合、将模拟信号转换为数字信号、在片上存储器中存储数字信号、以及一旦请求提供数字信号至测试设备的片上模拟信号监视电路。模拟信号监视电路包括用于生成精确电压和/或电流的片上参考生成器，用于将所选择参考信号路由至模拟是数字转换器(ADC)用于校准目的以及用于将所选择模拟信号从混合信号核芯的一个路由至ADC用于数字化目的的开关网络。IC芯片进一步包括用于存储数字化模拟信号以后续由测试设备访问用于分析的片上存储器。IC芯片包括用于输出数字化模拟信号的数字模拟测试点(ATP)。
电子设备用于监视模拟信号方法

[发明专利]栅极升压的低压降调节器-CN201780021437.5有效
发明人：高卓;B·班迪达 -专利权人：高通股份有限公司
申请日： 2017-03-13 - 公布日： 2020-04-03 - 主分类号： G05F1/575 文献下载
摘要：在某些方面，电压调节器包括传输晶体管，传输晶体管具有耦合到电压调节器的输入的漏极、耦合到电压调节器的输出的源极以及栅极。电压调节器还包括放大器，放大器具有耦合到基准电压的第一输入、耦合到反馈电压的第二输入以及输出，其中反馈电压大约等于电压调节器的输出处的电压或与电压调节器的输出处的电压成比例。电压调节器还包括电压升压器，电压升压器具有耦合到放大器的输出的输入和耦合到传输晶体管的栅极的输出，其中电压升压器被配置成将在电压升压器的输入处的电压升压以生成经升压的电压，并在电压升压器的输出处输出经升压的电压。
栅极升压低压降调

[发明专利]锁相环(PLL)架构-CN201680014381.6有效
发明人： K·L·阿库迪亚;J·A·谢弗;B·班迪达 -专利权人：高通股份有限公司
申请日： 2016-02-12 - 公布日： 2020-03-31 - 主分类号： H03L7/091 文献下载
摘要：在一个实施例中，一种锁相环(PLL)包括：压控振荡器(VCO)；分频器，被配置为对VCO的输出信号进行分频以产生反馈信号；以及相位检测电路，被配置为检测参考信号与反馈信号之间的相位差，并且基于检测的相位差生成输出信号。该PLL还包括：比例电路，被配置为基于相位检测电路的输出信号生成控制电压，其中控制电压调谐VCO的第一电容以提供相位校正。该PLL进一步包括：积分电路，被配置为将控制电压转换为数字信号，对数字信号进行积分，并基于积分后的数字信号来调谐VCO的第二电容以提供频率跟踪。
锁相环 pll 架构

[发明专利]脉冲数字转换器-CN201880044773.6在审
发明人： E·黑路;B·班迪达 -专利权人：高通股份有限公司
申请日： 2018-06-18 - 公布日： 2020-02-21 - 主分类号： H03M1/50 文献下载
摘要：本公开的各方面涉及一种脉冲数字转换器。根据一个方面，脉冲数字转换器包括：输入，其用于接收输入脉冲信号；分数元件，其耦合到输入，其中分数元件生成输入脉冲信号的分数脉宽测量；以及积分元件，其耦合到输入，其中积分元件生成输入脉冲信号的积分脉宽测量，并且其中分数脉宽测量和积分脉宽测量被并置为输出信号。
脉冲数字转换器

[发明专利]具有自适应时钟数据恢复的串化解串器-CN201880042151.X在审
发明人： E·黑路;B·班迪达;J·博耶特 -专利权人：高通股份有限公司
申请日： 2018-06-26 - 公布日： 2020-02-11 - 主分类号： H03L7/08 文献下载
摘要：提供了一种换挡串化器‑解串器(串化解串器)，其在锁定检测之前，在对串行数据流解串时，使用第一除数值以形成分频后的时钟，并且其在锁定检测之后使用第二除数值以形成分频后的时钟值，其中第二除数值大于第一除数值。
分频锁定串行数据流换挡串化器解串器检测串器解串化解

[发明专利]用于对来自感测放大器中的无源均衡器的电流进行组合的装置和方法-CN201680059270.7在审
发明人： E·黑路;H·科恩;B·班迪达 -专利权人：高通股份有限公司
申请日： 2016-09-12 - 公布日： 2018-06-08 - 主分类号： H03F3/45 文献下载
摘要：一种被配置为向输入数据信号应用均衡并且基于经均衡的数据信号来检测数据的装置。该装置包括无源均衡器，无源均衡器包括被配置为基于输入信号生成第一信号的第一信号路径、以及被配置为通过对输入信号进行滤波来生成第二信号的第二信号路径。该装置进一步包括感测放大器，感测放大器具有被配置为生成与第一和第二信号的组合相关的第三信号的输入电路、以及被配置为基于第三信号生成数据的数据检测电路。数据检测电路可以被配置作为强臂锁存器。第三信号可以是包括正和负电流分量的差分电流信号。强臂锁存器基于正电流分量是否大于负电流分量来生成数据。
感测放大器无源均衡器配置第二信号数据检测电路负电流臂锁存器均衡差分电流信号输入信号生成检测数据生成数据输入电路数据信号信号生成信号应用正电流滤波

[发明专利]新型分数锁相环（PLL）架构-CN201680046008.9在审
发明人： B·班迪达;H·科恩;E·黑路;K·L·阿库迪亚 -专利权人：高通股份有限公司
申请日： 2016-07-07 - 公布日： 2018-04-17 - 主分类号： H03L7/18 文献下载
摘要：在一个实施例中，一种用于频率划分的方法包括将模信号从级联的划分器级中的最后划分器级向划分器级中的第一划分器级沿划分器级的链向上传播，并且针对划分器级中的每个划分器级，当模信号传播出划分器级时生成相应的本地负载信号。该方法还包括针对划分器级中的每个划分器级，基于相应的本地负载信号向划分器级输入一个或多个相应的控制位，一个或多个相应的控制位设置划分器级的划分器值。
新型分数锁相环 pll 架构

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