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[发明专利]片上电源开关链的构建方法、装置、设备及存储介质-CN201911081410.2有效
发明人：宋振坤;田金峰;马卓;丁军锋;张少华;周朝旭;王春雷;宋佳利;欧平;张明;郭御风;李珊珊;李振虎;赵旭野;魏龙文;薛彤;刘登龙;吉博林 -专利权人：飞腾信息技术有限公司
申请日： 2019-11-07 - 公布日： 2023-10-24 - 主分类号： G06F30/392 文献下载
摘要：本发明提供了一种片上电源开关链的构建方法、装置、设备及存储介质，其中该构建方法包括：获取片上系统中目标模块的中心区域和缝隙区域内所有门控电源单元psw的坐标位置信息；对中心区域内的psw进行连接，形成第一psw闭环链；获取目标模块的门控电源单元触发信号的坐标位置信息；在第一psw闭环链中接入门控电源单元触发信号和门控电源单元响应信号；对缝隙区域内的psw进行连接，形成第二psw闭环链；确定中心区域内所有psw中距离缝隙区域最近的目标psw；以目标psw为接入点，将第二psw闭环链接入第一psw闭环链，形成片上电源开关链。本发明能快速处理模块中的psw串链，准确的实现psw的最优连接，避免出现冗长的连接线，防止绕线拥塞。
电源开关构建方法装置设备存储介质

[发明专利]片上系统的混合时钟树结构-CN201910845557.8有效
发明人：张少华;马卓;丁军锋;张弛;李振虎;宋佳利;田金峰;朱长举;张明;郭御风;赵旭野;刘登龙;魏龙文;薛彤 -专利权人：飞腾信息技术有限公司
申请日： 2019-09-02 - 公布日： 2023-05-23 - 主分类号： G06F30/39 文献下载
摘要：本发明提供了一种片上系统的混合时钟树结构，片上系统的时钟主干路径上的多个门控单元位于所述片上系统时钟结构的中心位置，所述多个门控单元包括沿时钟信号传播方向依次设置的第一级门控单元和第二级门控单元以及第三级门控单元，各级门控单元的输出端口均设有H‑tree，所述第一级门控单元和所述第二级门控单元的输出端口处均以其输出端口为根节点形成有多叉树时钟树。本发明可以根据时钟结构和负载情况，灵活的在时钟的不同分支门控之后建立规模相对较小的多棵H‑tree，在局部负载较小的时钟树分支上基于多叉树的方案产生时钟树，使得多叉树产生的时钟树长度小于同层次之下H‑tree的时钟延迟，使得整个时钟树的延迟达到最短。
系统混合时钟结构

[发明专利]片上系统的顶层时钟树结构-CN201910824725.5有效
发明人：马卓;张少华;丁军锋;王飞;田金峰;张弛;李振虎;朱长举;张明;郭御风;宋佳利;薛彤;刘登龙;魏龙文;赵旭野 -专利权人：飞腾信息技术有限公司
申请日： 2019-09-02 - 公布日： 2023-04-18 - 主分类号： G06F30/396 文献下载
摘要：本发明提供了一种片上系统的顶层时钟树结构，该片上系统包括多个模块，多个模块包括电源可关断模块，电源可关断模块的tap单元的输入端口为时钟信号接入端口，电源可关断模块的tap单元的第一输出端口连接至电源可关断模块的下一级模块的tap单元的输入端口，电源可关断模块的tap单元的第二输出端口为电源可关断模块的时钟树根节点，能极大的降低顶层时钟树的整体延迟，有利于片上系统不同模块之间接口时序的收敛及优化。
系统顶层时钟结构

[发明专利]片上系统的时钟树结构的设计方法、装置、设备及介质-CN201911098764.8有效
发明人：马卓;田金峰;周朝旭;刘登龙;郭御风;张明;赵旭野;薛彤;魏龙文;吉博林 -专利权人：飞腾信息技术有限公司
申请日： 2019-11-12 - 公布日： 2022-06-03 - 主分类号： G06F1/3234 文献下载
摘要：本发明提供了一种片上系统的时钟树结构的设计方法、装置、设备及介质，其中该设计方法包括：确定片上系统允许同时导通的寄存器的最大数量；对片上系统内的所有寄存器进行分组，得到多个寄存器小组；其中，每个寄存器小组内的寄存器数量小于或等于最大数量；分别针对每个寄存器小组，对寄存器小组内的各寄存器进行时钟树设计，得到各寄存器小组的时钟树；分别将各寄存器小组的时钟树连接至片上系统的主时钟路径上；根据各时钟树的时钟长度，调节主时钟路径上的时钟信号到达各寄存器小组的时钟长度；其中，时钟信号到达各寄存器小组的时钟长度互不相同。本发明能减少同时翻转的寄存器数量，有效降低片上系统的瞬时功耗，减小对电源的冲击。
系统时钟结构设计方法装置设备介质

[发明专利]一种耐高压低功耗启动电路-CN201910640395.4在审
发明人：马卓;田金峰;丁军锋;张少华;欧平;朱长举;赵旭野;魏龙文;薛彤;刘登龙;吉博林 -专利权人：天津飞腾信息技术有限公司
申请日： 2019-07-16 - 公布日： 2019-09-06 - 主分类号： H03K17/081 文献下载
摘要：本发明公开了一种耐高压低功耗启动电路，包括2*P个NMOS管、PMOS管P1和电容C1，P个NMOS管依次串联形成第一降压电路，另外P个NMOS管依次串联形成第二降压电路，第一降压电路一端和电源VDD相连，另一端通过电容C1后接地VSS且和PMOS管P1的栅极相连，PMOS管P1的源极通过第二降压电路和电源VDD相连，漏极作为耐高压低功耗启动电路的输出端。本发明相对于传统的耐高压启动电路在启动动作完成后难以解决仍然存在的功耗问题，巧妙利用了RC延时在启动动作完成后关闭启动管使得启动电路不存在功耗，该启动电路可广泛应用于耐高压、低功耗电路中，且可以大大减少版图面积的开销。
启动电路功耗降压电路启动动作依次串联耐高压电容电源低功耗电路栅极相连接地传统的输出端漏极源极应用