专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]资源选择方法及装置、存储介质、终端-CN201811141242.7有效
  • 燕威;曲鑫;王化磊;杨毅 - 展讯半导体(南京)有限公司
  • 2018-09-28 - 2022-11-25 - H04W24/08
  • 一种资源选择方法及装置、存储介质、终端,所述方法包括:获取在预测窗口内已经发送的数据包的相关信息,所述相关信息包括所述已经发送的数据包的大小;根据所述已经发送的数据包的大小的变化趋势确定预测值,所述预测值用于预测在资源选择窗口内将要发送的数据包的大小,所述资源选择窗口位于所述预测窗口之后;根据所述预测值在预设传输资源集合中选择候选资源;对所述候选资源进行LBT侦测,并根据LBT侦测结果选择可用资源。在数据包的大小可变的周期性通信模式下,通过本发明提供的方案能够有效提高时频资源的利用率。
  • 资源选择方法装置存储介质终端
  • [发明专利]序列的循环移位装置及方法、存储介质-CN201811455830.8有效
  • 燕威;谢静;徐志昆 - 展讯半导体(南京)有限公司
  • 2018-11-30 - 2022-10-25 - H03M13/11
  • 一种序列的循环移位装置及方法、存储介质,装置包括:第一组循环移位寄存器,包括多个第一循环移位器;第二组循环移位寄存器,包括多个第二循环移位器,第k个第一循环移位器的各个输出端依次连接至各个第二循环移位器的第k个输入端,k为正整数;顺序重排模块,适于接收各个第二循环移位器的输出端的输出数据,对输出数据的次序进行重排,得到输出序列;对长度为x的序列移位v时,c个第一循环移位器接收序列拆分得到的子序列并移位,移位的位数是根据x、v和c确定的,c是外部输入的,子序列的长度d个第二循环移位器移位的位数是根据x、v和c确定的,v、x、c、d为正整数,x≤c·d。本发明的方案可以降低移位复杂度。
  • 序列循环移位装置方法存储介质
  • [发明专利]5G车联网中传输样式的选择方法、装置及用户设备-CN201910027297.3有效
  • 邹蕾;曲鑫;杨毅;燕威;王化磊 - 展讯半导体(南京)有限公司
  • 2019-01-11 - 2022-09-20 - H04W4/50
  • 本发明提供一种5G车联网中传输样式的选择方法、装置及用户设备。所述方法包括:在5G车联网中,确定n时刻是否需要进行传输样式选择;当需要进行传输样式选择时,若当前UE在[n‑T,n]内使用过一个传输样式进行非周期性业务传输,继续选择所述传输样式进行业务传输;若当前UE在[n‑T,n]内没有使用过传输样式进行非周期性业务传输,在样式选择窗内排除在感知窗中感知到的被周期性业务使用的传输样式以及在[n‑T,n]内感知到的被非周期性业务使用的传输样式,然后在样式选择窗内剩余的传输样式中随机选择一个传输样式进行业务传输;感知窗为[n‑2T,n],样式选择窗为[n+t1,n+T],T为免调度配置周期,t1取决于UE实现。本发明能够减少非周期性业务造成的资源浪费和资源碰撞。
  • 联网传输样式选择方法装置用户设备
  • [发明专利]LDPC的乱序译码实现方法及装置-CN201711376656.3有效
  • 戴晶;燕威;谢静 - 北京紫光展锐通信技术有限公司
  • 2017-12-19 - 2022-08-26 - H03M13/11
  • 本发明提供一种LDPC的乱序译码实现方法及装置。所述方法包括:针对LDPC码所使用的基图,选择母序列,其中,所述母序列为根据所述基图不同码率的LDPC码而预设的针对最大行数的乱序序列;根据译码所需的行索引号,从所述母序列中选择译码用的行块的乱序序列;按照所述译码用的行块的乱序序列对所述LDPC码的基础矩阵进行行乱序;对乱序后的基础矩阵的行进行分层;对分层后的基础矩阵进行流水线译码。本发明对于同一个基图,只需要一个乱序序列即可实现对不同码率的NR LDPC码进行行乱序的分层译码,从而可以减少硬件开销。
  • ldpc译码实现方法装置
  • [发明专利]一种基于DVB-S2标准多码率兼容的LDPC编码器-CN201610901130.1有效
  • 燕威;李炯卉;朱岩;熊蔚明 - 中国科学院国家空间科学中心
  • 2016-10-17 - 2019-05-17 - H03M13/11
  • 本发明提供了一种基于DVB‑S2标准多码率兼容的LDPC编码器,包括控制信号生成单元和校验比特更新单元;所述控制信号生成单元根据设定的编码码率和编码起始标识信号产生用于控制整个编码器运转的状态控制信号、每一输入的待编码信息比特对应于DVB‑S2标准所提供的地址表中对应行的若干地址、该编码码率对应的控制标识信号,并输出至校验比特更新单元;所述的校验比特更新单元通过状态控制信号和控制标识信号的控制,将待编码信息比特与其对应的若干地址中读取的校验比特进行模二加运算,并将运算结果写入原地址。本发明通过将控制单元和运算单元分离设计,实现了多种码率兼容的LDPC编码器,只需要在外部接口设置相应的编码码率,即可完成相应码率的编码运算。
  • 一种基于dvbs2标准多码率兼容ldpc编码器

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