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- [发明专利]全数字锁相回路及其校正方法-CN202110869536.7在审
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杨育哲
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瑞昱半导体股份有限公司
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2021-07-30
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2023-02-03
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H03L7/085
- 本公开涉及全数字锁相回路及其校正方法。一种全数字锁相回路(all‑digital phase‑locked loop,ADPLL),包含:数字控制振荡器(digitally controlled oscillator,DCO),用来依据频率控制信号产生时钟信号;时间‑数字转换器(time‑to‑digital converter,TDC),耦接至该数字控制振荡器,用来依据该时钟信号与参考信号之间的相位差产生数字输出信号;以及归一化(normalization)电路,耦接至该时间‑数字转换器,用来依据增益参数将该数字输出信号转换为时钟相位值;其中该归一化电路对应该数字输出信号自储存的多个候选增益参数选出其中之一做为该增益参数。
- 数字回路及其校正方法
- [发明专利]全数字锁相回路及其校正方法-CN202110755512.9在审
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杨育哲;陈家源
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瑞昱半导体股份有限公司
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2021-07-05
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2023-01-06
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H03L7/081
- 本公开涉及全数字锁相回路及其校正方法。本发明提供一种全数字锁相回路及其校正方法,其中该全数字锁相回路可包含一数字控制振荡器、耦接至该数字控制振荡器的一时间‑数字转换器、以及耦接至该时间‑数字转换器的一正规化电路。该数字控制振荡器可用来依据一频率控制讯号产生一时脉讯号,该时间‑数字转换器可用来依据该时脉讯号与一参考讯号之间的相位差产生一数字输出讯号,以及该正规化电路可用来依据一增益参数将该数字输出讯号转换为一时脉相位值。尤其,该正规化电路可依据该时脉相位值与一参考相位值之间的一相位差数值调整该增益参数。
- 数字回路及其校正方法
- [发明专利]收发器电路-CN202010562878.X在审
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陈家源;石益璋;杨育哲
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瑞昱半导体股份有限公司
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2020-06-19
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2022-01-07
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H03L7/08
- 本发明公开一种收发器电路,其包括收发天线、发射器电路、接收器电路、频率合成器以及基频电路。发射器电路用以通过收发天线发射对应于射频频率的射频信号。频率合成器用以提供分别具有第一本地振荡频率及第二本地振荡频率的第一本地振荡信号及第二本地振荡信号。基频电路在发射器模式及接收器模式下运作。在发射器模式下,频率合成器提供第一本地振荡信号,在接收器模式下,频率合成器提供第二本地振荡信号,且第一本地振荡频率为射频频率的非整数倍,且第二本地振荡频率为射频频率的整数倍。
- 收发电路
- [发明专利]锁相回路电路-CN201210160455.0有效
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杨育哲;康汉彰
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瑞昱半导体股份有限公司
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2012-05-22
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2016-04-13
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H03L7/087
- 本发明提供一种锁相回路电路。锁相回路电路包含一相位频率检测器、一第一充电泵、一第二充电泵、一第一回路元件组、一第二回路元件组、一压控振荡器以及一除频器。第一充电泵及第二充电泵耦接相位频率检测器。第一回路元件组耦接于第一充电泵与压控振荡器间。第二回路元件组耦接于第二充电泵与压控振荡器间。除频器耦接于相位频率检测器与压控振荡器间。第一回路元件组产生一补偿电流,调整第一充电泵及第二充电泵的工作区间。第二回路元件组产生一补偿电流及一直流调整电压,以控制其输出至压控振荡器的控制电压。
- 回路电路
- [发明专利]多频段电子电路的设计方法与电路-CN200310122565.9无效
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吕学士;邱弘纬;李勃纬;杨育哲
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瀰工科技股份有限公司
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2003-12-12
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2005-06-15
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H04B1/40
- 本发明提出一种具有至少一晶体管的多频段电子电路(Multi-band electronic circuit)的设计方法与电路。所提议的方法包含下列步骤:(a)改变电路晶体管的输入端与输出端间电容值;以及(b)随改变的电容值获得电路的共振频率使在多频段间切换。一种包含至少一晶体管具一输入端且有一电感电连接到该输入端的多频段放大器(Multi-band amplifier)其设计方法与电路也被提出。该方法包含下列步骤:改变晶体管偏压;以及随改变的偏压切换晶体管输入阻抗与电感的共振频率使在多频段间切换。由于使用电流或电压或晶体管的输入端与输出端间电容值来切换频段,本发明相对于现有的技术,不需使用芯片外的电感及电容,且不用额外打线,有助于合格率及产量的提升。
- 频段电子电路设计方法电路
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