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[发明专利]硬件中的使用模数学的矩阵相乘-CN202080051872.4在审
发明人： 托马斯·马克·乌尔里希 -专利权人：元平台公司
申请日： 2020-07-17 - 公布日： 2022-03-01 - 主分类号： G06F17/16 文献下载
摘要：存储第一组取模结果矩阵，该第一组取模结果矩阵对应于由多个模数中的每一个对第一矩阵中的元素进行的取模。存储第二组取模结果矩阵，该第二组取模结果矩阵对应于由多个模数中的每一个对第二矩阵中的元素进行的取模。确定是否可以使用第一硬件乘法模块而不是第二硬件乘法模块来执行第一矩阵与第二矩阵的相乘的元素运算。响应于确定可以使用第一硬件乘法模块执行元素运算，使用第一硬件乘法模块执行元素运算，包括通过将来自第一组取模结果矩阵的一个或更多个对应元素与来自第二组取模结果矩阵的一个或更多个对应元素相乘。
硬件中的使用数学矩阵相乘

[发明专利]使用低位宽点积引擎对高位宽数求和-CN202110494255.8在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;伊赫桑·基什阿德斯坦尼扎德;托马斯·马克·乌尔里希 -专利权人：脸谱公司
申请日： 2021-05-07 - 公布日： 2021-11-09 - 主分类号： G06F17/16 文献下载
摘要：本申请涉及使用低位宽点积引擎来对高位宽数字求和。一种设备(例如，集成电路芯片)包括点积处理组件、数据对齐组件和累加器。点积处理组件被配置为计算第一组元素与第二组元素的点积，该第一组元素存储在第一存储单元中，其中：使用第一数量的位来表示第一组元素中的每个元素，使用大于第一数量的位的第二数量的位来表示存储在第一存储单元中的一组值中的每个值，并且该组值中的每个值被存储为跨越第一组元素的元素中的多于一个元素的分割段。数据对齐组件被配置成接收点积处理组件的结果，并修改点积处理组件的结果中的一个或更多个。累加器被配置为对数据对齐组件的输出求和，以至少部分地确定该组值的和。
使用低位宽点积引擎高位求和

[发明专利]用于对矩阵值灵活求和的设备和方法-CN202110494768.9在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;伊赫桑·基什阿德斯坦尼扎德;托马斯·马克·乌尔里希 -专利权人：脸谱公司
申请日： 2021-05-07 - 公布日： 2021-11-09 - 主分类号： G06F17/16 文献下载
摘要：本申请涉及用于对矩阵值灵活求和的设备和方法。一种设备(例如，专用集成电路芯片)包括矩阵转置组件、矩阵处理组件、数据对齐组件和数据缩减组件。矩阵转置组件被配置为转置元素的输入矩阵以输出已经转置的元素的输出矩阵。矩阵处理组件被配置为将第一乘法输入矩阵与第二乘法输入矩阵相乘，其中矩阵转置组件的输出矩阵被用作第一乘法输入矩阵，并且掩码向量被用作第二乘法输入矩阵。数据对齐组件被配置成修改矩阵处理组件的结果的元素的至少一部分。数据缩减组件被配置为至少对矩阵处理组件的经修改结果的元素求和，以确定一组值的和。
用于矩阵灵活求和设备方法

[发明专利]旁路硬件乘法器中的零值乘法-CN202110496149.3在审
发明人：阿卜杜勒卡迪尔·乌特库·迪里尔;托马斯·马克·乌尔里希;汪钊 -专利权人：脸谱公司
申请日： 2021-05-07 - 公布日： 2021-11-09 - 主分类号： G06F17/16 文献下载
摘要：本申请涉及旁路硬件乘法器中的零值乘法。一种设备(例如，集成电路芯片)包括第一操作数寄存器、第二操作数寄存器、乘法单元和硬件逻辑组件。第一操作数寄存器被配置为存储第一操作数值。第二操作数寄存器被配置为存储第二操作数值。乘法单元被配置为至少将第一操作数值与第二操作数值相乘。硬件逻辑组件被配置为检测是否提供了零值，并且响应于检测到提供了零值，使得至少第一操作数寄存器的更新被禁用，并且使得第一操作数值与第二操作数值的相乘结果是零值结果。
旁路硬件乘法器中的乘法

[发明专利]用分布流水线可分离卷积运算将卷积映射到相连处理元件-CN202110429712.5在审
发明人：阿卜杜勒卡迪尔·乌特库·迪里尔;克里希纳库马尔·纳拉亚南·奈尔;阿努普·拉梅什·卡德科尔;伊赫桑·基什阿德斯坦尼扎德;郝宇辰;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利;阿敏·费鲁沙希安;马丁·沙茨;奥利维亚·吴 -专利权人：脸谱公司
申请日： 2021-04-21 - 公布日： 2021-10-22 - 主分类号： G06F17/15 文献下载
摘要：公开了使用分布式流水线式可分离卷积运算将卷积映射到相连的处理元件。一种处理器系统包括多个点积处理器单元和逐元素乘法单元。点积处理器单元为每个数据矩阵通道执行数据矩阵与单独的逐深度卷积权重矩阵的逐深度卷积。每个点积处理器单元为一个或更多个数据矩阵通道执行至少一部分逐深度卷积。逐元素乘法单元执行逐点卷积的乘法运算。每个逐元素乘法单元向从点积处理器单元中的一个或更多个接收的每个逐深度卷积部分结果元素应用来自多个逐点卷积权重滤波器的每一个的相应数据元素，以确定逐元素乘法单元结果。处理器系统将来自逐元素乘法单元结果的数据元素的不同组相加在一起，以至少部分地计算逐点卷积结果的不同数据元素。
分布流水线可分离卷积运算映射相连处理元件

[发明专利]使用点对点连接的通道卷积引擎的分组卷积-CN202110378534.8在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;阿卜杜勒卡迪尔·乌特库·迪里尔;阿努普·拉梅什·卡德科尔;伊赫桑·基什阿德斯坦尼扎德;奥利维亚·吴;郝宇辰;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利;阿敏·费鲁沙希安;马丁·沙茨 -专利权人：脸谱公司
申请日： 2021-04-08 - 公布日： 2021-10-12 - 主分类号： G06N3/063 文献下载
摘要：本申请公开了使用点对点连接的通道卷积引擎的分组卷积。处理器系统包括多个处理元件。每个处理元件包括被配置成执行逐组卷积的一部分的相应的卷积处理器单元。相应的卷积处理器单元通过将卷积数据矩阵中的一部分数据元素中的每个数据元素与相应的逐组卷积权重矩阵中的相应数据元素相乘来确定相乘结果。卷积数据矩阵中被相乘的该部分数据元素属于不同的通道和不同的组。对于不同通道的每个特定通道，相应的卷积处理器单元将相乘结果中属于同一特定通道的至少一些相乘结果合计在一起，以确定相应通道卷积结果数据元素。处理元件将来自一组不同卷积处理器单元的通道卷积结果数据元素的一部分合计在一起，以确定逐组卷积结果数据元素。
使用点对点连接通道卷积引擎分组

[发明专利]使用每通道卷积运算的流水线逐点卷积-CN202110310532.5在审
发明人：阿卜杜勒卡迪尔·乌特库·迪里尔;克里希纳库马尔·纳拉亚南·奈尔;阿努普·拉梅什·卡德科尔;伊赫桑·基什阿德斯坦尼扎德;奥利维亚·吴;郝宇辰;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利;阿敏·费鲁沙希安;马丁·沙茨 -专利权人：脸谱公司
申请日： 2021-03-23 - 公布日： 2021-09-24 - 主分类号： G06N3/04 文献下载
摘要：公开了使用每通道卷积运算的流水线逐点卷积。一种处理器系统包括硬件通道卷积处理器单元和点积处理器单元。通道卷积处理器单元被配置为执行逐深度卷积，包括通过将卷积数据矩阵的第一组数据元素的每个数据元素与多个逐深度卷积权重矩阵的第二组数据元素的对应数据元素相乘，并且对于每个特定通道，将对应于特定通道的相乘结果相加在一起，以确定对应通道卷积结果矩阵中的一个对应结果数据元素，从而计算逐深度卷积结果的一部分。点积处理器单元被配置为执行逐点卷积，包括将逐点权重矩阵应用于逐深度卷积结果的一部分，以确定可分离卷积结果的一部分，同时处理器系统正在计算逐深度卷积结果的至少另一部分。
使用通道卷积运算流水线

[发明专利]将卷积映射到通道卷积引擎-CN202110190104.3在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;拉凯什·科姆拉韦利;阿卜杜勒卡迪尔·乌特库·迪里尔;伊赫桑·基什阿德斯坦尼扎德;郝宇辰;马丁·沙茨;托马斯·马克·乌尔里希;奥利维亚·吴;阿努普·拉梅什·卡德科尔;阿敏·费鲁沙希安 -专利权人：脸谱公司
申请日： 2021-02-18 - 公布日： 2021-09-03 - 主分类号： G06N3/04 文献下载
摘要：本申请涉及将卷积映射到通道卷积引擎。一种处理器系统包括第一组寄存器和第二组寄存器以及硬件通道卷积处理器单元。第一组寄存器被配置为存储卷积数据矩阵的一部分的通道的数据元素。每个寄存器存储来自每个通道的至少一个数据元素。第二组寄存器被配置为存储卷积权重矩阵的数据元素，该卷积权重矩阵包括每个通道的独立卷积权重矩阵。每个寄存器存储来自每个卷积权重矩阵的至少一个数据元素。硬件通道卷积处理器单元被配置为将第一组寄存器中的每个数据元素与第二组寄存器中的对应数据元素相乘，并将每个特定通道的相乘结果相加在一起，以确定对应通道卷积结果矩阵中的对应通道卷积结果数据元素。
卷积映射通道引擎

[发明专利]将卷积映射到分区通道卷积引擎-CN202110226681.3在审
发明人：阿卜杜勒卡迪尔·乌特库·迪里尔;克里希纳库马尔·纳拉亚南·奈尔;阿努普·拉梅什·卡德科尔;伊赫桑·基什阿德斯坦尼扎德;奥利维亚·吴;郝宇辰;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利;阿敏·费鲁沙希安;马丁·沙茨 -专利权人：脸谱公司
申请日： 2021-03-01 - 公布日： 2021-08-31 - 主分类号： G06N3/04 文献下载
摘要：本申请涉及将卷积映射到分区通道卷积引擎。一种处理器系统包括两组寄存器和一个硬件通道卷积处理器单元。第一组寄存器被配置成存储卷积数据矩阵的一部分的通道的数据元素。每个寄存器存储来自每个通道的至少一个数据元素。第二组寄存器被配置成存储卷积权重矩阵的数据元素，该卷积权重矩阵包括每个通道的单独的矩阵。每个寄存器存储来自每个矩阵的至少一个数据元素。硬件通道卷积处理器单元被配置成将第一组寄存器的第一部分和第二部分中的每个数据元素与第二组寄存器中的对应数据元素相乘，以确定对应的相乘结果，并且将每个特定通道的相乘结果相加在一起，以确定对应通道卷积结果矩阵中两个对应的通道卷积结果数据元素。
卷积映射分区通道引擎

[发明专利]用于多种格式的浮点运算的硬件-CN202110195149.X在审
发明人：阿卜杜勒卡迪尔·乌特库·迪里尔;克里希纳库马尔·纳拉亚南·奈尔;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利;汪钊 -专利权人：脸谱公司
申请日： 2021-02-19 - 公布日： 2021-08-20 - 主分类号： G06F7/57 文献下载
摘要：本申请公开了用于多种格式的浮点运算的硬件。第一格式表示的浮点数被接收。基于浮点数的浮点格式类型的标识，识别第一格式表示的不同组成部分。第一格式表示的不同组成部分被放置在浮点数的第二格式表示的相应组成部分中，其中，第二格式表示的总位数大于第一格式表示的总位数。用一个或更多个零位填充第二格式表示的至少一个组成部分。第二格式表示的浮点数被存储在寄存器中。使用浮点数的第二格式表示的乘法被执行。
用于多种格式浮点运算硬件

[发明专利]使用处理器指令的硬件加速矩阵操纵运算-CN202011449371.X在审
发明人： 托马斯·马克·乌尔里希;克里希纳库马尔·纳拉亚南·奈尔;郝宇辰 -专利权人：脸谱公司
申请日： 2020-12-09 - 公布日： 2021-06-25 - 主分类号： G06F9/30 文献下载
摘要：公开了使用处理器指令的硬件加速矩阵操纵运算。一种处理器系统包括共享存储器和处理元件。处理元件包括矩阵处理器单元，并与共享存储器通信。处理元件被配置成接收指定数据矩阵和矩阵操纵运算的处理器指令。识别基于处理器指令的操纵矩阵。数据矩阵和操纵矩阵被加载到矩阵处理器单元中，并且执行矩阵运算以确定结果矩阵。结果矩阵被输出到目的地位置。
使用处理器指令硬件加速矩阵操纵运算

[发明专利]通过选择加法器树中间结果支持不同的矩阵乘法-CN202011133658.1在审
发明人：郝宇辰;克里希纳库马尔·纳拉亚南·奈尔;伊赫桑·基什·阿德斯坦尼·扎德;拉凯什·科姆拉韦利;阿卜杜勒卡迪尔·乌特库·迪里尔;托马斯·马克·乌尔里希 -专利权人：脸谱公司
申请日： 2020-10-21 - 公布日： 2021-05-04 - 主分类号： G06F17/16 文献下载
摘要：公开了通过选择加法器树中间结果支持不同的矩阵乘法。使用属于矩阵乘法硬件单元的多个乘法器将第一组元素与第二组元素逐元素相乘。使用属于矩阵乘法硬件单元的分层加法器树将多个乘法器的结果相加在一起，并且选择性地提供分层加法器树的最终结果或分层加法器树的多个中间结果中的任何一个，用于确定输出结果矩阵。控制单元用于指示矩阵乘法硬件单元通过使用包括多个不同操作数矩阵的元素的组合矩阵来并行执行多个不同的矩阵乘法，并利用分层加法器树的中间结果中的一个或更多个选定的中间结果来用于确定输出结果矩阵，该输出结果矩阵包括表示对应于不同操作数矩阵中的不同操作数矩阵的不同乘法结果的不同元素组。
通过选择加法器中间结果支持不同矩阵乘法

[发明专利]支持同时处理多个矩阵的高吞吐量矩阵处理器-CN202011182408.7在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;奥利维亚·吴;伊赫桑·基什·阿德斯坦尼·扎德;阿卜杜勒卡迪尔·乌特库·迪里尔;托马斯·马克·乌尔里希;郝宇辰;拉凯什·科姆拉韦利;阿拉温德·卡莱阿 -专利权人：脸谱公司
申请日： 2020-10-29 - 公布日： 2021-05-04 - 主分类号： G06F9/30 文献下载
摘要：公开了支持同时处理多个矩阵的高吞吐量矩阵处理器。一种系统包括数据输入向量单元、权重输入向量单元和矩阵处理器单元的多个计算单元。数据输入向量单元被配置为同时接收第一数据矩阵和第二数据矩阵的不同行的元素。权重输入向量单元被配置成接收组合权重向量，并且至少部分地同时向相应的第一组计算单元和第二组计算单元提供第一权重矩阵和第二权重矩阵的获得的权重元素。第一组计算单元和第二组计算单元中的每个计算单元被配置为将来自数据输入向量单元的元素与来自权重输入向量单元的相应权重矩阵的元素相乘，并将相应计算单元的相乘结果相加在一起，以至少部分地确定第一或第二卷积结果矩阵中的相应元素。
支持同时处理矩阵吞吐量处理器

[发明专利]使用分解的分量数字的浮点乘法硬件-CN202011073214.3在审
发明人：克里希纳库马尔·纳拉亚南·奈尔;阿努普·拉梅什·卡德科尔;伊赫桑·基什·阿德斯坦尼·扎德;奥利维亚·吴;郝宇辰;托马斯·马克·乌尔里希;拉凯什·科姆拉韦利 -专利权人：脸谱公司
申请日： 2020-10-09 - 公布日： 2021-04-02 - 主分类号： G06F7/487 文献下载
摘要：本申请涉及使用分解的分量数字的浮点乘法硬件。一种处理器系统包括一个或更多个逻辑单元，该逻辑单元被配置为接收识别将与第二浮点数相乘的第一浮点数的处理器指令。浮点数各自被分解成一组多个分量数字，其中用于表示每个浮点数的位数大于用于表示每组多个分量数字中的任何分量数字的位数。第一组的分量数字与第二组的分量数字相乘以确定中间乘法结果，将这些中间乘法结果相加在一起以确定表示第一浮点数与第二浮点数相乘的结果的有效结果。
使用分解分量数字浮点乘法硬件

[发明专利]数论变换硬件-CN202010942882.9在审
发明人： 托马斯·马克·乌尔里希 -专利权人：脸谱公司
申请日： 2020-09-09 - 公布日： 2021-03-09 - 主分类号： G06N3/063 文献下载
摘要：本申请涉及数论变换硬件。正数论变换专用硬件单元被配置为计算输入向量的数论变换，其中由正数论变换专用硬件单元执行的数论变换的单位根是二的幂。正数论变换专用硬件单元包括数据路由路径、多个硬件二进制位移位器和多个加法器。
数论变换硬件

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