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[发明专利]具有本地分别同步的内存模块-CN201910718977.X有效
发明人：李铉;雅耶斯·R·巴克塔 -专利权人： 奈特力斯股份有限公司
申请日： 2014-07-28 - 公布日： 2023-09-22 - 主分类号： G11C5/04 文献下载
摘要：一种在具有内存控制器的内存系统中运行的内存模块。该内存模块包括用于接收从内存控制器来的命令信号和输出模块C/A信号和数据缓存控制信号。向组织成组的内存设备提供模块C/A信号，每组包括至少一个内存设备，然而向多个缓存电路提供数据缓存控制信号以控制缓存电路中的数据，每个缓存电路对应一个相应组的内存设备。多个缓存电路分布于该内存模块的一个表面，从而每个数据缓存控制信号在不同时间点达到多个缓存电路。该多个缓存电路包括时钟重新生成电路来重新生成模块控制设备收到的时钟信号和提供重新生成的时钟信号给相应组的内存设备。
具有本地分别同步内存模块

[发明专利]计算机存储器扩展设备及其操作方法-CN202180059852.6在审
发明人：乔丹·霍里奇;杰瑞·阿尔斯通;陈志泽;帕特里克·李;斯科特·米尔顿;朴继荣 -专利权人： 奈特力斯股份有限公司
申请日： 2021-06-01 - 公布日： 2023-05-16 - 主分类号： G06T1/60 文献下载
摘要：一种与主机计算机系统一起操作的存储器扩展设备包括非易失性存储器(NVM)子系统、高速缓冲存储器和控制逻辑，该控制逻辑可被设置为从主机接收提交，该提交包括读取命令并指定该NVM子系统中的有效载荷和该有效载荷中的需求数据。该控制逻辑被设置为请求与该有效载荷相对应的一组高速缓冲存储器线的所有权，在获取该一组高速缓冲存储器线的所有权之后指示该提交的完成，以及将该有效载荷加载到该高速缓冲存储器。该一组高速缓冲存储器线对应于相干存储器空间中的一组高速缓冲存储器线。该控制逻辑还被设置为在指示该提交的完成之后，以及响应于该主机读取该有效载荷的需求数据的请求，在确定该需求数据已经被加载到该高速缓冲存储器中之后，从该高速缓冲存储器返回该需求数据。
计算机存储器扩展设备及其操作方法

[发明专利]具有数据缓存功能的混合存储器模块、数据缓存器和方法-CN202111088557.1在审
发明人：朴继荣;乔丹·诺威奇 -专利权人： 奈特力斯股份有限公司
申请日： 2021-09-16 - 公布日： 2022-04-01 - 主分类号： G06F13/16 文献下载
摘要：本申请提供的一种可在计算机系统中操作的存储器模块、数据缓存器和方法。存储器模块包括易失性存储器子系统和耦合到易失性存储器子系统的模块控制器。易失性存储器子系统可用于耦合到包括数据总线的存储器通道，并且包括动态随机存取存储器(DRAM)设备。存储器模块允许独立地控制DRAM装置和数据总线之间的选通路径和数据路径，并且可用于执行存储器写入操作和存储器读取操作，在存储器写入操作期间，写入数据与经由DRAM装置和数据总线之间的第一选通路径传输的写入选通一起被提供给易失性存储器子系统，在存储器读取操作期间，来自易失性存储器子系统的读取数据与经由模块控制器和数据总线之间的第二选通路径传输的读取选通一起被输出到数据总线。
具有数据缓存功能混合存储器模块方法

[发明专利]存储器模块以及操作系统和方法-CN201680036145.4有效
发明人：炫·李 -专利权人： 奈特力斯股份有限公司
申请日： 2016-04-11 - 公布日： 2021-12-14 - 主分类号： G06F13/00 文献下载
摘要：一种存储器模块，包括：易失性存储器子系统，经配置耦接到计算机系统中的存储器信道并且能够用作计算机系统的主存储器；非易失性存储器子系统，为计算机系统提供存储；以及模块控制器，耦接到易失性存储器子系统、非易失性存储器子系统和存储器信道。模块控制器响应于经由存储器信道接收的NV访问请求从非易失性存储器子系统读取第一数据，并且从易失性存储器子系统读取第二数据，并且响应于经由C/A总线接收的虚拟写入存储器命令，使第一数据的至少一部分写入易失性存储器子系统中。模块控制装置包括由计算机系统经由存储器信道可访问的状态寄存器。
存储器模块以及操作系统方法

[发明专利]混合内存模块以及操作混合内存模块的系统和方法-CN202010083541.0在审
发明人：炫·李;杰斯·R·巴克达;池社·陈;杰弗里·C·所罗门;马里奥·杰西·马丁内斯;浩·乐;淑·J·蔡 -专利权人： 奈特力斯股份有限公司
申请日： 2014-11-07 - 公布日： 2020-06-19 - 主分类号： G06F3/06 文献下载
摘要：一种内存模块包括：易失性内存子系统，用于耦合到计算机系统中的内存通道且能够充当计算机系统的主内存；非易失性内存子系统，其为计算机系统提供存储装置；和模块控制器，其耦合到易失性内存子系统、非易失性内存子系统和C/A总线。模块控制器用于控制在易失性内存子系统和非易失性内存子系统之间的模块内数据传送。该模块控制器进一步用于监视C/A总线上的C/A信号，且根据C/A信号调度模块内数据传送，使得模块内数据传送不与内存控制器对易失性内存子系统的存取冲突。
混合内存模块以及操作系统方法

[发明专利]混合内存模块以及操作混合内存模块的系统和方法-CN202010083537.4在审
发明人：炫·李;杰斯·R·巴克达;池社·陈;杰弗里·C·所罗门;马里奥·杰西·马丁内斯;浩·乐;淑·J·蔡 -专利权人： 奈特力斯股份有限公司
申请日： 2014-11-07 - 公布日： 2020-06-12 - 主分类号： G06F11/10 文献下载
摘要：一种内存模块包括：易失性内存子系统，用于耦合到计算机系统中的内存通道且能够充当计算机系统的主内存；非易失性内存子系统，其为计算机系统提供存储装置；和模块控制器，其耦合到易失性内存子系统、非易失性内存子系统和C/A总线。模块控制器用于控制在易失性内存子系统和非易失性内存子系统之间的模块内数据传送。该模块控制器进一步用于监视C/A总线上的C/A信号，且根据C/A信号调度模块内数据传送，使得模块内数据传送不与内存控制器对易失性内存子系统的存取冲突。
混合内存模块以及操作系统方法

[发明专利]混合内存模块以及操作混合内存模块的系统和方法-CN202010083536.X在审
发明人：炫·李;杰斯·R·巴克达;池社·陈;杰弗里·C·所罗门;马里奥·杰西·马丁内斯;浩·乐;淑·J·蔡 -专利权人： 奈特力斯股份有限公司
申请日： 2014-11-07 - 公布日： 2020-05-29 - 主分类号： G06F3/06 文献下载
摘要：一种内存模块包括：易失性内存子系统，用于耦合到计算机系统中的内存通道且能够充当计算机系统的主内存；非易失性内存子系统，其为计算机系统提供存储装置；和模块控制器，其耦合到易失性内存子系统、非易失性内存子系统和C/A总线。模块控制器用于控制在易失性内存子系统和非易失性内存子系统之间的模块内数据传送。该模块控制器进一步用于监视C/A总线上的C/A信号，且根据C/A信号调度模块内数据传送，使得模块内数据传送不与内存控制器对易失性内存子系统的存取冲突。
混合内存模块以及操作系统方法

[发明专利]混合内存模块以及操作混合内存模块的系统和方法-CN202010083535.5在审
发明人：炫·李;杰斯·R·巴克达;池社·陈;杰弗里·C·所罗门;马里奥·杰西·马丁内斯;浩·乐;淑·J·蔡 -专利权人： 奈特力斯股份有限公司
申请日： 2014-11-07 - 公布日： 2020-05-19 - 主分类号： G06F3/06 文献下载
摘要：一种内存模块包括：易失性内存子系统，用于耦合到计算机系统中的内存通道且能够充当计算机系统的主内存；非易失性内存子系统，其为计算机系统提供存储装置；和模块控制器，其耦合到易失性内存子系统、非易失性内存子系统和C/A总线。模块控制器用于控制在易失性内存子系统和非易失性内存子系统之间的模块内数据传送。该模块控制器进一步用于监视C/A总线上的C/A信号，且根据C/A信号调度模块内数据传送，使得模块内数据传送不与内存控制器对易失性内存子系统的存取冲突。
混合内存模块以及操作系统方法

[发明专利]混合内存模块以及操作混合内存模块的系统和方法-CN201480060643.3有效
发明人：炫·李;杰斯·R·巴克达;池社·陈;杰弗里·C·所罗门;马里奥·杰西·马丁内斯;浩·乐;淑·J·蔡 -专利权人： 奈特力斯股份有限公司
申请日： 2014-11-07 - 公布日： 2020-03-06 - 主分类号： G06F12/00 文献下载
摘要：一种内存模块包括：易失性内存子系统，用于耦合到计算机系统中的内存通道且能够充当计算机系统的主内存；非易失性内存子系统，其为计算机系统提供存储装置；和模块控制器，其耦合到易失性内存子系统、非易失性内存子系统和C/A总线。模块控制器用于控制在易失性内存子系统和非易失性内存子系统之间的模块内数据传送。该模块控制器进一步用于监视C/A总线上的C/A信号，且根据C/A信号调度模块内数据传送，使得模块内数据传送不与内存控制器对易失性内存子系统的存取冲突。
混合内存模块以及操作系统方法

[发明专利]具有本地分别同步的内存模块-CN201480053599.3有效
发明人：李铉;雅耶斯·R·巴克塔 -专利权人： 奈特力斯股份有限公司
申请日： 2014-07-28 - 公布日： 2019-08-27 - 主分类号： G06F12/02 文献下载
摘要：一种在具有内存控制器的内存系统中运行的内存模块。该内存模块包括用于接收从内存控制器来的命令信号和输出模块C/A信号和数据缓存控制信号。向组织成组的内存设备提供模块C/A信号，每组包括至少一个内存设备，然而向多个缓存电路提供数据缓存控制信号以控制缓存电路中的数据，每个缓存电路对应一个相应组的内存设备。多个缓存电路分布于该内存模块的一个表面，从而每个数据缓存控制信号在不同时间点达到多个缓存电路。该多个缓存电路包括时钟重新生成电路来重新生成模块控制设备收到的时钟信号和提供重新生成的时钟信号给相应组的内存设备。
具有本地分别同步内存模块

[发明专利]利用存储模块上的分布式字节缓冲器的系统和方法-CN201510483986.7有效
发明人：李铉;雅耶斯·R·巴克塔 -专利权人： 奈特力斯股份有限公司
申请日： 2010-07-01 - 公布日： 2018-02-06 - 主分类号： G11C5/02 文献下载
摘要：本发明提供一种使用一个或多个存储模块的存储系统和方法。存储模块(400)包括多个存储装置(412)以及一个控制器(430)，所述控制器(430)经配置以从系统存储控制器(420)接收控制信息(440)，并产生模块控制信号(442)。所述存储模块进一步包括多个电路，例如字节缓冲器(416)，所述电路经配置以选择性地将所述多个存储装置与所述系统控制器隔离。所述电路可响应于所述模块控制信号而运行，以便将写入数据从所述系统存储控制器驱动到所述多个存储装置，并将来自所述多个存储装置的读出数据合并到所述系统存储控制器中。所述电路分布在彼此隔开的对应位置上。
利用存储模块分布式字节缓冲器系统方法

[发明专利]利用存储模块上的分布式字节缓冲器的系统和方法-CN201080039043.0有效
发明人：李铉;雅耶斯·R·巴克塔 -专利权人： 奈特力斯股份有限公司
申请日： 2010-07-01 - 公布日： 2012-07-11 - 主分类号： G11C5/02 文献下载
摘要：本发明提供一种使用一个或多个存储模块的存储系统和方法。存储模块(400)包括多个存储装置(412)以及一个控制器(430)，所述控制器(430)经配置以从系统存储控制器(420)接收控制信息(440)，并产生模块控制信号(442)。所述存储模块进一步包括多个电路，例如字节缓冲器(416)，所述电路经配置以选择性地将所述多个存储装置与所述系统控制器隔离。所述电路可响应于所述模块控制信号而运行，以便将写入数据从所述系统存储控制器驱动到所述多个存储装置，并将来自所述多个存储装置的读出数据合并到所述系统存储控制器中。所述电路分布在彼此隔开的对应位置上。
利用存储模块分布式字节缓冲器系统方法

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