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[发明专利]具有接口的半导体器件及半导体器件的接口管理方法-CN202011402870.3在审
发明人：毅格艾尔卡诺维奇;阿姆农帕纳斯;喻珮;叶力垦;方勇胜;林圣伟;黄智强;谭竞豪;陈卿芳 -专利权人：创意电子股份有限公司;台湾积体电路制造股份有限公司
申请日： 2020-12-04 - 公布日： 2022-04-12 - 主分类号： H01L25/18 文献下载
摘要：本发明提供一种具有接口的半导体器件及半导体器件的接口管理方法，所述具有接口的半导体器件包括主器件以及多个从器件。主器件包括主接口。从器件一个接一个地在主器件上堆叠成三维堆叠。从器件中的每一者包括从接口及管理电路，主接口及从接口形成用于在主器件与从器件之间传递通信信号的接口。从器件中的当前一个从器件的管理电路驱动从器件中的下一个从器件。在从器件中的所述当前一个从器件处接收的操作命令仅通过接口被传递到从器件中的所述下一个从器件。来自从器件中的所述当前一个从器件的回应通过接口被传递回主器件。
具有接口半导体器件管理方法

[发明专利]用于三维半导体器件的数据保护系统及其方法-CN202011406828.9在审
发明人：毅格艾尔卡诺维奇;阿姆农帕纳斯;喻珮;叶力垦;方勇胜;林圣伟;黄智强;谭竞豪;陈卿芳 -专利权人：创意电子股份有限公司;台湾积体电路制造股份有限公司
申请日： 2020-12-04 - 公布日： 2022-04-12 - 主分类号： G11C5/02 文献下载
摘要：公开一种用于处置错误命令的数据保护系统及数据保护方法。数据保护系统包括主器件以及从器件。主器件被配置成发送命令。从器件耦合到主器件。从器件被配置成从主器件接收命令。主器件包括主接口。从器件包括从接口。主接口与从接口通过一个或多个结合件和/或硅穿孔进行电连接且被配置成在主器件与从器件之间进行接口功能。错误命令代表具有奇偶性错误或其他错误的命令。从器件还被配置成接收错误命令且根据读取操作或写入操作对错误命令作出响应。
用于三维半导体器件数据保护系统及其方法

[发明专利]用于三维半导体器件的接口器件及接口方法-CN202011347869.5在审
发明人：毅格艾尔卡诺维奇;阿姆农帕纳斯;喻珮;叶力垦;方勇胜;林圣伟;黄智强;谭竞豪;陈卿芳 -专利权人：创意电子股份有限公司;台湾积体电路制造股份有限公司
申请日： 2020-11-26 - 公布日： 2022-04-12 - 主分类号： G06F13/40 文献下载
摘要：本发明提供一种用于三维半导体器件的在主器件与从器件之间进行接口的接口器件及接口方法。主器件产生命令且从器件根据命令产生数据。接口器件包括主接口以及从接口。主接口耦合到主器件且被配置成将命令发送到从器件和/或从从器件接收数据。从接口耦合到从器件且被配置成从主器件接收命令和/或将数据发送到主器件。主接口及从接口由时钟产生器产生的时钟驱动。主接口与从接口由一个或多个结合件和/或硅穿孔进行电连接。
用于三维半导体器件接口器件方法

[发明专利]半导体器件的接口及用于排列结合半导体器件的接口方法-CN202011344794.5在审
发明人：毅格艾尔卡诺维奇;阿姆农帕纳斯;喻珮;叶力垦;方勇胜;林圣伟;黄智强;谭竞豪;陈卿芳 -专利权人：创意电子股份有限公司;台湾积体电路制造股份有限公司
申请日： 2020-11-25 - 公布日： 2022-04-12 - 主分类号： G06F15/78 文献下载
摘要：本发明提供一种半导体器件的接口及用于排列结合半导体器件的接口方法。半导体器件的接口包括主器件及多个从器件。所述接口包括主接口及从接口。主接口实施在主器件中且包括由被排列成第一阵列的主结合件形成的主结合件图案。从接口实施在每一个从器件中且包括由被排列成第二阵列的从结合件形成的从结合件图案。主结合件的第一阵列包括第一中心行及分成两部分的第一组数据行，所述两部分相对于第一中心行完全对称。从结合件的第二阵列包括第二中心行及分成两部分的第二组数据行，所述两部分相对于第二中心行完全对称。第一中心行与第二中心行在芯片结合连接中对齐，且第一组数据行连接到第二组数据行。
半导体器件接口用于排列结合方法

[发明专利]用于半导体器件的接口和其接口方法-CN202011089344.6在审
发明人：毅格艾尔卡诺维奇;阿姆农帕纳斯;喻珮;叶力垦;方勇胜;林圣伟;黄智强;谭竞豪;陈卿芳 -专利权人：创意电子股份有限公司;台湾积体电路制造股份有限公司
申请日： 2020-10-13 - 公布日： 2022-02-22 - 主分类号： H01L23/538 文献下载
摘要：本发明公开一种用于半导体器件的接口和其接口方法。半导体器件具有用导电连接并堆叠在一起的单个主器件和多个从器件。接口包含主接口，主接口建造于主器件中且包含具有主连接垫矩阵的主接口电路。另外，从接口实施于每一从器件中且包含从接口电路，从接口电路具有从连接垫矩阵以对应地连接到主连接垫矩阵。时钟布线将通过主接口和从接口传送时钟信号。主器件通过主接口将指令和从识别码传送到所有从接口。对应于从识别码的从器件将执行指令的结果通过从接口和主接口向主器件回应。
用于半导体器件接口方法

[发明专利]使用考虑不同电路拓扑结构生成的输入波形特征化单元的方法和系统-CN201410507469.4有效
发明人： 谭竞豪;陈彦宾;陈文豪;王中兴 -专利权人：台湾积体电路制造股份有限公司
申请日： 2014-09-28 - 公布日： 2018-04-17 - 主分类号： G06F17/50 文献下载
摘要：本发明提供了一种使用考虑不同电路拓扑结构生成的输入波形特征化单元。在一些实施例中，在通过至少一个处理器所执行的方法中，考虑驱动单元的前级驱动器的不同电路拓扑结构以得到相同输入转换特性，通过至少一个处理器关于输入转换特性来特征化单元。
使用考虑不同电路拓扑结构生成输入波形特征单元方法系统

[发明专利]具有共享PODE的标准集成电路单元的泄漏预估的系统和方法-CN201410411479.8有效
发明人： 谭竞豪;张业琦;杨国男;江哲维;王中兴 -专利权人：台湾积体电路制造股份有限公司
申请日： 2014-08-20 - 公布日： 2018-02-13 - 主分类号： G06F17/50 文献下载
摘要：本发明涉及用于具有共享PODE的标准集成电路单元的泄漏预估的系统和方法。本发明的制造使用具有共享的氧化物限定区边缘上多晶硅(PODE)的邻接单元的集成电路的系统和方法，包括在多个不同单元中模拟单元间漏电流。多个不同单元的每一个邻接另一个单元，并且具有共享的PODE。方法还包括基于单元间漏电流来验证集成电路的预定可接受的功耗。
具有共享 pode 标准集成电路单元泄漏预估系统方法

[发明专利]具有不同阈值电压的单元布局方法、实现系统和形成布局-CN201310656513.3有效
发明人：叶松艳;张业琦;陈彦宾;江哲维;谭竞豪;侯元德;王中兴 -专利权人：台湾积体电路制造股份有限公司
申请日： 2013-12-05 - 公布日： 2017-08-08 - 主分类号： G06F17/50 文献下载
摘要：一种方法包括开发电路原理图，该电路原理图包括多个单元。该方法还包括基于电路原理图生成多个单元的单元布置规则和基于单元布置规则开发多个单元的电路布局图。该方法还包括基于阈值电压对电路布局图的多个单元进行分组和将阈值电压一致的填充物插入电路布局图内。本发明还描述了实施该方法的系统。本发明还描述了通过该方法形成的布局。本发明还提供了形成具有不同阈值电压的单元的布局的方法、实现系统和形成的布局。
形成具有不同阈值电压单元布局方法实现系统

[发明专利]布局修改方法及系统-CN201310218309.3有效
发明人：李孟祥;许力中;杨士贤;余和哲;谭竞豪;王中兴 -专利权人：台湾积体电路制造股份有限公司
申请日： 2013-06-04 - 公布日： 2014-02-26 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种方法，该方法包括：提供存储先前下线的集成电路(IC)布局的至少一部分的局部网表的非易失性机器可读存储介质，该局部网表代表用于制造具有使IC满足第一规格值的IC布局的IC的光掩模组。计算机识别IC布局中多个第一器件的固有子器件，使得由第二器件代替第一器件的固有子器件在修改后的IC布局中满足不同于第一规格值的第二规格值。生成至少一个布局掩模，并且将该至少一个布局掩模存储在可被用于形成至少一个附加光掩模的工具访问的至少一个非易失性机器可读存储介质中，使得将光掩模组和至少一个附加掩模用于根据修改后的IC布局制造IC。本发明还提供了布局修改方法及系统。
布局修改方法系统

[发明专利]用于电迁移容忍电源分配的自动置放和布线方法-CN201210205918.0有效
发明人：王中兴;谭竞豪;陳皇宇 -专利权人：台湾积体电路制造股份有限公司
申请日： 2012-06-18 - 公布日： 2013-06-26 - 主分类号： G06F17/50 文献下载
摘要：本发明涉及采用自动置放和布线（APR）方法生成的容忍电迁移的电源分配网络。在一些实施方式中，自动置放和布线工具构造了具有多层电源导轨的局部电源网。所述多层电源导轨具有垂直相邻金属层的交错段，其中每个交错段的长度比相当于Blech长度的预定特征长度短。通过限制所述交错金属段的长度，减轻了多层电源导轨内的电迁移，从而提高了用于平均无故障时间（MTTF）的最大电流密度（Jmax）。本发明还公开了用于电迁移容忍电源分配的自动置放和布线方法。
用于迁移容忍电源分配自动置放布线方法

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