专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种释抑时间的实时自动调节方法-CN201710446140.5有效
  • 张沁川;谭峰;潘卉青;曾浩;郑罗楠 - 电子科技大学
  • 2017-06-14 - 2019-05-28 - G01R13/02
  • 本发明公开了一种释抑时间的实时自动调节方法,通过对迭代调整释抑时间,并测量系统触发信号的周期,然后根据周期序列的统计特性,取均值对应的最大样本数,并判断周期变化即2σ/Pop(μ)或|Cmax‑Cmin|/Pop(μ)是否大于设定阈值,若大于,则设定释抑时间等于周期序列的最大值(或最小值、均值),重新进行测量判断,直到小于设定的阈值,这样实现了减少人工调节的复杂性和缓慢性,快速在数字存储示波器上呈现出复杂信号的稳定波形,使得数字存储示波器的触发调节更为方便。
  • 一种时间实时自动调节方法
  • [发明专利]具有多器件同步复位识别校正功能的多通道并行采集系统-CN201610852029.1有效
  • 黄武煌;邱渡裕;蒋俊;谭峰;郭连平;赵勇;袁渊 - 电子科技大学
  • 2016-09-27 - 2019-01-25 - H03M1/10
  • 本发明公开了一种具有多器件同步复位识别校正功能的多通道并行采集系统,在多通道并行采集系统的N个ADC和FPGA模块中,第1个FPGA模块根据系统复位起始命令发出复位信号完成ADC和DCM的复位操作,产生稳定的FPGA内部的数据工作时钟CCLK1;第2至第N个FPGA模块分别包含一个同步识别模块和复位控制模块,同步识别模块对上一个FPGA模块的数据工作时钟的延迟值进行调整,采用解串器和序列检测模块对本FPGA与上一个FPGA的数据工作时钟进行同步识别,将同步时的延迟值作为时间间隔,然后根据时间间隔调整复位信号到对应ADC和时钟管理单元的延迟值,从而完成多器件同步复位识别校正。采用本发明可以保证复位的准确性,从而使每次同步复位后多通道数据工作时钟的相位关系是确定的。
  • 具有器件同步复位识别校正功能通道并行采集系统
  • [发明专利]基于链表数组的多幅波形包络提取方法-CN201611161528.2有效
  • 张沁川;郭连平;谭峰;潘卉青;焦晓曼 - 电子科技大学
  • 2016-12-15 - 2019-01-25 - G01R13/02
  • 本发明公开了一种基于链表数组的多幅波形包络提取方法,建立一个动态链表数组,数组长度和一副信号波形长度相同,数组中的数据元素均为链表表头节点,每一个链表中存储同一个采样位置的波形数据,每采集完一幅波形数据即更新数据链表;在每次更新数据时,如果链表长度达到用户设置的包络次数,则删除表头节点;如果最新数据与之前某个节点相同,则将这一旧节点删除,将最新数据添加至链表末尾节点,否则直接将最新数据添加至链表末尾节点;然后对链表进行数据老化处理,避免老旧数据滞留;依次扫描每个链表得到其最大值和最小值,即为对应采样点的包络数据。本发明通过将波形数据存储到动态链表型数组中,实现高精度的多幅波形包络数据提取。
  • 基于数组波形包络提取方法

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