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[发明专利]包括存储器矩阵的电路和位线噪声补偿的读取方法-CN200780011964.4无效
发明人： 维克托·M·G·范艾科特;尼古拉斯·兰伯特 -专利权人： NXP股份有限公司
申请日： 2007-03-27 - 公布日： 2009-04-22 - 主分类号： G11C7/14 文献下载
摘要：从具有多条位线(12)的存储器矩阵(10)读取数据。差分读出放大器(14)接收从第一输入端上的位线(12)中的第一位线获得的信号。差分读出放大器(14)接收从参考电路(15)的参考输出端到第二输入端的参考信号。将与位线(12)中的第一位线相邻的位线(12)中的第二位线与参考电路(15)耦合，使得位线(12)中的第二位线上的位线信号值影响参考输出端上的参考信号值，在位线(12)上的第一位线上的位线信号值上，至少部分地复制位线(12)的第二位线上的位线信号值(12)的串扰效应。
包括存储器矩阵电路噪声补偿读取方法

[发明专利]具有可块擦除单元的存储器-CN200680048689.9有效
发明人： 维克托·M·G·范艾科特;尼克·兰伯特 -专利权人： NXP股份有限公司
申请日： 2006-12-14 - 公布日： 2009-01-14 - 主分类号： G06F12/02 文献下载
摘要：一种包括多个存储单元的物理块的非易失主存储器(10)。在主存储器(10)中存储指向信息(112a-c，114a-c)，指向信息包括指向用于特定功能的使用块的指针(112a-c)，和指向空闲出用于特定功能将来的使用的空闲块的指针。空闲块将替代使用块中被选择的部分。之后，只有在使用空闲块中的至少两个作为替代之后，可以将指向信息的更新的版本写入主存储器。在启动时，至少使用指向空闲块的指针(114a-c)中的一个来存取空闲块中的至少一个，以决定是否已将存取的空闲块用作特定的一个使用块的替代。如果是，使用所述空闲块来代替特定的一个使用块。
具有擦除单元存储器

[发明专利]单阈值和单导电类型逻辑-CN200680034304.3有效
发明人： 维克托·M·G·范艾科特;尼古拉斯·兰伯特;安德烈·米希里特斯科伊;皮埃尔·H·沃尔里 -专利权人： NXP股份有限公司
申请日： 2006-09-14 - 公布日： 2008-09-17 - 主分类号： H03K19/017 文献下载
摘要：一种逻辑组件(400)，包括单阈值且单导电类型的电路元件，并包括具有至少一组开关的逻辑电路(410)，每一个开关具有主电流路径和控制端子。主电流路径形成具有与电源线耦合的第一和第二导电端子的串联配置。该主电流路径与形成逻辑组件(400)的输出的公共节点耦合。所述开关的控制端子与用于向所述控制端子提供彼此不重叠的时钟信号的时钟电路耦合。该逻辑组件还包括对所述逻辑组件(400)的输出升压的输出升压电路(420)，包括使得能够向所述逻辑组件(400)的输出供给额外的电荷的电容性装置(421)。还包括自举电路(422)，使得能够向所述电容性装置的第一端额外供给电荷，从而在所述电容性装置的第二端处产生提升的电压。
阈值导电类型逻辑

[发明专利]反熔丝存储装置-CN200680018002.7有效
发明人：保罗·范德斯勒伊斯;安德烈·米希里特斯科伊;皮埃尔·H·沃尔里;维克托·M·G·范艾科特;尼古拉斯·兰伯特 -专利权人： NXP股份有限公司
申请日： 2006-05-04 - 公布日： 2008-05-14 - 主分类号： G11C17/16 文献下载
摘要：一次可编程(OTP)存储器单元(10)包括涂敷有第二导电稳定过渡化合物(14)的第一金属层(12)，其间具有绝缘层(16)。根据第一和第二层之间的Gibbs自由能的差别来选择第一和第二层(12、14)，Gibbs自由能规定了作为两种材料的放热化学反应的结果产生的化学能。第一和第二层(12、14)的材料本身是高度热稳定的，但是，当向单元(10)施加电压时，绝缘层(16)的局部击穿产生引起第一和第二层(12、14)之间的放热化学反应的热点(18)。放热反应产生足够的热(20)以在单元两端产生短路，并且因此减小其阻抗。
反熔丝存储装置

[发明专利]包括产生装置和比较装置的系统-CN200680017851.0无效
发明人：汉斯·M·B·波依;特尼斯·J·伊金克;维克托·M·G·范艾科特 -专利权人： NXP股份有限公司
申请日： 2006-05-09 - 公布日： 2008-05-14 - 主分类号： G05D1/02 文献下载
摘要：系统(1)包括产生装置(2)，产生装置(2)包括用于产生代表产生装置(2)取向的传感器信号的传感器(21)，系统还包括比较装置(3)，比较装置(3)包括用于比较传感器信号和参考信号以解译取向的比较器(31)，从而增加可能的应用数目。产生装置(2)和比较装置(3)可以构成同一设备或不同设备的组成部分，并进行有线通讯或者通过无线电或红外线进行无线通讯。用于产生参考信号的参考传感器(33，52)和/或用于存储参考信号的参考存储器(34，53)可以位于比较装置(3)中和/或位于源(5)中，并进行有线通讯或者通过无线电或红外线进行无线通讯。另外，比较装置(3)中的比较器(36)可以引入可调整灵敏度。
包括产生装置比较系统

[发明专利]具有存储阵列的电路和基准电平发生器电路-CN200680002036.7无效
发明人： 维克托·M·G·范艾科特;尼古拉斯·兰伯特;皮埃尔·H·沃尔里 -专利权人： NXP股份有限公司
申请日： 2006-01-05 - 公布日： 2008-04-16 - 主分类号： G11C7/06 文献下载
摘要：一种电路包括存储单元(10)的阵列。多个读出电路(20)连接到各个存储单元(10)的输出端(14)，用于比较相应一个存储单元(10)的输出信号与基准信号，以根据来自相应一个存储单元(10)的输出信号形成数据信号。基准发生器电路(24，26)根据总和形成基准信号，其中在所述总和中被寻址组的每个相应存储单元(10)贡献的成分是相应一个存储单元(10)的输出信号的函数。该成分对于基准信号之上超过饱和距离的输出信号值是相等的，并且该成分对于基准信号之下超过饱和距离的输出信号值是相等的。在单元中存储多电平数据的情况下，在基准电平之上和之下，从中间电平到饱和电平的距离彼此不同，其比率对应于已经编程为各个电平的单元的计数的比率。
具有存储阵列电路基准电平发生器

[发明专利]对具有阻抗滞后元件的存储器矩阵的控制-CN200680007285.5有效
发明人：特尼斯·J·伊金克;皮埃尔·H·沃尔里;维克托·M·G·范艾科特;尼古拉斯·兰伯特;阿尔贝·W·马什曼 -专利权人： NXP股份有限公司
申请日： 2006-03-03 - 公布日： 2008-03-12 - 主分类号： G11C16/02 文献下载
摘要：使用一种用于存储器矩阵的控制电路(1、11)，所述控制电路限定了写入过程，所述写入过程使用至少两个空闲电路状态、全部列更新电路状态和列选择性更新状态之间的电路状态转变。其次，在存取期间，控制电路在执行列选择性更新命令期间从第一空闲状态(I1)到列选择性更新状态(W)来回切换；并且在执行全部列更新操作期间从第二空闲状态(I2)到全部列更新状态(E)来回切换。控制电路(1、11)保持处于第一和第二空闲状态(I1、I2)，而无需在执行连续的列选择性更新命令和全部列更新命令之间分别切换到第二和第一空闲状态(I2、I1)。
具有阻抗滞后元件存储器矩阵控制

[发明专利]对阻抗滞后元件的存储器矩阵的驱动-CN200680007357.6有效
发明人：特尼斯·J·伊金克;皮埃尔·H·沃尔里;维克托·M·G·范艾科特;尼古拉斯·兰伯特;阿尔贝·W·马什曼 -专利权人： NXP股份有限公司
申请日： 2006-02-28 - 公布日： 2008-03-12 - 主分类号： G11C16/02 文献下载
摘要：一种存储器矩阵(10)，包括单元行和列，每一个单元(20)包括串联连接在所述单元(20)行端子和列端子之间的阻抗滞后元件(24)和阈值元件(22)。所述阻抗滞后元件(24)具有分别相反极性的分别较大和较小的滞后阈值。在选定行中单元(20)的列端子和行端子之间施加电压差，以便执行读取动作。所述电压差具有读取极性，使得单元(20)两端的电压趋于与较大滞后阈值相对应。在选定行中单元(20)的列端子和行端子之间施加电压差，以便执行擦除动作，在所述擦除动作中集体地对选定行的全部单元(20)进行擦除。用于擦除动作的电压差具有读取极性。另外，在选定行中单元(20)的列端子和行端子之间施加电压差，以便执行写入动作。用于写入动作的电压差具有与较小的滞后阈值相对应的写入极性，用于对依据写入数据选定的单元(20)进行更新。
阻抗滞后元件存储器矩阵驱动

[发明专利]数据存储和重放设备-CN200580033037.3无效
发明人：塞巴斯蒂安·安吉尔;尼古拉斯·兰伯特;卢多维克斯·M·G·M·托于泽;维克托·M·G·范艾科特;马丁努斯·W·布卢姆 -专利权人：皇家飞利浦电子股份有限公司
申请日： 2005-07-22 - 公布日： 2007-09-05 - 主分类号： G11B20/18 文献下载
摘要：一种数据存储和重放设备，使用存储介质(典型地为闪速存储器电路)的性能演变的测量，来预测从存储介质的区域中重新得到的误码率。所述预测用作用于动态地选择在存储数据之前对数据进行编码的ECC的基础。从多个可用ECC中选择ECC，使得选择可最快编码的ECC，在给定所述信息的情况下，预测所述ECC产生不高于预定的解码后误码率。这样，在解码之后的预测未来时间段内使误码率保持低于可接受水平的同时，可以使设备的数据传输的速度最大化。在对典型地为音频或视频数据的数据进行解码时，以预定的速度进行解码和重放。在另一个实施例中，使用多个ECC来存储数据，并动态地选择ECC用于编码，使得可以使输出数据率最大化，或可以使重放时的功率消耗最小化。
数据存储重放设备

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