专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]制造半导体器件的方法-CN201510640606.6有效
  • 山部和治;阿部真一郎;吉田省史;山越英明;工藤敏生;村中诚志;大和田福夫;冈田大介 - 瑞萨电子株式会社
  • 2015-09-30 - 2020-01-24 - H01L21/28
  • 本发明涉及一种制造半导体器件的方法。为了提供具有改善的性能的半导体器件同时改善半导体器件的制造步骤中的吞吐量。在半导体衬底上形成由第一绝缘膜、第二绝缘膜、第三绝缘膜、第四绝缘膜和第五绝缘膜构成的绝缘膜部。所述第二绝缘膜是第一电荷存储膜并且所述第四绝缘膜是第二电荷存储膜。所述第一电荷存储膜含有硅和氮;所述第三绝缘膜含有硅和氧;并且所述第二电荷存储膜含有硅和氮。所述第三绝缘膜的厚度小于所述第一电荷存储膜的厚度并且所述第二电荷存储膜的厚度大于所述第一电荷存储膜的厚度。通过用含水的处理液对所述第一电荷存储膜的上表面进行处理来形成所述第三绝缘膜。
  • 制造半导体器件方法
  • [发明专利]制造半导体装置的方法-CN201710874281.7在审
  • 村中诚志 - 瑞萨电子株式会社
  • 2017-09-25 - 2018-04-13 - H01L29/78
  • 半导体装置的可靠性得到改善。由包含硅的伪栅电极构成的第一栅电极形成于半导体衬底之上。之后,通过离子注入法,在所述半导体衬底中形成用于MISFET的源极或漏极的半导体区域。之后,在所述半导体衬底之上形成绝缘膜以覆盖所述第一栅电极。之后,将所述绝缘膜抛光以暴露所述第一栅电极。之后,通过APM湿法蚀刻所述第一栅电极的表面。之后,通过使用氨水的湿法蚀刻将所述第一栅电极移除。然后,在所述第一栅电极被移除的区域中形成MISFET的栅电极。
  • 制造半导体装置方法
  • [发明专利]半导体器件及其制造方法-CN201510884600.3在审
  • 矢岛明;村中诚志 - 瑞萨电子株式会社
  • 2015-12-03 - 2016-06-15 - H01L23/485
  • 提供一种提高半导体器件的集成度的半导体器件及其制造方法。半导体器件(1A)包括:形成于半导体衬底(1P)上的多个Al布线层(5、7、9);形成于多个Al布线层的最上层的焊盘电极(9a);在焊盘电极上具有焊盘开口(10a)的基底绝缘膜(10);再布线,其与焊盘电极电连接,并在基底绝缘膜上延伸。而且,半导体器件包括:保护膜(12),其覆盖再布线(RM)的上表面,并具有使再布线的上表面的一部分露出的外部焊盘开口(12a);外部焊盘电极(13),其在外部焊盘开口处与再布线电连接,并在保护膜上延伸;以及与外部焊盘电极连接的导线(27)。并且,外部焊盘电极的一部分位于再布线的外侧区域。
  • 半导体器件及其制造方法

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