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[发明专利]一种提升SoC或ASIC混合验证的数据传输速率的方法-CN202211652498.0在审
发明人：张鹏程;杨滔;刘海峰 -专利权人： 合肥海本蓝科技有限公司
申请日： 2022-12-22 - 公布日： 2023-03-07 - 主分类号： G06F11/26 文献下载
摘要：本发明涉及集成电路验证技术领域，尤其涉及一种提升SoC或ASIC混合验证的数据传输速率的方法，包括Qemu模拟器和仿真器；Qemu模拟器用于模拟嵌入式SoC硬件平台为客户机提供运行环境；客户机为用户提供混合验证服务；虚拟设备使用Qemu模拟器提供的QAPI应用编程接口模拟虚拟设备，虚拟设备的OPS基于protobuf‑c‑rpc框架注册第一RPC客户端和第一RPC服务端；仿真器运行于主机上，主机基于protobuf‑c‑rpc框架注册第二RPC客户端和第二RPC服务端；虚拟设备的I/O行为通过第一RPC客户端与第二RPC服务端交互；仿真器的主动行为由第二RPC客户端告知第一RPC服务端，protobuf‑c‑rpc框架为基于protobuf语言和protobuf‑c语言的RPC框架。本发明验证效率高、可扩展性强、可移植性强、兼容性高。
一种提升 soc asic 混合验证数据传输速率方法

[发明专利]一种四片FPGA原型验证系统-CN202210932439.2在审
发明人：郭文帅;张全富 -专利权人： 合肥海本蓝科技有限公司
申请日： 2022-08-04 - 公布日： 2022-11-25 - 主分类号： G06F30/331 文献下载
摘要：本发明提供了一种四片FPGA原型验证系统，所述原型验证系统包括控制系统和四个FPGA主体板，控制系统用于配置四个FPGA主体板的电源电压值和时钟频率，监控四个FPGA主体板的电源电压和温度是否正常，快速下载BIT文件到四个FPGA主体板，抓取四个FPGA主体板内部的信号，提供用户接口。本发明提供的四片FPGA原型验证系统，降低了PCB的研发难度高、缩小了FPGA的面积、降低了研发成本、模块化方案方便调试和维护、用户可以自定义FPGA主体板与FPGA主体板的互联关系、用户自定义IO接口多。
一种 fpga 原型验证系统

[发明专利]一种实现软硬件互锁的装置-CN201710822909.9有效
发明人：刘海峰;许理;娄山林 -专利权人： 合肥海本蓝科技有限公司
申请日： 2017-09-13 - 公布日： 2020-08-07 - 主分类号： G05B19/042 文献下载
摘要：本发明提供一种实现软硬件互锁的装置，包括：硬件侧模块读取FPGA芯片中的Device DNA；物理通道连接模块接收硬件侧模块传递的Device DNA；AES加密模块接收物理通道连接模块发送的Device DNA，对Device DNA进行加密后发送给Device DNA匹配模块；预设Device DNA读取模块从本地文件中获取预设Device DNA，并发送给Device DNA匹配模块；Device DNA匹配模块接收加密后的Device DNA和预设Device DNA，并比较是否相同，如果不相同，控制当前运行软件退出运行。本发明实现了软硬件的相互绑定，保护了软件提供者的利益。
一种实现软硬件互锁装置

[发明专利]一种软硬件协同仿真加速器运行环境搭建方法和装置-CN201610520856.0有效
发明人：刘海峰;杨滔;王星;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2019-10-08 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种软硬件协同仿真加速器运行环境搭建方法和装置，方法包括：接收用户待测试设计文件、测试文件和参数信息文件，解析用户待测试设计文件、测试文件和参数信息文件以生成配置信息文件，并发送配置信息文件；接收配置信息文件和用户待测试设计文件，根据配置信息文件和用户待测试设计文件搭建软硬件协同仿真加速器运行环境。本发明可在当前设计语言基础上完全统一SCE‑MI协议，便于规范软硬件协同仿真加速器接口和便于测试文件和用户待测试设计文件之间的数据交换；SCE‑MI参数文件在很大程度上使得后续软件接口的实现脱离了硬件；同时可自动架构起软硬件协同仿真加速器运行环境，大大加速软硬件协同仿真处理效率和技术发展。
一种软硬件协同仿真加速器运行环境搭建方法装置

[发明专利]一种实现测试平台与用户待测试设计通信的方法和装置-CN201610520857.5有效
发明人：王星;杨滔;刘海峰;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2019-07-12 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种实现测试平台与用户待测试设计通信的方法和装置，方法包括：根据DUT中的顶层模块生成交换器，以及根据DUT中硬件输入、输出端口的属性信息生成参数文件，发送交换器的属性信息和参数文件；解析参数文件以获得硬件输入、输出端口的名称信息和对应的交换器的名称信息并发送；根据硬件输入、输出端口的名称信息和对应的交换器的名称信息以及交换器的属性信息生成标准协同仿真建模接口代理并发送；通过该代理将测试激励数据发送至交换器，以及通过该代理接收交换器产生的数据响应信息并发送至测试平台。本发明能增加测试平台的可操作性、灵活性和可移植性，且通信交互过程层次清晰，大大方便了程序设计者维护程序。
一种实现测试平台用户设计通信方法装置

[发明专利]一种软硬件协同仿真交易器和仿真系统-CN201610522236.0有效
发明人：杨滔;刘海峰;王星;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2019-06-25 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种软硬件协同仿真交易器和仿真系统，交易器包括：激励数据输入模块与FPGA中的待测试电路模块相连，用于接收打包的激励数据，并根据打包的激励数据获取激励数据，发送激励数据至待测试电路模块；仿真数据输出模块与待测试电路模块相连，用于接收待测试电路模块生成的仿真波形数据，对仿真波形数据进行打包处理，并输出打包处理后的仿真波形数据；配置模块分别与激励数据输入模块、仿真数据输出模块和待测试电路模块相连，用于接收配置信息，并根据配置信息配置激励数据输入模块、仿真数据输出模块和待测试电路模块。本发明中的软硬件协同仿真交易器为独立于软硬件协同仿真系统的模块，功能扩展更加方便，可靠性和可移植性好。
一种软硬件协同仿真交易系统

[发明专利]一种SCE-MI协议桥及仿真系统-CN201610520860.7有效
发明人：杨滔;刘海峰;王星;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2019-04-26 - 主分类号： H04L12/46 文献下载
摘要：本发明提供一种SCE‑MI协议桥及仿真系统，协议桥包括软件侧模块、硬件侧模块和物理通道模块，软件侧模块包括：软件侧数据生成单元、软件侧数据接收单元、软件侧数据处理单元、包括多个软件侧节点和软件侧适配节点的软件侧路由模块、与多个软件侧节点一一对应的多个基于SCE‑MI协议的软件侧数据输出通道和软件侧数据输入通道；硬件侧模块包括：包括多个硬件侧节点和硬件侧适配节点且结构与软件侧路由模块的结构相同的硬件侧路由模块、与多个硬件侧节点一一对应的多个基于SCE‑MI协议的硬件侧数据输出通道和硬件侧数据输入通道、硬件侧数据处理单元、硬件侧数据生成单元和硬件侧数据接收单元。本发明可以高效、有秩序的传输数据。
一种 sce mi 协议仿真系统

[发明专利]一种实现仿真波形数据实时分割的装置-CN201710822910.1在审
发明人：刘海峰;许理;娄山林 -专利权人： 合肥海本蓝科技有限公司
申请日： 2017-09-13 - 公布日： 2019-03-19 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种实现仿真波形数据实时分割的装置，包括：硬件侧模块生成仿真波形数据并进行周期信息设置和数据打包，并将打包后的仿真波形数据发送给仿真波形数据分割模块；波形分割需求信息传递模块接收用户TestBench设置的波形分割条件信息，并发送给仿真波形数据分割模块；仿真波形数据分割模块接收仿真波形数据和波形分割条件信息，根据波形分割条件信息对仿真波形数据进行分割，并将分割产生的数据发送给仿真波形数据写入文件模块；仿真波形数据写入文件模块接收分割数据，并将分割数据写入到波形文件中。本发明支持执行仿真时在线实时地分割仿真波形，方便用户选择性地查看波形，避免了超大波形数据加载效率低下的问题。
仿真波形分割数据分割模块分割条件数据写入文件分割数据数据发波形数据波形文件传递模块接收用户模块接收数据打包需求信息周期信息侧模块加载并发打包写入

[发明专利]一种基于重加密算法的FPGA虚拟IO片间互连数字电路-CN201510388804.8有效
发明人：宋宇鲲;杨滔;张多利;耿罗锋;陈迎春 -专利权人：合肥工业大学;合肥海本蓝科技有限公司
申请日： 2015-07-03 - 公布日： 2018-04-03 - 主分类号： H04L9/06 文献下载
摘要：本发明公开了一种基于重加密算法的FPGA虚拟IO片间互连数字电路，其特征是包括发送端数字电路、接收端数字电路和时钟生成模块；发送端数字电路包括明文数据生成逻辑、第一异步FIFO、头同步LFSR加密模块、第二异步FIFO、AES加密模块、并串转换模块、串行器和OBUFDS模块；接收端数字电路包括解串器、IBUFGDS模块、串并转换模块、第三异步FIFO写控制逻辑、第三异步FIFO、AES解密模块、第四异步FIFO、头同步LFSR解密模块和明文数据接收逻辑。本发明通过稳定有效的重加密算法，实现对FPGA虚拟IO片间互连数据传输过程中的加解密。
一种基于加密算法 fpga 虚拟 io 互连数字电路

[发明专利]一种数据回读系统-CN201610522205.5在审
发明人：杨滔;刘海峰;王星;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2016-11-30 - 主分类号： G06F17/50 文献下载
摘要：本发明实施例提供了一种数据回读系统，包括：数据回读装置产生波形回读命令，并将波形回读命令发送至物理通道连接装置，以及从物理通道连接装置获取仿真波形数据，并显示仿真波形数据对应的仿真波形；物理通道连接装置传输波形回读命令和仿真波形数据；FPGA模块包括待测试电路模块和仿真波形数据捕获模块，FPGA模块用于获取波形回读命令，根据波形回读命令通过仿真波形数据捕获模块捕获待测试电路模块生成的仿真波形数据，并将仿真波形数据发送至物理通道连接装置。本发明实施例占用逻辑资源少，且逻辑资源的占用不会随着IC设计规模的增大而增大，并且仿真波形数据回读十分方便，静态时序分析简单。
一种数据系统

[发明专利]一种封装标准协同仿真建模接口的方法和装置-CN201610520849.0在审
发明人：刘海峰;杨滔;王星;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2016-11-23 - 主分类号： G06F17/50 文献下载
摘要：本发明实施例提供了一种封装标准协同仿真建模接口的方法和装置，方法包括：接收用户待测试设计中的顶层文件，获取顶层文件中的各接口信息，并发送各接口信息；用户待测试设计中的顶层文件通过硬件描述语言设计；接收各接口信息，将各接口信息解析为对应在bsv语言中表示的各端口信息，根据各端口信息实例化用户待测试设计，将实例化的用户待测试设计封装成对应的bsv文件。本发明实施例在不改变原有硬件描述语言的情况下，通过转化顶层文件对应的用户DUT为更高抽像层次的bsv文件，实现了用户DUT和SCE‑MI协议的对接，促进了软硬件协同仿真技术的发展。
一种封装标准协同仿真建模接口方法装置

[发明专利]一种仿真系统-CN201610522228.6在审
发明人：王星;杨滔;刘海峰;戴继祥;陈迎春 -专利权人： 合肥海本蓝科技有限公司
申请日： 2016-07-01 - 公布日： 2016-11-23 - 主分类号： G06F17/50 文献下载
摘要：本发明提供了一种仿真系统，包括：主机模块根据接收的用户待测试设计生成配置文件，以及根据接收的测试参数产生测试激励数据，并分别发送配置文件和测试激励数据至物理通道连接模块，以及从物理通道连接模块获取仿真波形数据，并显示仿真波形数据对应的仿真波形；物理通道连接模块传输配置文件、测试激励数据和仿真波形数据；开发板模块包括FPGA，开发板模块根据配置文件对FPGA进行配置，并根据测试激励数据测试待测试电路模块以生成仿真波形数据，并发送仿真波形数据至物理通道连接模块；待测试电路模块为用户待测试设计在FPGA中映射的电路模块。本发明结构简单、拥有高效路由传输机制和多物理传输通道，且移植灵活方便。
一种仿真系统

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