[实用新型]一种多管并联匹配的超低噪声放大器有效

专利信息
申请号: 201720777998.5 申请日: 2017-06-30
公开(公告)号: CN207039547U 公开(公告)日: 2018-02-23
发明(设计)人: 郑滔;周德钱 申请(专利权)人: 成都玖信科技有限公司
主分类号: H03F1/26 分类号: H03F1/26;H03F1/56
代理公司: 北京康盛知识产权代理有限公司11331 代理人: 涂凤霞
地址: 610000 四川省成都市武侯*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 并联 匹配 低噪声放大器
【说明书】:

技术领域

实用新型涉及微波信号处理领域,具体而言,涉及一种多管并联匹配的超低噪声放大器。

背景技术

在微波信号处理领域,低噪声放大器作为最重要的器件之一,对输入信号功率进行放大,减小输入信号的噪声,提高输出信号的信噪比,尤其在雷达天线中有着不可替代的作用,低噪声放大器是无线接收机的重要组成部分,其性能的好坏将直接影响整个接收机系统的性能,低噪声放大器广泛地应用于微波通信、雷达、电子对抗、遥测遥控、射电天文、大地测绘等无线电通信系统中。

低噪声放大器是指噪声系数很低的放大器,一般用作各类无线电接收机的高频或中频前置放大器,以及高灵敏度电子探测设备的放大电路。在放大微弱信号的场合,放大器自身的噪声对信号的干扰可能很严重,在微波信号领域,低噪声放大器是必不可少的设备之一,放大信号,降低噪声是低噪声放大器的主要功能。

低噪声放大器带有限幅功能,可有效的削减无关大功率信号的幅度,保证后续器件的安全;目前很多低噪声放大器都是选用现成的低噪声的集成芯片或者采用单管匹配来设计的,比如设计一款4-8GHz的放大器,关键指标噪声系数难以达到1dB或者更低,并且考虑到芯片本身的噪声系数,实际的噪声系数还要比1dB大很多。

因此,不管采用集成芯片或者单管匹配的设计来实现低噪声放大器,噪声系数的大小将由芯片本身的噪声决定,而实际设计的低噪声放大器结构也会影响芯片本身的噪声系数,由此得出,用集成芯片和单管匹配的低噪声放大器不适合超低噪声系数要求的系统,只适用于一些要求不高的系统应用中,有一定的局限性。

实用新型内容

本实用新型的目的在于提供一种多管并联匹配的超低噪声放大器,其能够通过采用单管放大芯片并联的形式形成噪声放大单元,将整个超低噪声放大器的阻抗减低,使阻抗更接近于标称阻抗,再通过匹配电路优化调节,使整个超低噪声放大器的噪声降低。

本实用新型的实施例是这样实现的:一种多管并联匹配的超低噪声放大器,其包括放大器放大电路,放大器放大电路包括放大单元,放大单元由3颗放大器件并联而成,放大器件包括单管放大器或放大器芯片。

在本实用新型较佳的实施例中,上述放大器件至少包括三组。

在本实用新型较佳的实施例中,上述超低噪声放大器还包括放大器输入匹配电路,放大器输入匹配电路的输出端与放大器放大电路的输入端连接。

在本实用新型较佳的实施例中,上述放大器输入匹配电路包括第一隔离耦合单元,第一隔离耦合单元包括第一带通滤波器、输入耦合器和前级超低噪声放大管,输入耦合器的输出端与前级超低噪声放大管的输入端连接,前级超低噪声放大管输出端与第一带通滤波器的输入端连接。

在本实用新型较佳的实施例中,上述超低噪声放大器还包括放大器输出匹配电路,放大器输出匹配电路的输入端与放大器放大电路的输出端连接。

在本实用新型较佳的实施例中,上述放大器输出匹配电路包括第二带通滤波器和输出耦合器,第二带通滤波器的输入端与噪声放大单元的输出端相连,第二带通滤波器的输出端与输出耦合器的输入端相连。

在本实用新型较佳的实施例中,上述超低噪声放大器还包括放大器供电电路,放大器供电电路包括放大器滤波单元,放大器滤波单元包括电感、电阻、电容等滤波电路,所述滤波单元输出端与放大器管芯的输入端和输出端连接。

本实用新型实施例的有益效果是:本实用新型实施例通过采用单管放大芯片并联的形式形成噪声放大单元,将整个超低噪声放大器的阻抗降低,使阻抗更接近于标称阻抗,再通过匹配电路优化调节,使整个超低噪声放大器的噪声降低。

附图说明

为了更清楚地说明本实用新型实施例的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,应当理解,以下附图仅示出了本实用新型的某些实施例,因此不应被看作是对范围的限定,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他相关的附图。

图1为本实用新型实施例的4-8GHz常规设计的示意电路图;

图2为本实用新型实施例的4-8GHz常规设计的噪声系数测试曲线;

图3为本实用新型实施例的4-8GHz采用多管并联设计的电路示意图;

图4为本实用新型实施例的4-8GHz采用多管并联设计的实际噪声系数测试曲线;

图5为本实用新型实施例中的4-8GHz采用多管并联设计的电路示意图。

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