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[发明专利]一种对远程FPGA实验平台的管脚复用方法-CN202010555952.5在审
发明人：卢建良;何旭;樊金昊;陈翊辉;张灏文;徐亦舜;朱恩佐 -专利权人：中国科学技术大学
申请日： 2020-06-17 - 公布日： 2020-09-22 - 主分类号： G06F13/40 文献下载
摘要：本发明公开了一种对远程FPGA实验平台的管脚复用方法，包括：烧录通道芯片，烧录的通道芯片用于接收程序并且将接收到的程序烧录到FPGA上，所述烧录的通道芯片通过排线将自身管脚与FPGA管脚相连接，自身运行程序根据当前模式，控制FPGA管脚的输入与输出，从而实现FPGA管脚的复用。上述方法对FPGA平台的使用起到了促进效果，能够在不增加管脚的情况下接收更多来自于FPGA的信息，而且通过管脚的复用节省了管脚资源，避免了管脚资源的浪费，从而使得在有限的资源下实现更多的功能。
一种远程 fpga 实验平台管脚方法

[发明专利]一种针对智能卡芯片的测试系统-CN201910028436.4在审
发明人：石志刚;来金鑫 -专利权人：北京确安科技股份有限公司
申请日： 2019-01-11 - 公布日： 2020-07-21 - 主分类号： G01R31/28 文献下载
摘要：本发明实施例提供一种针对智能卡芯片的测试系统，包括测试机及参与并行测试的多个智能卡芯片；其中：测试机包括一个或多个100MDM板卡，100MDM板卡包括多个100MDM测试资源；并且，每个智能卡芯片的VCC管脚单独连接100MDM板卡进行供电；多个智能卡芯片的同种类的第一管脚采用多位复用的方式连接100MDM测试资源，第一管脚的信号不随周期进行电平翻转；每个智能卡芯片的第二管脚单独连接100MDM测试资源，第二管脚的信号随周期进行电平翻转。本发明实施例提供的针对智能卡芯片的测试系统，通过采用100MDM板卡给VCC管脚供电，并且同种类的第一管脚复用100MDM测试资源，有效地减少了测试机板卡的使用数量，降低了测试成本。
一种针对智能卡芯片测试系统

[实用新型]一种空调器及其步进电机驱动电路-CN201420217010.6有效
发明人：余圩钱 -专利权人：美的集团股份有限公司
申请日： 2014-04-29 - 公布日： 2014-10-29 - 主分类号： H02P8/00 文献下载
摘要：本实用新型通过在具有主控芯片以及一个或多个复合晶体管芯片的步进电机驱动电路中采用移位寄存模块，移位寄存模块的时钟控制端、数据输入端及锁存控制端分别连接主控芯片的时钟信号管脚、数据信号管脚及锁存信号管脚，由移位寄存模块根据主控芯片输出的时钟信号和锁存信号对主控芯片输出的数据信号进行移位寄存处理后输出多路驱动信号以使一个或多个复合晶体管芯片驱动一个或多个步进电机进行工作，减少了对主控芯片的管脚资源的占用，在同时驱动多个步进电机时可以有效地提高主控芯片的管脚资源利用率，解决了现有技术所存在的主控芯片的管脚资源利用率低的问题。
一种空调器及其步进电机驱动电路

[发明专利]端口状态管理电路、方法、装置及可读存储介质-CN202010666982.3有效
发明人：章波 -专利权人：迈普通信技术股份有限公司
申请日： 2020-07-10 - 公布日： 2022-05-17 - 主分类号： G01R31/69 文献下载
摘要：本申请提供一种端口状态管理电路、方法、装置及可读存储介质，端口状态管理电路包括：具有控制管脚和模拟采样管脚的控制芯片；信号采集电路，与控制芯片的控制管脚和模拟采样管脚连接，并与待检测的各端口连接。信号采集电路用于在接收到控制管脚发来的控制信号时，根据控制信号对所连接的端口进行电压采集，并将采集到的各端口的总电压值通过模拟采样管脚反馈给所述控制芯片；控制芯片用于根据总电压值确定信号采集电路所连接的各端口的状态本申请可以通过模拟信号使得管脚资源最小化，使得一个模拟采样管脚可以对应用于检测多个端口的状态，从而减少对于管脚资源的限制。
端口状态管理电路方法装置可读存储介质

[发明专利]一种模式选择电路-CN201210476031.5无效
发明人：谢卫国 -专利权人：江苏格立特电子有限公司
申请日： 2012-11-22 - 公布日： 2013-03-13 - 主分类号： H03K19/0185 文献下载
摘要：本发明公开了一种模式选择电路，涉及集成电路设计领域，包括芯片的内部模式选择电路和芯片的管脚，所述管脚外部通过电阻接地，所述管脚内部通过转换电路与内部模式选择电路相连，所述管脚内部与转换电路的连接点通过串联的电阻和本发明只需要使用1个管脚，增加1个管脚外部连接的电阻，用AD转换电路代替逻辑控制电路，通过调整管脚外部连接电阻的阻值，就可以实现集成了多模式的芯片在不同模式间的选择，充分利用芯片的管脚资源，有效降低芯片成本，而且芯片集成的模式越多，效果越明显。
一种模式选择电路

[实用新型]一种模式选择电路-CN201220620893.6有效
发明人：谢卫国 -专利权人：江苏格立特电子有限公司
申请日： 2012-11-22 - 公布日： 2013-05-15 - 主分类号： H03K19/0185 文献下载
摘要：本实用新型公开了一种模式选择电路，涉及集成电路设计领域，包括芯片的内部模式选择电路和芯片的管脚，所述管脚外部通过电阻接地，所述管脚内部通过转换电路与内部模式选择电路相连，所述管脚内部与转换电路的连接点通过串联的电阻和本实用新型只需要使用1个管脚，增加1个管脚外部连接的电阻，用AD转换电路代替逻辑控制电路，通过调整管脚外部连接电阻的阻值，就可以实现集成了多模式的芯片在不同模式间的选择，充分利用芯片的管脚资源，有效降低芯片成本，而且芯片集成的模式越多，效果越明显。
一种模式选择电路

[发明专利]一种CPLD管脚复用方法与装置-CN201810759185.2在审
发明人：梁超;赵现普 -专利权人：郑州云海信息技术有限公司
申请日： 2018-07-11 - 公布日： 2018-12-07 - 主分类号： G06F13/20 文献下载
摘要：本发明公开了一种CPLD管脚复用方法与装置包括：在第一时间段，使用外部芯片的管脚监控CPLD的管脚、或使用CPLD的管脚监控外部芯片的管脚，并根据被监控管脚的发出的第一信号执行第一操作；在第二时间段，继续使用外部芯片的管脚监控CPLD的管脚、或使用CPLD的管脚监控外部芯片的管脚，并根据被监控管脚的发出的第二信号执行不同于第一操作的第二操作。本发明能够针对不同CPLD或不同类型的CPLD进行管脚复用，减少对GPIO的需求、降低CPLD的成本、并提高资源利用率。
管脚外部芯片监控管脚复用时间段资源利用率第二信号

[实用新型]具有串行接口的时钟控制电路-CN201220671450.X有效
发明人：文涵灵 -专利权人：成都卓程科技有限公司
申请日： 2012-12-09 - 公布日： 2013-07-10 - 主分类号： G05B19/042 文献下载
摘要：本实用新型公开了具有串行接口的时钟控制电路，包括设有时钟芯片、单片机的数字时钟控制机构，所述的时钟芯片连接在单片机上，本实用新型在所述的时钟芯片上设有串行接口，所述的时钟芯片通过串行接口连接在单片机上。所述的串行接口包括定义于时钟芯片上的管脚SCL、管脚SDA、管脚RET，所述的时钟芯片通过管脚SCL、管脚SDA、管脚RET连接在单片机上。本实用新型结构简单，以单片机为主控芯片、设有串行接口的时钟芯片为核心设计，不但能准确的计时、附加其它功能，而且，其串行接口还可以节省单片机的接口资源，设计十分合理。
具有串行接口时钟控制电路

[发明专利]一种Vcore与Boot管脚复用的芯片管脚架构、方法及芯片-CN202210157870.4在审
发明人：杨颖 -专利权人：上海矽翊微电子有限公司
申请日： 2022-02-21 - 公布日： 2022-04-12 - 主分类号： H03K19/0175 文献下载
摘要：本申请提供了一种Vcore与Boot管脚复用的芯片管脚架构、方法及芯片。管脚架构包括PMU模块、电压比较模块和Boot管脚；PMU模块具有Vcore电压端。复用方法为：Boot管脚的输入信号发送至电压比较模块，电压比较模块的滞回电压比较器将Boot管脚的输入信号和第一参考电压比较后输出芯片在加电启动时的启动模式选择信号；Boot管脚还连接至Vcore电压端，Boot管脚还用于外接Vcore电容，构成管脚复用。Boot管脚电平范围为Vcore电压的范围。电压比较模块还包括时钟周期滤波器，以滤除频率为启动时钟频率的干扰信号。芯片包括上述管脚架构。本申请可节省管脚资源，应用方便、工作可靠。
一种 vcore boot 管脚芯片架构方法

[发明专利]FPGA管脚加载复用装置和方法-CN201510873137.2有效
发明人：赵亮;吴芳;黄少杰 -专利权人：北京浩瀚深度信息技术股份有限公司
申请日： 2015-12-02 - 公布日： 2019-01-01 - 主分类号： G06F8/61 文献下载
摘要：本发明涉及通信领域，具体提供一种FPGA管脚加载复用装置，旨在解决现有现有FPGA加载方式导致管脚浪费的问题。为此目的，本发明的FPGA管脚加载复用装置包括烧录通道芯片，所述烧录通道芯片用于从硬盘接收程序并且将接收到的程序烧录到FPGA上，其特征在于，所述FPGA管脚加载复用装置还包括设置在所述烧录通道芯片与所述FPGA之间的驱动控制芯片，所述驱动控制芯片用于控制所述驱动控制芯片两端的烧录数据线的打开和关闭，从而实现所述烧录通道芯片的烧录管脚的复用。本领域技术人员能够理解的是，本发明的技术方案使烧录专用管脚能够被复用，不仅提高了加载速度，还最大限度地解决了管脚资源紧张的问题。
管脚加载烧录复用装置通道芯片驱动控制芯片复用程序烧录管脚资源接收程序领域技术烧录数据通信领域硬盘

[实用新型]FPGA管脚加载复用装置-CN201520987940.4有效
发明人：赵亮;吴芳;黄少杰 -专利权人：北京浩瀚深度信息技术股份有限公司
申请日： 2015-12-02 - 公布日： 2016-07-06 - 主分类号： G06F9/445 文献下载
摘要：本实用新型涉及通信领域，具体提供一种FPGA管脚加载复用装置，旨在解决现有现有FPGA加载方式导致管脚浪费的问题。为此目的，本实用新型的FPGA管脚加载复用装置包括烧录通道芯片，所述烧录通道芯片用于从硬盘接收程序并且将接收到的程序烧录到FPGA上，其特征在于，所述FPGA管脚加载复用装置还包括设置在所述烧录通道芯片与所述FPGA之间的驱动控制芯片，所述驱动控制芯片用于控制所述驱动控制芯片两端的烧录数据线的打开和关闭，从而实现所述烧录通道芯片的烧录管脚的复用。本领域技术人员能够理解的是，本实用新型的技术方案使烧录专用管脚能够被复用，不仅提高了加载速度，还最大限度地解决了管脚资源紧张的问题。
fpga 管脚加载装置

[实用新型]一种基于FPGA的串行闪存调试电路以及具有该电路的电视机-CN201020139667.7无效
发明人：徐卫 -专利权人：青岛海信电器股份有限公司
申请日： 2010-03-24 - 公布日： 2010-11-24 - 主分类号： G11C29/12 文献下载
摘要：本实用新型公开了一种基于FPGA的串行闪存调试电路以及具有该电路的电视机，涉及调试电路技术领域，为了解决现有技术中FPGA内部RAM资源容量限制串行闪存调试电路的观测数据存储的问题而设计，本实用新型提供的一种基于FPGA的串行flash调试电路，包括：FPGA芯片、闪存芯片和测试插针；所述闪存芯片与所述FPGA芯片的控制管脚、所述测试插针的控制管脚相连；所述FPGA芯片的测试管脚与所述测试插针的测试管脚相连。采用该实用新型可以实现闪存调试电路能够调试数据量较大的信号，缩短调试周期，节省FPGA的RAM资源，提高FPGA的系统性能。
一种基于 fpga 串行闪存调试电路以及具有电视机

[发明专利]一种微控制器单线编程调试接口装置以及调试方法-CN201710725981.X在审
发明人：张伟 -专利权人：上海爱矽半导体科技有限公司
申请日： 2017-08-22 - 公布日： 2018-01-23 - 主分类号： G06F11/36 文献下载
摘要：本发明公开了一种微控制器单线编程调试接口装置以及调试方法，装置包括控制芯片和目标芯片，所述控制芯片和所述目标芯片之间使用一个IO管脚D_IO用作调试。采用本发明的方法使用管脚更少，更节省资源，且通讯速率范围更宽，管脚使用少，对通讯时钟无固定需求。此外，本发明具备通讯速率自适应能力。
一种控制器单线编程调试接口装置以及方法

[发明专利]一种接口扩展电路和运行方法-CN201611267082.1在审
发明人：肖瑜珠 -专利权人：深圳市沃特玛电池有限公司
申请日： 2017-05-11 - 公布日： 2017-07-21 - 主分类号： H04L12/40 文献下载
摘要：本发明实施例公开了一种接口扩展电路和运行方法，用于增加CAN通信接口资源，满足通信需求。本发明实施例接口扩展电路包括顺序连接的CAN控制芯片、IC芯片、CAN收发器；CAN控制芯片的各选通脚分别与IC芯片的各选通脚连接；IC芯片电连接至少两个CAN收发器，包括第一CAN收发器和第二CAN收发器；IC芯片中的第一管脚与第一CAN收发器中的TTL接收管脚电连接，IC芯片中的第二管脚与第一CAN收发器中的TTL发送管脚电连接，IC芯片中的第三管脚与第二CAN收发器中的TTL接收管脚电连接，IC芯片中的第四管脚与第二CAN收发器中的TTL发送管脚电连接；通过控制CAN控制芯片的各选通脚的电平，IC芯片能控制CAN控制芯片选通任一个CAN收发器。
一种接口扩展电路运行方法

[实用新型]一种微控制器单线编程调试接口装置-CN201721042170.1有效
发明人：张伟 -专利权人：上海爱矽半导体科技有限公司
申请日： 2017-08-18 - 公布日： 2018-03-16 - 主分类号： G05B19/042 文献下载
摘要：本实用新型公开了一种微控制器单线编程调试接口装置，装置包括控制芯片和目标芯片，所述控制芯片和所述目标芯片之间使用一个IO管脚D_IO用作调试。采用本实用新型的方法使用管脚更少，更节省资源，且通讯速率范围更宽，管脚使用少，对通讯时钟无固定需求。此外，本实用新型具备通讯速率自适应能力。
一种控制器单线编程调试接口装置

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