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- [发明专利]FPGA时序约束布局方法-CN201510289075.0有效
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来金梅;方浩帅;杨萌;王健
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复旦大学
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2015-06-01
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2017-12-29
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G06F17/50
- 本发明属于电子技术领域,具体为一种FPGA时序约束布局方法。本发明针对输入输出延时约束与端口路径延时约束。对于输入输出延时约束,本发明提出一种递归搜索算法进行输入端口到触发器(或触发器到输出端口)的路径搜索,当搜索到触发器Q顶点时,使用延时分类路径存储方法进行路径保存;对于端口路径约束,本发明对所约束的输入端口进行正向拓扑排序,对所约束的输出端口进行反向拓扑排序,对两者求交集得到约束路径,并设计了该类约束的路径延时增量式计算策略。本发明提出的方法能够很好的处理这两类时序约束的路径存储与延时计算问题,能够指导布局引擎进行时序路径约束布局。
- fpga时序约束布局方法
- [发明专利]路径选择方法、装置和网络设备-CN200910266038.2无效
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刘金辉
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福建星网锐捷网络有限公司
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2009-12-31
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2010-07-14
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H04L12/56
- 本发明提供一种路径选方法、装置和网络设备,其中方法包括:根据节点的路径权重生成根节点到目的节点的路径表,路径表中的路径节点携带各自的下一跳表;根据等价约束路径选取规则从目的节点的下一跳表指示的等价约束路径中选择最优的约束路径装置包括:路径表生成模块,用于根据节点的路径权重生成根节点到目的节点的路径表,路径表中的路径节点携带各自的下一跳表;路径选择模块,用于根据等价约束路径选取规则从所述目的节点的下一跳表指示的等价约束路径中选择最优的约束路径本实施例在不增加计算复杂度的前提下,可以从中快速选择一条符合要求的等价路径,提高了链路的整体性能,提高了路径选择的效率。
- 路径选择方法装置网络设备
- [发明专利]一种隧道环回方法及其相关设备-CN201711345664.1有效
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覃剑宏
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北京华为数字技术有限公司
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2017-12-14
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2021-02-23
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H04L12/721
- 本申请实施例公开了一种隧道环回方法及其相关设备,用于在不影响其它正常的SR‑TE隧道的业务和可以检测回程路径的前提下,实现SR‑TE承载的业务报文的隧道环回。本申请实施例方法包括:接收控制器下发的约束路径,约束路径包括源节点、宿节点和约束节点,源节点和宿节点为同一节点,源节点到约束节点的路径为第一路径,约束节点到宿节点的路径为第二路径,第一路径与第二路径经过的转发器顺序相反;根据约束路径更新转发路径的标签栈,得到目的标签栈;根据目的标签栈将目标报文在约束路径中进行转发;判断第一转发器是否接收到目标报文,第一转发器与与源节点相对应;若接收到目标报文,则确定目标报文实现隧道环回
- 一种隧道方法及其相关设备
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