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专利名称

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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]处理器的处理方法以及处理器-CN201310751045.8有效
发明人：张喆鹏 -专利权人：联想（北京）有限公司
申请日： 2013-12-31 - 公布日： 2018-08-31 - 主分类号： G06F1/32 文献下载
摘要：本发明提供了处理器的处理方法以及处理器。所述处理器具有一个或者多个内核，所述内核包括指令集合、接收模块以及处理模块，指令集合配置来存储包括第一指令在内的多个指令，其中包括：通过所述接收模块接收操作命令；通过所述处理模块调取所述指令集合中的指令以执行所述操作命令，当所述调取的指令中包含所述第一指令时，在保持所述内核时钟继续运行的同时，在规定时间内停止所述内核中的处理操作。根据该方法，在指令间隔期间内停止内核的各种处理操作，仅保留时钟，在无需停止处理器的同时有效降低处理器的功耗。
处理器处理方法以及

[实用新型]处理器模组和处理器装置-CN202320485294.6有效
发明人：许科峰 -专利权人：广州国同芯微电子有限公司
申请日： 2023-03-14 - 公布日： 2023-09-01 - 主分类号： G06F15/78 文献下载
摘要：本实用新型实施例公开一种处理器模组和处理器装置，其中处理模块和二级缓存模块集成，二级缓存模块的第三总线接口与处理模块的第一总线接口连接，二级缓存模块的第四总线接口与处理模块的第二总线接口连接；处理器模组的第一输出端分别与第一总线接口处理模块选择通过第一总线接口和第二总线接口分别向第一输出端和第二输出端输出信号，或者通过第五总线接口和第六总线接口分别向第一输出端和第二输出端输出信号。因在处理器模组中处理模块和二级缓存模块已集成，因此处理器模组经过验证后，根据需求在片上系统直接应用即可，缩短项目时间。
处理器模组装置

[发明专利]处理器-CN201110265352.6在审
发明人：花木博一;高岛敏 -专利权人：索尼公司
申请日： 2011-09-08 - 公布日： 2012-04-04 - 主分类号： G06F9/30 文献下载
摘要：一种处理器，包括：指令提取部分，配置为根据程序计数器同时提取多个固定长度的指令；指令预解码器，配置为预解码所述多个固定长度的指令的一部分中的特定字段；以及程序计数器管理部分，配置为根据预解码的结果控制所述程序计数器的增量
处理器

[发明专利]处理器-CN202010306599.7在审
发明人：王磊;伊利亚·奥夫相尼科夫 -专利权人：三星电子株式会社
申请日： 2020-04-17 - 公布日： 2020-10-27 - 主分类号： G06N3/063 文献下载
摘要：公开一种处理器。所述处理器包括寄存器、非零权重值选择器和乘法器。寄存器保存第一组权重值和第二组权重值。每组权重值包括至少一个权重值，并且第一组权重值中的每个权重值对应于第二组权重值中的权重值。非零权重值选择器从第一组权重值中的权重值或第二组权重值中的与第一组权重值中的权重值对应的非零权重值选择非零权重值。乘法器将选择的非零权重值和与选择的非零权重值对应的激活值相乘以形成输出乘积值。
处理器

[发明专利]处理器-CN202110776465.6在审
发明人：赖照民;谢瀚颉;张堂洪;王鸿玮;郭俊仪 -专利权人：瑞昱半导体股份有限公司
申请日： 2021-07-09 - 公布日： 2023-01-13 - 主分类号： G06F1/08 文献下载
摘要：本发明公开了一种处理器，其包含有核心电路、多个时钟产生电路、多工器及检测电路。
处理器

[发明专利]处理器-CN03138541.9有效
发明人：田中哲也;冈林羽月;瓶子岳人;小川一;古贺义宏;黑田学;铃木正人;清原督三;田中健;西田英志;宫阪修二 -专利权人：松下电器产业株式会社
申请日： 2003-06-03 - 公布日： 2004-01-14 - 主分类号： G06F9/30 文献下载
摘要：提供一种执行对作为SIMD运算对象的操作数位置的约束少、弹性高的SIMD运算的处理器。具备解码部(20)和运算部(40)等，若解码部(20)译码命令[vxaddh Rc，Ra，Rb]，则算术逻辑、比较运算器(41)等(i)将寄存器Ra的上位16位与寄存器Rb的下位16位相加，将结果存储在寄存器Rc的上位16位中，同时，(ii)将寄存器Ra的下位16位与寄存器Rb的上位16位相加，将结果存储在寄存器Rc的下位16位中。
处理器

[发明专利]处理器-CN03160365.3有效
发明人：田中哲也;冈林贺子奇;瓶子岳人;小川一;铃木常之;清原督三;田中健;西田英志;前田昌树 -专利权人：松下电器产业株式会社
申请日： 2003-09-25 - 公布日： 2004-05-19 - 主分类号： G06F9/38 文献下载
摘要：本发明提供一种执行高性能SIMD运算的处理器等。其具备解码部(20)与运算部(40)等，一旦解码部(20)译码指令vcchk，则运算部(40)等判断条件标志寄存器CFR(32)的矢量条件标志VC0－VC3(110)是否全部为0，在全部为0的情况下，分别将条件标志寄存器
处理器

[发明专利]处理器-CN200810109159.1有效
发明人：本田岩;岸田慎也 -专利权人：三洋电机株式会社;三洋半导体株式会社
申请日： 2008-05-23 - 公布日： 2008-12-03 - 主分类号： G06F9/30 文献下载
摘要：提供一种处理器，具备：多个寄存器；命令读出电路，其从存储器中读出命令；命令生成电路，其在由命令读出电路读出的命令是指示存储在多个寄存器中的数据的保存的命令的情况下，按照每个寄存器生成将数据保存在规定的存储区域中的命令；命令执行电路，其执行从存储器中读出的命令以及由命令生成电路所生成的命令。
处理器

[发明专利]处理器-CN200410087792.7有效
发明人：关正伸 -专利权人：精工爱普生株式会社
申请日： 2004-10-28 - 公布日： 2005-05-04 - 主分类号： G06F9/30 文献下载
摘要：在一处理器中，一ALU或一解码部分包括：用于对第一输入值的符号进行反向的符号反向部分(101)；用于确定第二输入值的符号的符号确定部分(102)；和输出选择部分，用于在所述符号确定部分(102)的确定结果是正的情况下选择性的输出所述第一输入值
处理器

[发明专利]处理器-CN200910132026.0无效
发明人：森下广之;桥本隆;清原督三 -专利权人：松下电器产业株式会社
申请日： 2006-04-12 - 公布日： 2009-09-30 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及的处理器，是循环地按照分配给线程的时间来执行多个线程的处理器，其具备可重构的集成电路；事先存储与多个线程的各个对应的电路构成信息，根据电路构成信息将上述集成电路的一部分进行重构，依次使用根据对应于线程的电路构成信息进行了重构的集成电路
处理器

[发明专利]处理器-CN200910158828.9无效
发明人：石井雅明 -专利权人：索尼株式会社
申请日： 2009-07-08 - 公布日： 2010-01-13 - 主分类号： G06F9/38 文献下载
摘要：本发明公开了处理器。该处理器包括：多个执行部件，被配置为同时执行多个线程的指令；指令发布部件，被配置为向多个执行部件发布指令；以及指令同步监控部件，被配置为当同步指令的指令从指令发布部件被发布到多个执行部件中的一个或多个时
处理器

[发明专利]处理器-CN201310178942.4无效
发明人：詹姆斯.A.D.W.安德森 -专利权人：詹姆斯·安德森
申请日： 2008-05-30 - 公布日： 2013-10-23 - 主分类号： G06F15/82 文献下载
摘要：一种处理装置包含每一个布置成执行指令的多个处理器（12）、和布置成在所述处理器之间传送数据和控制令牌的总线（20）。每个处理器（12）被布置成，如果它经由所述总线接收到控制令牌，就执行指令，并且，一旦执行了指令，就对数据执行操作以标识将是数据目标处理器的任何处理器（12），并将输出数据发送给任何标识数据目标处理器，以标识将是控制目标处理器的任何处理器，并将控制令牌发送给任何标识控制目标处理器。
处理器

[发明专利]处理器-CN98117664.X无效
发明人：神保卓哉;大谷昭彦;荒木敏之 -专利权人：松下电器产业株式会社
申请日： 1998-09-01 - 公布日： 2004-07-14 - 主分类号： G06F1/10 文献下载
摘要：一种处理器设置运算控制器、运算单元、存储器。运算控制器，接受来自时钟信号控制器的非选通时钟信号，发布用于指定运算单元中使用资源的参数信号，同时微控制器发布运算启动信号，请求信号被触发。对应于该请求信号，时钟信号控制器分别向运算单元及存储器提供选通信号。运算控制器，判断运算单元提供的状态信号是否满足终了条件，在终了条件得到满足的情况下，将隔断请求信号。这样，停止向运算单元及存储器提供时钟信号。
处理器

[发明专利]处理器-CN89103732.2无效
发明人：维尔纳·赖兴;威尔弗利德·维尔纳·盖利 -专利权人：德国ITT工业有限公司
申请日： 1989-06-01 - 公布日： 1991-04-17 - 主分类号： G06F7/00 文献下载
摘要：本处理器的算术/逻辑单元含有一个乘法器、第一数据字A和第二数据字B作为输入数据送入至乘法器，与第一和第二数据字相似，来自数据存贮器的第三数据字C，通过移位数q的桶形移位器(b1)送入加法器的一个输入，而加法器的其他输入接到乘法器的输出，加法器的输出提供第四数据字D，它被写入到数存贮器内，借助单个程序指令(pi)，对形成第四数据字D所需的全部数据运动予以定义。
处理器

[发明专利]处理器-CN200710141073.2无效
发明人：九郎丸俊一;冈本好史;道山淳儿 -专利权人：松下电器产业株式会社
申请日： 1998-06-05 - 公布日： 2008-01-09 - 主分类号： G06F7/76 文献下载
摘要：本发明公开一种运算装置，具有将从外部输入的数字数据作为P位的数字数据进行存储的输入寄存器101、存储Q位的数字数据的输出寄存器107和将从输入寄存器101输出的P位的数字数据102作为第1输入数据、将从输出寄存器输出的Q位的数字数据103作为第2输入数据并根据从外部输入的控制数据104从第1输入数据102的位和第2输入数据103的位中选择应输出其值的位从而将由该选择的位的值构成的Q位的数字数据106向输出寄存器107输出的输出位选择单元105，该运算装置用于图象处理系统，适合于高速地进行代码的多路化处理或分离处理。
处理器

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