专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]采用深沟槽隔离的图像传感器的制作方法-CN201510280051.9在审
  • 赵立新;杨瑞坤 - 格科微电子(上海)有限公司
  • 2015-05-28 - 2015-09-30 - H01L27/146
  • 本发明提供一种采用深沟槽隔离的图像传感器的制作方法,包括:提供衬底,所述衬底包括衬底单晶层;刻蚀所述衬底单晶层以形成若干凸起的单晶墙,所述单晶墙的顶表面和侧表面覆盖有介质层;选择性外延所述单晶墙之间的衬底单晶层表面以形成第一外延单晶层,去除覆盖单晶墙顶表面的介质层以暴露出单晶墙顶表面,选择性外延所述单晶墙顶表面和第一外延单晶层表面以形成第二外延单晶层;在所述第一外延单晶层和第二外延单晶层中形成图像传感器的部分器件。本发明有效减少了隔离结构和外延单晶层的缺陷,避免了图像传感器器件的功能损害,提高了图像传感器器件质量。
  • 采用深沟隔离图像传感器制作方法
  • [发明专利]单片单晶微机械加工的电容式压力传感器-CN200510092880.0无效
  • 涂相征;李韫言 - 李韫言
  • 2005-08-25 - 2007-02-28 - G01L9/12
  • 一种微机械加工的电容式压力传感器,其结构主要包括:单晶衬底;处于单晶衬底表面,起电容器弹性电极作用的外延单晶层;处于单晶衬底边缘表面的外延单晶框架;覆盖外延单晶框架表面的介质薄膜;由外延单晶框架支持,起电容器固定电极作用的外延单晶层;由外延单晶框架所围绕,处于两外延单晶层之间的空洞夹层。传感器的制造采用多孔选择性形成,多孔外延生长,以及多孔选择性腐蚀等技术。由于器件为全单晶结构,器件性能可以得到很大改进,制造成本也能大幅度降低。
  • 单片单晶硅微机加工电容压力传感器
  • [实用新型]采用深沟槽隔离的图像传感器-CN201520352531.7有效
  • 赵立新;杨瑞坤 - 格科微电子(上海)有限公司
  • 2015-05-28 - 2015-09-09 - H01L27/146
  • 本实用新型提供一种采用深沟槽隔离的图像传感器,包括:衬底,所述衬底包括衬底单晶层;单晶墙,凸出设置于衬底单晶层表面,所述单晶墙的侧表面覆盖有介质层;第一外延单晶层,位于所述单晶墙之间的衬底单晶层表面;第二外延单晶层,位于所述单晶墙顶表面和第一外延单晶层表面;图像传感器的部分器件,位于所述第一外延单晶层和第二外延单晶层中。本实用新型有效减少了隔离结构和外延单晶层的缺陷,避免了图像传感器器件的功能损害,提高了图像传感器器件质量。
  • 采用深沟隔离图像传感器
  • [发明专利]SOI衬底的制造方法-CN202080003712.2在审
  • 朴振源 - 韩商则舒穆公司
  • 2020-10-29 - 2021-07-16 - H01L21/762
  • 本发明涉及多个SOI衬底的制造方法,所述SOI衬底的制造方法的特征包括:(a)在第一单晶衬底的一面上形成剥离层的步骤;(b)在剥离层上形成第一单晶外延层的步骤;(c)在第一单晶外延层的一面上形成多个绝缘图案的步骤;(d)在第一单晶外延层和绝缘图案上形成第二单晶外延层的步骤;(e)将第二单晶外延层进行平坦化的步骤;(f)接合第一单晶衬底与表面上形成有氧化层的第二单晶衬底的步骤;(g)通过向剥离层施加能量来分离并去除第一单晶衬底的步骤;(h)从第一单晶外延层的另一面向一面方向缩减厚度的同时进行去除的步骤。
  • soi衬底制造方法
  • [发明专利]SOI基板的制造方法-CN202111550729.2在审
  • 李永浩 - 韩商则舒穆公司
  • 2021-12-17 - 2022-07-08 - H01L21/762
  • 本发明涉及SOI基板的制造方法,SOI基板的制造方法包括以下步骤:(a)在第一单晶基板的一面上形成剥离层;(b)在剥离层上形成单晶外延层;(c)在单晶外延层的一面上形成多个阴刻图案;(d)在阴刻图案和单晶外延层上形成绝缘层;(e)在绝缘层的表面上接合形成有氧化层的第二单晶基板;(f)通过向剥离层施加能量,将第一单晶基板分离并去除;(g)从单晶外延层的另一面向一面方向缩减厚度的同时进行去除。
  • soi制造方法
  • [发明专利]外延晶圆的制造方法-CN202180088195.8在审
  • 铃木克佳 - 信越半导体株式会社
  • 2021-12-06 - 2023-09-01 - C30B25/20
  • 本发明涉及一种外延晶圆的制造方法,是在单晶晶圆上形成单晶层的外延晶圆的制造方法,包含以下工序:通过氢氟酸将所述单晶晶圆表面的自然氧化膜去除;在已去除所述自然氧化膜的所述单晶晶圆的表面形成氧原子层;以及在形成有所述氧原子层的所述单晶晶圆的表面上使所述单晶外延生长,其中,使所述氧原子层的氧的平面浓度为1×1015atoms/cm2由此,提供一种能够将氧原子层稳定且简便地导入至外延层,且具有优质的单晶外延层的外延晶圆的制造方法。
  • 外延制造方法
  • [实用新型]一种高导通低漏电的肖特基芯片-CN201921868925.2有效
  • 薛涛;关仕汉;迟晓丽 - 淄博汉林半导体有限公司
  • 2019-11-01 - 2020-05-12 - H01L29/872
  • 包括衬底,在衬底表面设置有外延层,在外延层中部形成肖特基界面(4),其特征在于:所述的外延层包括第一外延层和第二外延层,在肖特基界面(4)下部的第二外延层内间隔设置有多个第二单晶区(5),在每一个第二单晶区(5)的下方分别设置有第一单晶区(3),第二单晶区(5)的宽度大于其底部对应的第一单晶区(3)的宽度。在本高导通低漏电的肖特基芯片中,设置有两层外延层,并通过设置第一单晶区和第二单晶区,可以有效阻断反向电流,同时有效增大肖特基界面的面积,降低了正向导通的电阻,因此增大了正向导通电流。
  • 一种高导通低漏电肖特基芯片
  • [发明专利]外延生长方法-CN201410138306.3在审
  • 曹威;江润峰 - 上海华力微电子有限公司
  • 2014-04-08 - 2014-07-16 - H01L21/331
  • 本发明提供了一种锗外延生长方法,所述锗外延生长方法包括:清洗单晶衬底;对所述单晶衬底表面执行原位刻蚀;在所述单晶衬底表面生长锗外延层。在本发明提供的锗外延生长方法中,通过对所述单晶衬底表面执行原位刻蚀,便可去除自然生长的氧化层,从而避免了所形成的锗外延层中产生层错、位错、滑移线等晶格缺陷,进而可提高器件/产品质量。
  • 外延生长方法
  • [发明专利]外延晶片及其制造方法-CN02816297.8有效
  • 户部敏视 - 信越半导体株式会社
  • 2002-08-21 - 2004-11-10 - H01L21/322
  • 本发明提供一种外延晶片,在掺杂氮的单晶晶片表面形成有外延层,其特征在于:体内具有吸气能力的氧析出物密度不低于108个/cm3。另外,本发明是提供一种外延晶片的制造方法,其特征在于:用CZ法拉制添加了氮的单晶,将该单晶加工成晶片,以制造出单晶晶片,在该单晶晶片进行热处理,使将晶片的体内的具有吸气能力的尺寸的氧析出物密度不低于108个/cm3,然后在上述单晶晶片上进行外延生长。由此,不依存于器件工序,可确实获得一种具有高吸气能力的单晶晶片。
  • 外延晶片及其制造方法
  • [发明专利]双极性三极管器件及其制备方法-CN201811573593.5在审
  • 孙澜;章剑锋;刘宗华 - 瑞能半导体科技股份有限公司
  • 2018-12-21 - 2020-06-30 - H01L29/06
  • 本发明公开了一种双极性三极管器件及其制备方法,该双极性三极管器件包括衬底、外延层和双极性三极管;双极性三极管包括:由轻掺杂的N‑型单晶外延层组成的集电区;由掺杂碳原子的P型单晶锗合金组成的基区,P型单晶锗合金中锗的含量沿第一方向由零递增至第一阈值后再递减为零;由重掺杂的N+型单晶组成的发射区;金属电极,包括集电极、基极和发射极;衬底为重掺杂的P+型单晶衬底;外延层包括沿第一方向层叠设置的轻掺杂的P‑型单晶外延层和重掺杂的N+型单晶外延层,集电区位于在N+型单晶外延层上,以使P+型单晶衬底与集电区之间形成反向PN结隔离。
  • 极性三极管器件及其制备方法
  • [实用新型]大功率肖特基势垒器件-CN201420385324.7有效
  • 徐吉程;毛振东;薛璐 - 苏州硅能半导体科技股份有限公司
  • 2014-07-11 - 2014-12-03 - H01L29/872
  • 本实用新型公开一种大功率肖特基势垒器件,位于所述单晶外延层上部并开口于所述单晶外延层上表面的沟槽,其特征在于:所述沟槽四壁均具有第一二氧化硅氧化层,一导电多晶体嵌入所述沟槽内,位于导电多晶体中下部的多晶中下部位于沟槽内且与单晶外延层之间设有所述第一二氧化硅氧化层,位于导电多晶体上部的多晶上部位于上金属层内,位于单晶外延层内的上部区域且位于所述沟槽上部外侧四周具有第二导电类型掺杂区,第二导电类型掺杂区与单晶外延层的接触面为弧形面,所述第二导电类型掺杂区位于单晶外延层的深度小于导电多晶体位于单晶外延层的深度
  • 大功率肖特基势垒器件

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