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- [发明专利]并行至串行转换装置-CN201110193789.3有效
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柏仓正一郎
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川崎微电子股份有限公司
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2011-07-06
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2012-01-25
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H03M9/00
- 本发明公开了一种并行至串行转换装置，包括：用于生成位交换并行数据的位交换电路、并行至串行转换电路和并行数据宽度设置电路。并行数据宽度设置电路生成具有等于根据模式设置信号的值的时钟周期的M1倍和M2倍中的一个的处理周期的处理信号。并行至串行转换电路获取位交换并行数据的M1或M2位，并且根据处理周期以特定顺序输出所获取的位。位交换电路根据模式设置信号的值来交换输入并行数据的位，使得并行至串行转换电路获取输入并行数据的第一至第M1或第M2位，并且不论模式设置信号的值如何都以固定的顺序输出所获取的位。
- 并行串行转换装置
- [发明专利]并行位反序装置和方法-CN201110459917.4有效
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谢少林;蒿杰;汪涛;尹磊祖
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中国科学院自动化研究所
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2011-12-31
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2012-07-18
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G06F12/06
- 本发明公开了一种并行位反序装置及方法，其中所述并行位反序装置包括并行位反序单元(314)、蝶形计算与控制单元(309)和存储器(311)，所述蝶形计算与控制单元(309)通过数据总线(310)与所述存储器(311)相连，所述并行位反序单元(314)用于对所述蝶形计算与控制单元(309)所计算的蝶形组数据进行位反序。所述并行位反序单元(314)包括地址反序逻辑(306)，地址反序逻辑(306)与蝶形计算与控制单元(309)相连，用于对来自蝶形计算与控制单元(309)读取地址进行镜像反序和右移操作。
- 并行反序装置方法
- [发明专利]多位宽数据串行转换装置-CN201010176289.4有效
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李广;李运海
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华为技术有限公司
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2010-05-14
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2010-09-08
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H03M9/00
- 本发明提供一种多位宽数据串行转换装置，包括：数字逻辑模块，接收八的偶数倍并行数据或十的偶数倍并行数据，在串口速率选择信号、位宽选择信号和时钟信号的控制下，将八的偶数倍并行数据转换为十六位并行数据或将十的偶数倍并行数据转换为二十位并行数据；PLL模块，在串口速率选择信号和位宽选择信号的控制下，由参考时钟信号产生时钟信号，时钟信号包括采样时钟信号和同步时钟信号；第一串行转换模块，在采样时钟信号和同步时钟信号的控制下，将二十位并行数据转换为四位并行数据，或，将十六位并行数据转换为四位并行数据。
- 多位宽数据串行转换装置
- [发明专利]高速并行位同步滤波器时变系数更新环路-CN201610443862.0有效
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唐婷;杜瑜
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中国电子科技集团公司第十研究所
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2016-06-17
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2018-08-31
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H03H17/02
- 本发明提出了一种高速并行位同步滤波器时变系数更新环路，利用本发明能有效降低高速率下并行位同步的硬件实现复杂度。本发明通过下述技术方案予以实现：在每个时刻，并行滤波器组将输出并行数据通过时钟转换模块完成工作时钟的转换后，送入位同步误差提取模块进行位同步误差的提取，将实时提取工作时钟位同步误差送入重采样时钟生成器，产生重采样时钟和时钟偏移量；重采样时钟生成器将重采样时钟及时钟偏移量输入到RAM模块，RAM存储事先计算的多组并行滤波器系数；在每个时刻，通过当前时钟偏移量读取RAM存储内容，获取与该钟偏移量对应的并行滤波器系数，将该读取并行滤波器系数作为下一个时刻的并行滤波器系数，更新并行滤波器组的时变系数。
- 高速并行同步滤波器系数更新环路
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