[发明专利]数据包处理方法及装置在审
| 申请号： | 202310320730.9 | 申请日： | 2023-03-27 |
| 公开（公告）号： | CN116346735A | 公开（公告）日： | 2023-06-27 |
| 发明（设计）人： | 刘镇;蔡鹏;周振磊 | 申请（专利权）人： | 恒生电子股份有限公司 |
| 主分类号： | H04L47/34 | 分类号： | H04L47/34;H04L47/10 |
| 代理公司： | 北京智信禾专利代理有限公司 11637 | 代理人： | 金鹏 |
| 地址： | 310053 浙江省杭州市*** | 国省代码： | 浙江;33 |
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| 摘要： | 本申请提供数据包处理方法及装置，其中所述数据包处理方法包括：接收至少一个数据包，其中，所述至少一个数据包的排序序号为乱序；将所述至少一个数据包存储至缓存空间，并提取所述数据包对应的数据包参数；根据所述至少一个数据包参数中的数据包标识，对所述至少一个数据包参数进行排序，获得参数序列，其中，所述参数序列的序列号为正序排列；基于所述参数序列，从所述缓存空间中访问所述至少一个数据包；该种方式实现了将数据包乱序进入，在FPGA中再实现正序输出，该框架结构清晰简单，不会为占用FPGA中额外的资源，也能快速地完成数据包正序的处理过程，提高数据包输出的效率。 | ||
| 搜索关键词： | 数据包 处理 方法 装置 | ||
【主权项】：
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