[发明专利]基于VHDL的浮点数转ASCII码的方法及装置在审
| 申请号： | 202111447834.3 | 申请日： | 2021-11-30 |
| 公开（公告）号： | CN114138234A | 公开（公告）日： | 2022-03-04 |
| 发明（设计）人： | 尚进;颜凯;孔云苍;刘博;蒋航;李鑫儒;赵亮 | 申请（专利权）人： | 天津光电通信技术有限公司 |
| 主分类号： | G06F7/575 | 分类号： | G06F7/575 |
| 代理公司： | 天津合正知识产权代理有限公司 12229 | 代理人： | 吕琦 |
| 地址： | 300211*** | 国省代码： | 天津;12 |
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| 摘要： | 本发明提供了一种基于VHDL的浮点数转ASCII码的方法及装置，所述方法包括：接收浮点数据；按照浮点数据的位将所述浮点数据划分为符号位、指数部分和尾数部分；对所述符号位、指数部分和尾数部分处理，分别得到符号、整数和小数部分；对符号部分、整数部分和小数部分进行解析，根据解析结果对符号部分、整数部分和小数部分进行整合，得到ASCII码。充分利用FPGA并行计算的优势，分别对符号位、指数部分和尾数部分单独处理，提升了转换速度。同时，通过对符号位、指数部分和尾数部分的处理优化。将处理过程以简单的加减处理执行。充分利用VHDL语言的特点，可以实现快速准确的将浮点数转ASCII码。 | ||
| 搜索关键词： | 基于 vhdl 浮点 ascii 方法 装置 | ||
【主权项】：
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