[发明专利]用于集成电路的功率节省功率架构在审
| 申请号： | 202110307784.2 | 申请日： | 2021-03-23 |
| 公开（公告）号： | CN113495605A | 公开（公告）日： | 2021-10-12 |
| 发明（设计）人： | R·T·Y·王;R·塞蒂亚万;H·B·陈;Y·姜;P·巴尔梅力 | 申请（专利权）人： | 硅实验室股份有限公司 |
| 主分类号： | G06F1/26 | 分类号： | G06F1/26;G06F1/3296 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 任曼怡;黄嵩泉 |
| 地址： | 美国得*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种集成电路，包括：第一多个电路，该第一多个电路接收第一内部电源电压；第一稳压器，当集成电路处于活跃模式时，该第一稳压器接收外部电源电压并响应于该外部电源电压而以第一额定功率提供第一内部电源电压；第二稳压器，当集成电路处于低功率模式时，该第二稳压器接收外部电源电压并响应于该外部电源电压以用于以低于第一额定功率的第二额定功率提供第一内部电源电压；以及控制器，该控制器控制集成电路在活跃模式和低功率模式之间的转换。在活跃模式下，控制器激活该第一多个电路中的全部，但在低功率模式下，控制器仅激活该第一多个电路的子集同时保持剩余的电路不活跃。 | ||
| 搜索关键词： | 用于 集成电路 功率 节省 架构 | ||
【主权项】：
暂无信息
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