[发明专利]基于计算机总线的错误记录表征错误相关性在审
| 申请号： | 202011556033.6 | 申请日： | 2020-12-25 |
| 公开（公告）号： | CN113495815A | 公开（公告）日： | 2021-10-12 |
| 发明（设计）人： | D·达斯夏尔马 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F11/22 | 分类号： | G06F11/22;G06F13/42 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘文灿 |
| 地址： | 美国加*** | 国省代码： | 暂无信息 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 系统和设备可以包括前向纠错(FEC)逻辑，以识别第一flit中的可纠正错误，并使用三个纠错码(ECC)组来纠正可纠正错误。系统和设备还可以包括错误日志，该可纠正错误日志用于记录由每个ECC组纠正的第一flit中的符号编号，并记录在第一flit中由每个ECC组纠正的可纠正错误的大小；以及用于记录链路错误相关性的配置寄存器，该链路错误相关性包括对第一flit中的一个或多个错误位的指示。 | ||
| 搜索关键词： | 基于 计算机 总线 错误 记录 表征 相关性 | ||
【主权项】：
暂无信息
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