[发明专利]FC-AE-1553总线与MIL-STD-1553B总线非透明桥接系统在审

专利信息
申请号: 201811447233.0 申请日: 2018-11-29
公开(公告)号: CN109587029A 公开(公告)日: 2019-04-05
发明(设计)人: 张智勇;王虹 申请(专利权)人: 北京计算机技术及应用研究所
主分类号: H04L12/46 分类号: H04L12/46
代理公司: 中国兵器工业集团公司专利中心 11011 代理人: 张然
地址: 100854*** 国省代码: 北京;11
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摘要: 发明涉及一种FC‑AE‑1553总线与MIL‑STD‑1553B总线非透明桥接系统,其中,包括:NC端、NT端和被控制设备节点;NC端包括控制器和FC‑AE‑1553模块,NT端包括ARM处理器、FPGA、MIL‑STD‑1553B收发器、网络变压器和光纤通讯模块;FPGA内嵌IP核形式实现FC‑AE‑1553通讯接口,运行时间通过FC‑AE‑1553对时协议进行时间同步。本发明在特定情况下将低速1553B时控制总线与高速FC‑AE‑1553总线非透明桥接,可以满足控制信息的长距离传输,电子系统在总线高速通讯是远程控制中的应用和高低速总线相互转换的应用。
搜索关键词: 总线 非透明桥 光纤通讯模块 被控制设备 长距离传输 网络变压器 电子系统 对时协议 高速通讯 控制信息 控制总线 时间同步 通讯接口 远程控制 控制器 高低速 收发器 内嵌 应用 转换
【主权项】:
1.一种FC‑AE‑1553总线与MIL‑STD‑1553B总线非透明桥接系统,其特征在于,包括:NC端、NT端和被控制设备节点;NC端包括控制器和FC‑AE‑1553模块,NT端包括ARM处理器、FPGA、MIL‑STD‑1553B收发器、网络变压器和光纤通讯模块;FPGA内嵌IP核形式实现FC‑AE‑1553通讯接口,运行时间通过FC‑AE‑1553对时协议进行时间同步;设备加电后,先加载PCIe驱动,初始化FC‑AE‑1553,初始化1553B,将1553B初始化为BUS Control模式,NC端发送状态查询帧,NT端接收数据放入环形缓冲队列内,FC‑AE‑1553模块将环形缓冲队列中的数据取出,根据内容将转换为1553B数据,被控设备接收NT端的数据后,执行相应动作,并反馈确认信息,同时返回状态信息,当NT端接收到来自NC端发送的数据帧后,首先根据报文标识判断帧的类型,从而确定转发通道为1553B,解析NC数据帧的位号可得到转发数据的MIL‑STD‑1553B通道号;同时通过NC数据帧的数据参数字段,参考MIL‑STD‑1553B协议可得出MIL‑STD‑1553B数据帧的种类;依据通信双方的协议规定,MIL‑STD‑1553B数据帧的数据段内容由NC数据帧的指令内容解析得到;之后调用MIL‑STD‑1553B发送函数,将解析得出的MIL‑STD‑1553B数据帧发送至后端的被控制设备,进行后续的动作与反馈。
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