[发明专利]用于调整时钟频率的存储系统有效
| 申请号： | 201811388365.0 | 申请日： | 2018-11-21 |
| 公开（公告）号： | CN109901665B | 公开（公告）日： | 2023-06-13 |
| 发明（设计）人： | 金荣柱;姜东锡;权慧贞;金炳喆;裴升浚 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G06F1/08 | 分类号： | G06F1/08 |
| 代理公司： | 北京市立方律师事务所 11330 | 代理人： | 李娜 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种用于调整时钟频率的存储系统，该存储系统包括逻辑电路和锁相环(PLL)电路。逻辑电路使用第一信号确定第一时钟的第一频率并且生成用于调整第一时钟的第一频率的第二信号。锁相环电路接收第二时钟并且使用第二时钟和第二信号生成具有由逻辑电路确定的第一频率的第一时钟。当第二时钟的第二频率变化时，逻辑电路确定第一时钟的第一频率，使得由锁相环电路生成的第一时钟的第一频率基本不变化，并且基于具有由第二信号调整的第一频率的第一时钟运行。 | ||
| 搜索关键词： | 用于 调整 时钟 频率 存储系统 | ||
【主权项】：
1.一种存储系统，包括：逻辑电路，所述逻辑电路被配置为使用第一信号确定第一时钟的第一频率并且生成用于调整所述第一时钟的所述第一频率的第二信号；以及锁相环电路，所述锁相环电路被配置为接收第二时钟和所述第二信号并且使用所述第二时钟和所述第二信号生成具有由所述逻辑电路确定的所述第一频率的所述第一时钟，其中，当所述第二时钟的第二频率变化时，所述逻辑电路使用所述第二信号控制所述锁相环电路使得由所述锁相环电路生成的所述第一时钟的所述第一频率不变化，并且基于具有由所述第二信号调整的所述第一频率的所述第一时钟操作。
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