[发明专利]一种地面雷达自适应距离幅度加权系统及方法有效
申请号: | 201810675350.6 | 申请日: | 2018-06-27 |
公开(公告)号: | CN108594197B | 公开(公告)日: | 2022-03-04 |
发明(设计)人: | 谢仁宏;乔帅;王丽妍;芮义斌;李鹏;郭山红;仇雯;王丙休 | 申请(专利权)人: | 南京理工大学 |
主分类号: | G01S7/41 | 分类号: | G01S7/41 |
代理公司: | 南京理工大学专利中心 32203 | 代理人: | 马鲁晋 |
地址: | 210094 江*** | 国省代码: | 江苏;32 |
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摘要: | 本发明公开了一种地面雷达自适应距离幅度加权系统及方法,所述方法包括以下步骤:首先高速ADC模块接收雷达中频回波信号,并对其进行数字化处理,获得中频数字回波信号;接着FPGA模块对中频数字回波信号进行数字正交下变频处理,采集基带数据并将其存储于DSP的EMIF外扩存储器;然后DSP模块获取上一步存储的基带数据,之后根据基带数据求取加权系数,并将加权系数存储于DSP的EMIF外扩存储器;最后FPGA模块从DSP的EMIF外扩存储器读取加权系数,并根据加权系数对中频数字回波信号进行数字正交下变频处理,获得加权后的基带数据,实现自适应距离幅度加权。本发明能保证强杂波区域回波定点处理不溢出,提高远距离弱杂波区域的杂波基底,进而提高雷达的检测和虚警性能。 | ||
搜索关键词: | 一种 地面 雷达 自适应 距离 幅度 加权 系统 方法 | ||
【主权项】:
1.一种地面雷达自适应距离幅度加权系统,其特征在于,包括高速ADC模块、高速DAC模块、FPGA模块、DSP模块、时钟模块、电源模块;所述高速DAC模块的输入端与FPGA模块相连;所述高速ADC模块的输出端与FPGA模块相连;FPGA模块通过EMIF总线接口和GPIO接口与DSP模块相连;所述时钟模块与高速ADC、高速DAC模块、FPGA模块、DSP模块均相连;所述电源模块与高速ADC模块、高速DAC模块、FPGA模块、DSP模块均相连;所述高速DAC模块,用于将FPGA产生的中频信号转化为模拟信号;所述高速ADC模块,用于对雷达信号中的中频信号进行数字化处理;所述FPGA模块,用于实现正交下变频、自适应距离幅度加权;所述DSP模块,用于读取FPGA存储的数据并实时求取加权系数;所述时钟模块,用于为高速DAC模块、高速ADC模块、FPGA模块、DSP模块提供工作时钟;所述电源模块,用于为高速DAC模块、高速ADC模块、FPGA模块、DSP模块提供工作电压。
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