[发明专利]一种用于在航电系统中提高通信与处理速度的装置和方法在审
| 申请号： | 201810333245.4 | 申请日： | 2018-04-13 |
| 公开（公告）号： | CN108563607A | 公开（公告）日： | 2018-09-21 |
| 发明（设计）人： | 徐国;邓雪 | 申请（专利权）人： | 成都赫尔墨斯科技股份有限公司 |
| 主分类号： | G06F15/173 | 分类号： | G06F15/173;G06F11/30 |
| 代理公司： | 四川力久律师事务所 51221 | 代理人： | 韩洋;刘童笛 |
| 地址： | 610000 四川省成都市中国（四川）自*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了用于在航电系统中提高通信与处理速度的装置和方法，能够提高通信处理速度，增加处理的机载设备数量，并保持航电系统的稳定性和可靠性。该装置包括通过SRIO接口连接的FPGA与CPU；其中，FPGA具有：多个串行输入接口，多个与串行输入接口连接的接收缓存模块，与每个接收缓存模块连接的第一组包模块；CPU具有：解包模块，数据处理模块，第二组包模块；FPGA进一步包括：译码模块，用于读取第二心跳数据包中针对各个机载设备的控制数据，并发送给相应的发送缓存模块；多个发送缓存模块，分别连接至多个串行输出接口以及至少一个以太网接口，并用于根据与接口对应的通信协议的以预定的速率向各机载设备发送控制数据。 | ||
| 搜索关键词： | 航电系统 机载设备 串行输入接口 发送缓存 接收缓存 组包 读取 串行输出接口 发送控制数据 数据处理模块 心跳数据包 以太网接口 控制数据 模块连接 通信处理 通信协议 译码模块 解包 通信 并发 | ||
【主权项】：
1.一种用于在航电系统中提高通信与处理速度的装置，其特征在于，所述装置包括通过SRIO接口连接的FPGA与CPU；其中，FPGA具有：多个串行输入接口，用于接收多个机载设备数据通道发送的数据；多个与串行输入接口连接的接收缓存模块，用于对来自各通道的数据进行临时缓存；与每个接收缓存模块连接的第一组包模块，用于将缓存的数据按照预设的编码方式进行组包以获取第一心跳数据包，并根据预定的心跳周期将第一心跳数据包通过FPGA与CPU之间的SRIO接口发送给CPU；CPU具有：解包模块，用于按照预设的编码方式从来自FPGA的第一心跳数据包读取各个通道的数据；数据处理模块，用于对各通道的数据进行处理，生成针对各机载设备的控制数据；第二组包模块，用于将控制数据按照预设的编码方式进行组包，以获取第二心跳数据包，并根据预定的第二心跳周期发送给FPGA；FPGA进一步包括：与每个发送缓存模块连接的译码模块，用于读取第二心跳数据包中针对各个机载设备的控制数据，并发送给相应的发送缓存模块；多个发送缓存模块，分别连接至多个串行输出接口以及至少一个以太网接口，并根据与接口对应的通信协议的以预定的速率向各机载设备发送控制数据。
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