[发明专利]增强型动态时钟和电压缩放(DCVS)方案有效
| 申请号： | 201780022134.5 | 申请日： | 2017-02-24 |
| 公开（公告）号： | CN108885486B | 公开（公告）日： | 2021-05-25 |
| 发明（设计）人： | 朴熙俊;C·杜罗尤 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F1/3234 | 分类号： | G06F1/3234;G06F1/3203;G06F1/324;G06F1/3287;G06F1/329 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 在某些方面，一种用于频率缩放的方法包括确定多个处理器中是否仅子集是活动的，其中多个处理器共享一个或多个资源。该方法还包括如果确定仅多个处理器的子集是活动的、并且多个处理器的子集中的至少一个处理器的频率低于频率阈值，则增加该至少一个处理器的频率。例如，这可以被进行以增加一个或多个共享资源的空闲模式的持续时间并且实现包括多个处理器、一个或多个共享资源和/或其他功能块的系统的总体功率降低。 | ||
| 搜索关键词： | 增强 动态 时钟 电压 缩放 dcvs 方案 | ||
【主权项】：
1.一种用于频率缩放的方法，包括：确定多个处理器中是否仅子集是活动的，其中所述多个处理器共享一个或多个资源；以及如果确定所述多个处理器中仅所述子集是活动的、并且所述多个处理器的所述子集中的至少一个处理器的频率低于频率阈值，则增加所述至少一个处理器的频率。
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