[实用新型]一种基于FPGA的逻辑分析仪有效
| 申请号： | 201720285293.1 | 申请日： | 2017-03-22 |
| 公开（公告）号： | CN206638783U | 公开（公告）日： | 2017-11-14 |
| 发明（设计）人： | 张喆;王宏斌;李颖;马宏锋;李祥林 | 申请（专利权）人： | 兰州工业学院 |
| 主分类号： | G01R31/3177 | 分类号： | G01R31/3177 |
| 代理公司： | 广东广信君达律师事务所44329 | 代理人： | 杨晓松 |
| 地址： | 730050 *** | 国省代码： | 甘肃;62 |
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| 摘要： | 本实用新型公开了一种基于FPGA的逻辑分析仪，包括信号发生模块、与信号发生模块相连的控制模块和与信号发生模块和所述控制模块相连的VGA显示模块；其中信号发生模块用于对系统复位信号进行异步复位和同步释放；控制模块包括时钟分频模块、与时钟分频模块相连的时钟选择模块、与时钟选择模块相连的波形数据存储模块、与波形数据存储模块相连的数据显示格式转换模块和连接显示格式转换模块的VGA接口；VGA接口连接VGA显示模块。本实用新型使用液晶显示器作为波形显示屏幕，用FPGA控制，其接口、数据传输及数据显示全是数字化工作的，实时采样波形的显示效果良好，本实用新型具有成本低、速度快、方便携带的特点。 | ||
| 搜索关键词： | 一种 基于 fpga 逻辑 分析 | ||
【主权项】：
一种基于FPGA的逻辑分析仪，其特征在于，包括信号发生模块、与所述信号发生模块相连的控制模块和与所述信号发生模块和所述控制模块相连的VGA显示模块；其中所述信号发生模块用于对系统复位信号进行异步复位和同步释放，且包括CycloneII芯片，所述CycloneII芯片内部的PLL例化得到多个稳定可靠的时钟信号；所述控制模块包括时钟分频模块、与所述时钟分频模块相连的时钟选择模块、与所述时钟选择模块相连的波形数据存储模块、与所述波形数据存储模块相连的数据显示格式转换模块和连接所述显示格式转换模块的VGA接口；所述VGA接口连接所述VGA显示模块。
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