[发明专利]一种高速加密传输接口电路及方法在审

专利信息
申请号: 201711206044.X 申请日: 2017-11-27
公开(公告)号: CN107908970A 公开(公告)日: 2018-04-13
发明(设计)人: 王子彤;姜凯;聂林川 申请(专利权)人: 济南浪潮高新科技投资发展有限公司
主分类号: G06F21/60 分类号: G06F21/60;H04L9/08;H04L9/32;G06F7/58
代理公司: 济南信达专利事务所有限公司37100 代理人: 阚恭勇
地址: 250100 山东省济南市*** 国省代码: 山东;37
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摘要: 发明提供一种高速加密传输接口电路及方法,涉及数据高速安全传输领域,本发明包括加密端电路和解密端电路。以低压差分电平信号形式保证互联传输速度,同时采用通用加密算法或用户自定义算法对芯片间交互数据进行加密传输,安全性得到保障,以认证码校验形式提高传输接口的可靠性,且相较于一般硬核传输接口,可节省部分片上资源。
搜索关键词: 一种 高速 加密 传输 接口 电路 方法
【主权项】:
一种高速加密传输接口电路,其特征在于,所述电路包括加密端电路和解密端电路;所述加密端电路作为高速加密传输接口的发送端,包括:随机数生成模块,数据缓存模块,加密处理模块,校验码计算模块,组包模块,并串及单端差分转换模块;所述随机数生成模块用于根据输入的随机噪声,采用加密算法,得到用于加密处理的随机数,随机数长度与待加密数据长度一致;所述数据缓存模块用于将待加密数据缓存并输出至加密处理模块;所述加密处理模块用于将待加密数据与随机数通过算法计算得到密文;所述校验码计算模块用于使用随机数对加密后的密文进行校验码计算;所述组包模块用于将随机数,加密密文,校验码组成一个包含包头包尾的完整数据包发送至后级模块;所述并串及单端差分转换模块用于将组好的加密数据包由并行转换成串行数据,并将单端信号转换成差分电平信号发送至解密端电路;所述解密端电路作为高速加密传输接口的接受端,包括:差分单端及串并转换模块,分包模块,校验模块,解密处理模块,数据缓存模块;所述差分单端及串并转换模块用于将输入的密文进行差分电平到单端电平转换,并将串行数据重新整合成并行数据;所述分包模块用于取出加密数据包的随机数,加密密文及校验码;所述校验模块用于使用收到的随机数对密文进行校验码计算,并与收到的校验码进行比较;所述解密处理模块用于根据随机数对密文进行解密,并将校验通过的数据送至所述数据缓存模块进行存储。
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