[发明专利]一种数据存储与读取的方法和装置有效
申请号: | 201711092277.1 | 申请日: | 2017-11-08 |
公开(公告)号: | CN107798117B | 公开(公告)日: | 2020-12-04 |
发明(设计)人: | 张代生;吴刚 | 申请(专利权)人: | 杭州迪普科技股份有限公司 |
主分类号: | G06F16/22 | 分类号: | G06F16/22;G06F16/2458 |
代理公司: | 北京博思佳知识产权代理有限公司 11415 | 代理人: | 林祥 |
地址: | 310051 浙江省杭*** | 国省代码: | 浙江;33 |
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摘要: | 本申请提供一种数据存储与读取的方法,应用于网络设备,其中所述网络设备包括可编程逻辑器件,所述方法包括:所述可编程逻辑器件接收所述网络设备的CPU发送的待存储数据,以及所述待存储数据的地址;所述可编程逻辑器件将所述待存储数据的地址并行输入至所述二进制trie树以查找与该地址对应的寄存器,并将所述待存储数据存储至该寄存器;所述可编程逻辑器件接收所述CPU发送的待读取数据的地址;所述可编程逻辑器件将所述待读取数据的地址并行输入至所述二进制trie树以查找与该地址对应的寄存器,并从该寄存器中读取存储的数据。采用本申请提供的技术方法,加快数据存储与读取的速度。 | ||
搜索关键词: | 一种 数据 存储 读取 方法 装置 | ||
【主权项】:
一种数据存储与读取的方法,应用于网络设备,其特征在于,所述网络设备包括可编程逻辑器件,其中,所述可编程逻辑器件使用寄存器建立了二进制trie树,所述二进制trie树的根节点以外的各节点分别对应于一个寄存器,所述寄存器用于存储数据,所述可编程逻辑器件支持将数据的存储地址并行输入二进制trie树,包括:所述可编程逻辑器件接收所述网络设备的CPU发送的待存储数据,以及所述待存储数据的地址;所述可编程逻辑器件将所述待存储数据的地址并行输入至所述二进制trie树以查找与该地址对应的寄存器,并将所述待存储数据存储至该寄存器;所述可编程逻辑器件接收所述CPU发送的待读取数据的地址;所述可编程逻辑器件将所述待读取数据的地址并行输入至所述二进制trie树以查找与该地址对应的寄存器,并从该寄存器中读取存储的数据。
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